数电选择题讲解.docx
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数电选择题讲解
1、,,它们的逻辑关系是（A）。
A.B.C.D.和互为对偶式
2、由集电极开路门构成的逻辑电路如图所示，则它所完成的逻辑功能是F＝（C）。
A、A⊕BB、
C、D、
3、74LS138是3线-8线译码器，译码输出为低电平有效，若输入A2A1A0=100时，输出= B 。
Ａ.00010000，B.1110111C.11110111
4、引起组合逻辑电路中竟争与冒险的原因是（D）
A、逻辑关系错；B、干扰信号；C、电路延时；D、电源不稳定。
5、时序逻辑电路中一定包含A。
A.触发器B.组合逻辑电路
C.移位寄存器D.译码器
6、如图时序电路的初始状态为，经过2个时钟脉冲作用后其状态为。
B
A、B、
C、D、
7、如果一个半导体储存器中有m位地址线，则应有（）个储存单元，若输出位数为n位，则其存储容量为（）位。
（D）
A：
m、m×nB：
2m、2nC：
2m、2nD：
2m、2m×n
8、下列哪种电路没有稳态（A）
A多谐振荡器B单稳态触发器C基本RS触发器
9．施密特触发器常用于对脉冲波形的（C）。
A．延时和定时B.计数与寄存C．整形与变换
10、某计数器由四个触发器组成，触发器时钟脉冲及输出端、、、的波形如图所示，高位到低位依次是到，则该计数器是（C）计数器。
A十二进制加法B十二进制减法
C十进制加法D十一进制加法
1、A2、C3、B4、C5、A
6、B7、D8、A9、C10、C
1、在何种情况下，“或非”运算的结果是逻辑“0”。
（D）
A．全部输入为“0”B．全部输入为“1”
C.任一输入为“0”，其他输入为“1”D.任一输入为“1”
2、在下列逻辑电路中，不是组合逻辑电路的是（D）。
A.译码器B.编码器C.全加器D.寄存器
3、逻辑数F=A+B，当变量的取值为（C）时，将出现冒险现象。
A.B=C=1B.B=C=0C.A=1，C=0D.A=0，B=0
4、时序逻辑电路中一定是含（A）
A.触发器B.组合逻辑电路C.移位寄存器D.译码器
5、8—3线优先编码器（74LS148）中，8条输入线~同时有效时，优先级最高为I7线，则输出线的状态是（A）
A.000B.010C.101D.111
6、下列触发器中没有约束条件的是___D__。
Ａ基本ＲＳ触发器 Ｂ主从ＲＳ触发器
Ｃ钟控ＲＳ触发器 Ｄ边沿Ｄ触发器
7、在CP作用下，欲使T触发器具有Qn+1=的功能，其T端应接（A）
A、1B、0C、D、
8、由集电极开路门构成的逻辑电路如图所示，则它所完成的逻辑功能是F＝（C）。
A.A⊕BB.
C.D.
9、用n个触发器构成计数器，可得到最大计数长度是（C）。
A.nB.2nC.2nD.2n-1
10、如果触发器的次态仅取决于CP（A）时输入信号的状态，就可以克服空翻。
A.上升（下降）沿B.高电平C.低电平D.无法确定
1、D2、D3、C4、A5、A
6、D7、A8、C9、C10、A
1、，,它们的逻辑关系是（A）。
A.B.C.D.和互为对偶式
2、由集电极开路门构成的逻辑电路如右图所示，则它所完成的逻辑功能是F＝（A）。
A、A⊕BB、
C、D、
3、可以代换下图所示组合电路的一个门电路是B。
A.与非门B.或非门
C.与或非门D.异或门
4、设所给电路均为TTL电路，能实现逻辑功能的电路是（D）。
、
ABCD
5、74LS138是3线-8线译码器，译码输出为低电平有效，若输入A2A1A0=100时，输出= B 。
Ａ.00010000，B.11101111C.11110111D.10000000
6、引起组合逻辑电路中竟争与冒险的原因是（D）
A、逻辑关系错；B、干扰信号；C、电路延时；D、电源不稳定。
7、时序逻辑电路中一定包含A。
A.触发器B.组合逻辑电路C.移位寄存器D.译码器
8、在CP作用下，欲使T触发器具有=的功能，其T端应接（A）
A、1B、0C、D、
9、如图时序电路的初始状态为，经过两个时钟脉冲作用后其状态为（B）。
A、B、
C、D、
10、在同步计数器中，各触发器状态改变时刻（A）。
A、相同B、不相同C、与触发器有关D、与电平相同
11、下列哪种电路没有稳态（C）
A.基本RS触发器B.单稳态触发器C.多谐振荡器D.施密特触发器
12、某计数器由四个触发器组成，触发器时钟脉冲及输出端、、、的波形如图所示，高位到低位依次是到，则该计数器是（C）计数器。
A、十二进制加法
B、十二进制减法
C、十进制加法
D、十一进制加法
13、一个振荡器电路中晶振元件的标称频率是6MHz，电容为30PF，则该电路输出信号的频率是（A）
A、6MHZB、2MHZC、3MHZD、12MHZ
14、用n个触发器构成计数器，可得到最大计数长度是（C）。
A.nB.2nC.2nD.2n-1
15、将一个最大幅值为5V的模拟信号转换为数字信号，要使模拟信号每变化10mV，数字信号的最低发生变化应选用（D）位的A/D转换器。
A、6B、7C、8D、9
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
A
A
B
D
B
C
A
A
B
A
C
C
A
C
D
1、555定时器输出状态的改变有A现象，回差电压为。
A.滞回，B.滞回，C.落差，D.落差，
2、电路为CMOS门电路，要想使,选择正确答案。
B
A.正确,错误,错误,错误B.错误,错误,错误,错误
C.正确,正确,正确,错误D.正确,正确,错误,错误
3、八选一数据选择器组成电路如下图所示，该电路实现的逻辑函数是Y=D。
A.
B.
C.
D.
4、二输入端的或非门，其输入端为A、B，输出端为Y,则其表达式Y=C。
A、ABB、C、D、A+B
5、七段显示译码器是指B的电路。
A.将二进制代码转换成0~9数字B.将BCD码转换成七段显示字形信号
C.将0~9数字转换成BCD码D.将七段显示字形信号转换成BCD码
6、同步时序逻辑电路和异步时序逻辑电路比较，其差别在于后者B。
A.没有触发器B.没有统一的时钟脉冲控制
C.没有稳定状态D.输出只与内部状态有关C
7、以下电路中,欲获得一个数字系统的时钟脉冲源,应采用_____B_____。
A．D触发器B.多谐振荡器C.单稳态触发器D.施密特触发器
8、一个T触发器，在T=1时，加上时钟脉冲，则触发器D。
A、保持原态B、置0C、置1D、翻转
9、组合逻辑电路通常由A组合而成。
A.门电路B.触发器C.计数器D.寄存器
10、指出下列各式中哪个是四变量Ａ、Ｂ、Ｃ、Ｄ的最小项C
A、ABC； B、A+B+C+D； C、ABCD； D、A+B+D
11、最小项的逻辑相邻最小项是A。
A.B.C.D.
12、在移位寄存器中采用并行输出比串行输出A。
A、快B、慢C、一样快D、不确定
13、下图中,满足Q＊=Q的触发器是______D_______。
14、十六路数据选择器，其地址输入端有C个。
A.16B.2C.4D.8
15、用8421码表示的十进制数65，可以写成C。
A．65B.[1000001]BCDC.[01100101]BCDD.[1000001]2
1、A2、B3、D4、C5、B
6、B7、B8、D9、A10、C
11、A12、A13、D14、C15、C
1、函数F=A⊕B与G=+AB（ ）
互为对偶式 互为反函数 ③相等 ④以上答案都不对
2、函数F=AB+C+C+D+的最简与或式为（ ）
①1 ②0 ③AB ④AB+
3、下列电路中，不属于时序电路的是（ ）
1移位寄存器 ②触发器 ③一位全加器 ④十进制计数器
4、一个二—十进制译码器，规定输出为低电平有效，当输入代码DCBA=1001时其输出Y0Y1Y2Y3Y4Y5Y6Y7Y8Y9＝（ ）
11111111110②0000000001
20000001001 ④1111110110
5、下列电路中，只有（ ）不能实现Qn+1=
①②
1
CPCP
1
③④
CPCP
6、用555定时器构成的施密特触发器，若电压控制端不外接固定电压，则其上限阈值电压与下限阈值电压为（）
1VT+=VCC，VT-=VCC②VT+=VCC，VT-=VCC
③VT+=VCC，VT-=VCC④VT+=VCC，VT-=VCC
7、如果一个二进制编码器有6位输出代码，则该编码器最多可以对（ ）个输入信号进行编码。
①8 ②16 ③32 ④64
8、在10位D/A转换器中，其分辨率是（ ）
① ② ③ ④
9、下列电路中，对应于F=的逻辑电路为（ ）
① ② ③ ④
AFFAFAFAF
BBBB
10K（TTL）1M（CMOS）
10、一个移位寄存器初态为0000，若输入始终为1，则经过4个移位脉冲后其状态为（ ）
10001 ②0111 ③1110 ④1111
1、②2、①；3、③；4、①；5、③；
6、②；7、④；8、③；9、④；10、④；
1、555定时器输出状态的改变有现象，回差电压为。
A.滞回，B.滞回，C.落差，D.落差，
2、电路为CMOS门电路，要想使,选择正确答案。
A.正确,错误,错误,错误B.错误,错误,错误,错误
C.正确,正确,正确,错误D.正确,正确,错误,错误
3、八选一数据选择器组成电路如下图所示，该电路实现的逻辑函数是Y=。
A.
B.
C.
D.
4、二输入端的或非门，其输入端为A、B，输出端为Y,则其表达式Y=。
A.ABB.C.D.A+B
5、七段显示译码器是指的电路。
A.将二进制代码转换成0~9数字B.将BCD码转换成七段显示字形信号
C.将0~9数字转换成BCD码D.将七段显示字形信号转换成BCD码
6、同步时序逻辑电路和异步时序逻辑电路比较，其差别在于后者。
A.没有触发器B.没有统一的时钟脉冲控制
C.没有稳定状态D.
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