数字电子技术题库资料Word文档格式.docx

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约束条件

9.逻辑函数

的标准与或式为（）

10.图中门电路为74系列TTL门。

要求当VI＝VIH时，发光二极管D导通并发光，且发光二极管导通电流约为10mA，下列说法正确的是（）

（A）两个电路都不能正常工作

（B）两个电路都能正常工作

（C）电路（A）可以正常工作

（D）电路（B）可以正常工作

11.74HC00为CMOS与非门采用+5V电源供电，输入端在下面哪种接法下属于逻辑0（）

A．输入端接地B.输入端接高于3.6V电源C.输入端悬空D.输入端接同类与非门的输出高电平3.6V

12.下列说法正确的是（）

（A）组合逻辑电路的输出不仅和该时刻的输入有关，还与电路原来的状态有关

（B）常用的组合逻辑电路有编码器、译码器、加法器、比较器、寄存器

（C）组合逻辑电路可能发生竞争冒险

（D）组合逻辑电路需要用状态方程来描述其逻辑功能

13.用8选1数据选择器实现函数

，A2、A1、A0分别接A、B、C，下列选项正确的是（）4分

（A）

（B）

（C）

（D）

14.8线—3线优先编码器的输入为I0—I7，当优先级别最高的I7有效时，其输出

的值是（）。

A．111B.010C.000D.101

15.十六路数据选择器的地址输入（选择控制）端有（）个。

A．16B.2C.4D.8

16.已知74LS138译码器的输入三个使能端（E3=1，E1=E2=0）时，地址码A2A1A0=011，则输出Y7～Y0是（）。

A.11111101B.10111111C.11110111D.11111111

17.设计一个全加器，选择哪个方案可以实现（）

（A）编码器和必要的门电路

（B）数值比较器和必要的门电路

（C）二进制译码器和必要的门电路

（D）7段显示译码器和必要的门电路

18.函数F=AB+BC，使F=1的输入ABC组合为（ 

）

A．ABC=000 

B．ABC=010C．ABC=101 

D．ABC=110

19.已知某电路的真值表如下，该电路的逻辑表达式为（）。

A．

C．

D．

A

B

C

Y

1

20.下列选项中是8421BCD码的是（）

A.0101B.1010C.1100D.1111

21.逻辑函数

的最简与或式是（）

A.1B.

C.AD.A+B+C

22.欲对全班40个学生以二进制代码表示，至少需要二进制码的位数是（）

A.6B.5C.10D.53

23.以下式子中不正确的是（）

A.

B.

D.

24.在数字电路中，稳态时三极管一般工作在（）状态。

在图示电路中，若

，则三极管T（）,此时

=（）

A．开关，截止，3.7V

B．放大，截止，5V

C．开关，饱和，0.3V

D．开关，截止，5V

25.数字电路中的工作信号为（）。

A.脉冲信号B.随时间连续变化的电信号C.直流信号D.模拟信号

26.下列等式不成立的是（）

A.AB+AC+BC=AB+BCB.（A+B）（A+C）=A+BC

C.A+AB=AD.

27.最小项

逻辑相邻项是（）

A.ABCDB.

28.下列逻辑门类型中，可以用（）一种类型门实现另三种基本运算。

A．与非门B．非门C．或门D．与门

29.n个变量的最小项是。

A.n个变量的积项，它包含全部n个变量，每个变量可用原变量或非变量。

B.n个变量的和项，它包含全部n个变量，每个变量可用原变量或非变量。

C.n个变量的积项，它包含全部n个变量，每个变量仅为原变量。

D.n个变量的和项，它包含全部n个变量，每个变量仅为非变量。

30.三态门输出高阻状态时，是正确的说法。

A.用电压表测量指针不动B.相当于悬空C.电压不高不低D.测量电阻指针不动

31.对于TTL与非门闲置输入端的处理，可以。

A.接电源B.通过电阻3kΩ接电源C.接地D.与有用输入端并联

32.CMOS数字集成电路与TTL数字集成电路相比突出的优点是。

A.微功耗B.高速度C.高抗干扰能力D.电源范围宽

33.如果要将一组并行的输入数据转换为串行输出，则应采用哪种电路（）

A.计数器B.编码器C.数据选择器D.数据分配器

34.三位二进制编码器输出与输入端的数量分别为（ 

） 

A.3个、2个 

B.3个、8个 

C.8个、3个 

D.2个、3个 

35.七段显示译码器，当译码器七个输出端状态是abcdefg=0110011，高电平有效，输入一定为（ 

A.0011 

B.0110 

C.0100 

D.0101

36.译码器驱动输出为低电平，则显示器应该选用（ 

A.共阴极显示器 

B.共阳极显示器 

C.两者均可 

D.不能确定

37.半加器的逻辑功能是（） 

A、两个同位的二进制数相加 

B、两个二进制数相加 

C、两个同位的二进制数及来自低位的进位三者相加 

D、两个二进制数的和的一半

38.全加器的逻辑功能是（） 

D、不带进位的两个二进制数相加

39.对于两个4位二进制数A（A3A2A1A0）、B（B3B2B1B0），下面说法正确的是（） 

A、如果A3＞B3，则A＞B 

B、如果A3＜B3，则A＞B 

C、如果A0＞B0，则A＞B 

D、如果A0＜B0，则A＞B

40.实现多输入、单输出逻辑函数，应选（） 

A、编码器 

B、译码器 

C、数据选择器 

D、数据分配器

41.对于触发器和组合逻辑电路，以下（）的说法是正确的。

A、两者都有记忆能力B、两者都无记忆能力

C、只有组合逻辑电路有记忆能力D、只有触发器有记忆能力

42.CP有效期间，同步RS触发器的特性方程是（）。

A、

B、

（RS=0）C、

D、

（RS=0）

43.CP有效期间，同步D触发器特性方程是（）。

C、

44.对于JK触发器，输入J=0、K=1，CP脉冲作用后，触发器的

应为（）。

A、0B、1C、可能是0，也可能是1D、与

有关、

45.JK触发器在CP脉冲作用下，若使

，则输入信号应为（）。

46.具有“置0”“置1”“保持”“翻转”功能的触发器叫（A）。

A、JK触发器B、基本RS触发器C、同步D触发器D、同步RS触发器

47.仅具有“保持”“翻转”功能的触发器叫（）。

A、JK触发器B、RS触发器C、D触发器D、T触发器

48.仅具有“翻转”功能的触发器叫（）。

A、JK触发器B、RS触发器C、D触发器D、T’触发器

49.时序逻辑电路中一定包含（）

A、触发器B、编码器C、移位寄存器D、译码器

50.时序电路某一时刻的输出状态，与该时刻之前的输入信号（）

A、有关B、无关C、有时有关，有时无关D、以上都不对

51.用n个触发器构成计数器，可得到的最大计数长度为（）

52.同步时序逻辑电路和异步时序逻辑电路比较，其差异在于后者（）

A、没有触发器B、没有统一的时钟脉冲控制C、没有稳定状态D、输出只与内部状态有关

53.一位8421BCD计数器，至少需要（）个触发器。

A、3B、4C、5D、10

54.经过有限个CP，可由任意一个无效状态进入有效状态的计数器是（）自启动的计数器。

A、能B、不能C、不一定能D、以上都不对

55.寄存器在电路组成上的特点是（）

A、有CP输入端，无数码输入端。

B、有CP输入端和数码输入端。

C、无CP输入端，有数码输入端。

D、无CP输入端和数码输入端。

56.通常寄存器应具有（）功能。

A、存数和取数B、清零和置数C、A和B都有D、只有存数、取数和清零，没有置数。

57.表示脉冲电压变化最大值的参数叫（）。

A、脉冲幅度B、脉冲宽度C、脉冲前沿D、脉冲后沿

58.表示两个相邻脉冲重复出现的时间间隔的参数叫（）。

A、脉冲周期B、脉冲宽度C、脉冲前沿D、脉冲后沿

59.集成555定时器的输出状态有（）

A、0状态B、1状态C、0和1状态D、高阻态

60.多谐振荡器能产生（）

A、正弦波B、矩形波C、三角波D、锯齿波

61.用555定时器构成的施密特触发器的回差电压

可表示为（）

B、

62.施密特触发器常用于对脉冲波形的（）。

A、计数B、寄存C、延时与定时D、整形与变换

63.图1为由或非门构成的基本SR锁存器，输入S、R的约束条件是。

A．SR=0B．SR=1C．S+R=0D．S+R=1

图.1图.2

64.图2所示为由与非门组成的基本SR锁存器，为使锁存器处于“置1”状态，其

应为。

=00B．

=01C．

=10D．

=11

65.电路如图所示。

实现

的电路是。

A．B．C．D

66.电路如图所示。

A．B．C．D．

67.电路如图所示。

输出端Q所得波形的频率为CP信号二分频的电路为。

A．B．C．D．

68.将D触发器改造成T触发器，如图所示电路中的虚线框内应是。

A．或非门B．与非门C．异或门D．同或门

69.米利型时序逻辑电路的输出是。

A．只与输入有关

B．只与电路当前状态有关

C．与输入和电路当前状态均有关

D．与输入和电路当前状态均无关

70.摩尔型时序逻辑电路的输出是。

二、填空题

1.模拟信号的特点