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组成原理
1．冯·诺依曼机工作的基本方式的特点是___B___。
A多指令流单数据流
B按地址访问并顺序执行指令
C堆栈操作
D存贮器按内容选择地址
2．完整的计算机应包括__D____。
A运算器、存储器、控制器；
B外部设备和主机；
C主机和实用程序；
D配套的硬件设备和软件系统；
3.计算机硬件能直接执行的只有____B__。
A.符号语言B机器语言C汇编语言D机器语言和汇编语言
1．系统总线中控制线的功能是____A__。
A提供主存、I/O接口设备的控制信号和响应信号B提供数据信息
C提供时序信号D提供主存、I/O接口设备的响应信号
2.系统总线地址的功能是__A____。
A选择主存单元地址；
B选择进行信息传输的设备；
C选择外存地址；D指定主存和I/O设备接口电路的地址；
3.同步传输之所以比异步传输具有较高的传输频率是因为同步传输_C_____。
A不需要应答信号；
B总线长度较短；
C用一个公共时钟信号进行同步；
D各部件存取时间较为接近；
4.采用串行接口进行七位ASCⅡ码传送，带有一位奇偶校验位为1位起始位和1位停止位，当波特率为9600波特时，字符传送速率为____A__。
A.960B.873C.1371D.480
5.在32位总线系统中，若时钟频率为500MHZ，传送一个32位字需要5个时钟周期，则该总线系统的数据传输速率为____B__MB/S。
A200B400C600D800
1.在计算机系统中，多个系统部件之间信息传送的公共通路称为总线。
就其所传送信息的性质而言，在公共通路上传送的信息包括数据、地址、控制信息。
2．总线控制主要包括判优控制和通信控制。
1.计算机系统中的存贮器系统是指__D____。
ARAM存贮器BROM存贮器
C主存贮器
Dcache、主存贮器和外存贮器
2.存储单元是指___C___。
A存放一个二进制信息位的存贮元B存放一个机器字的所有存贮元集合
C存放一个字节的所有存贮元集合D存放两个字节的所有存贮元集合；
3.某一RAM芯片，其容量为512×8位，包括电源和接地端，该芯片引出线的最小数目应是___B___。
A23B25C50D19
4.某SRAM芯片，存储容量为64K×16位，该芯片的地址线和数据线数目为____D__。
A64，16B16，64C64，8D16，16。
5.某计算机字长32位，其存储容量为4MB，若按半字编址，它的寻址范围是____C__。
A4MBB2MBC2MD1M
6.某计算机字长32位，其存储容量为4MB，若按字编址，它的寻址范围是__A____。
A.1MB.4MBC.4MD.1MB
7.某计算机字长16位，它的存贮容量是64KB，若按字编址，那么它的寻址范围是____B__
A.64KB.32KC.64KBD.32KB
8.主存储器是计算机系统的记忆设备，它主要用来____C__。
A存放数据B存放程序C存放数据和程序D存放微程序
9.微型计算机系统中，操作系统保存在硬盘上，其主存储器应该采用___C___。
ARAMBROMCRAM和ROMDCCP
10．某SRAM芯片，其容量为512×8位，包括电源端和接地端，该芯片引出线的最小数目应为___D___。
A23B25C50D19
11.EPROM是指___D___。
A.读写存储器B.只读存储器
C.闪速存储器D.光擦除可编程只读存储器
12.以下四种类型的半导体存储器中，以传输同样多的字为比较条件，则读出数据传输率最高的是___C___。
ADRAMBSRAMC闪速存储器DEPROM
13.下面常见的只读存储器中，____A__只能有生产厂家在生产芯片的过程中写入，用户无法修改。
A.只读ROMB.PROMC.EPROMDEEPROM
14.动态RAM是指.__C__。
A工作时存储内容变化B工作中需动态地改变访问地址
C每隔一定时间要对存储内容进行刷新D每次读出后都需要根据原内容重写一遍
14.交叉存贮器实质上是一种____A__存贮器，它能_____执行______独立的读写操作。
A模块式，并行，多个B模块式串行，多个C整体式，并行，一个D整体式，串行，多个
15.主存贮器和CPU之间增加cache的目的是__A____。
A解决CPU和主存之间的速度匹配问题B扩大主存贮器容量
C扩大CPU中通用寄存器的数量
D既扩大主存贮器容量，又扩大CPU中通用寄存器的数量
16.cache用于存放主存数据的部分拷贝，主存单元地址与cache单元地址之间的转换工作由___A__完成
A硬件B软件C用户D程序员
17.相联存贮器是按____C__进行寻址的存贮器。
A地址方式B堆栈方式C内容指定方式D地址方式与堆栈方式
18．多总线结构的计算机系统，采用A方法，对提高系统的吞吐率最有效。
A多端口存贮器B提高主存的速度；C交叉编址多模块存贮器；D高速缓冲存贮器
19.cache存储器的内容应该与主存储器的相应单元内容___A___。
A保持一致B可以不一致C无关D有关
20.cache存储器的速度应该比从主存储器取数的速度__A___。
A快B稍快C相同D慢
21cache存储器的内容是___B__调入的。
A操作系统B执行程序时逐步C指令系统设置的专用指令D软件
22.采用虚拟存贮器的主要目的是__B____。
A提高主存贮器的存取度；
B扩大主存贮器的存贮空间，并能进行自动管理和调度；
C提高外存贮器的存取速度；
D扩大外存贮器的存贮空间；
23.常用的虚拟存储系统由___B___两级存储器组成，其中辅存是大容量的磁表面存储器。
A.cache—主存B.主存—辅存C.cache—辅存D.通用寄存器—主存
24.虚拟存储器的逻辑地址位数比物理地址___A__。
A多B少C相等D不一定
1.微型机系统中，主机和高速硬盘进行数据交换一般采用A方式。
A.程序查询B.程序中断C.DMA
2.主机与设备传送数据时，采用A，主机与设备是串行工作。
A.程序查询方式B.中断方式C.DMA方式
3.主机与I/O设备传送数据时，采用C，CPU的效率最高。
A.程序查询方式B.中断方式C.DMA方式
4.中断发生时，程序计数器内容的保护和更新，是由A完成的。
A.硬件自动B.进栈指令和转移指令C.访存指令
5.中断向量地址是C。
A．子程序入口地址B中断服务程序入口地址C中断服务程序入口地址的地址
6.采用DMA方式传送数据时，每传送一个数据要占用C的时间。
A.一个指令周期B一个机器周期C一个存储周期
7.I/O编址方式通常可分统一编址和不统一编址，B。
A统一编址就是将I/O地址看做是存储器地址的一部分，可用专门的I/O指令对设备进行访问
B不统一编址是指I/O地址和存储器地址是分开的，所有对I/O访问必须有专门的I/O指令
C统一编址是指I/O地址和存储器地址是分开的，所以可用访存指令实现CPU对设备的访问
8.计算机的外部设备是指B。
A磁盘机B输入输出设备C电源及空调设备
9.I/O采用统一编址时，进行输入输出操作的指令是B。
A控制指令B访存指令
C输入输出指令
10.I/O采用不统一编址时，进行输入输出操作的指令是C。
A控制指令B访存指令
C输入输出指令
11.中断服务程序的最后一条指令是C。
A转移指令B出栈指令
C中断返回指令
12DMA方式的接口电路中有程序中断部件，其作用是C。
A实现数据传送B向CPU提出总线使用权C向CPU提出传输结束
13.键盘、鼠标、显示器、打印机属于C设备。
A机一机通信B计算机信息存储C人机交互
1.设存储器位数为8位，机器数采用补码形式（含1位符号位）。
对应于十进制数-27，寄存器内容为C。
A27HB9BHCE5H
2.对真值0表示形式唯一的机器数是B。
A原码B.补码和移码C反码D以上都不对
3.某机字长8位，采用补码形式（其中1位为符号位），则机器数所能表示的范围是C。
A-127~+127B-128~+128
C-128~+127
4.16位长的浮点数，其中阶码7位（含1位阶符），尾数9位（含1位数符），当浮点数采用原码表示时，所能表示的数的范围是D；当采用补码表示时，所能表示的数的范围是B。
A-264~264（1-2-8）B-263~263（1-2-8）C-263~263（1-2-9）D-263（1-2-8）~263（1-2-8）
5.[x]补=1.000…0，它代表的真值是B。
A-0B-1C+1
6.设[x]原=1.x1x2x3x4,当满足下列B时，x>
成立。
Ax1必为0，x2~x4至少有一个为1
Bx1必为0，x2~x4任意
Cx1必为1，x2~x4任意
7.设x为整数，[x]反=1,1111,对应的真值是C。
A-15B-1C-0
8.在整数定点机中，机器数采用补码，双符号位，若它的十六进制表示为C0H，则它对应的真值是C。
A-1B+3C-64
9.若9BH表示移码（含1位符号位），其对应的十进制数是A。
A27B-27C-101D101
10.设寄存器内容为10000000，若它等于0，则为D。
A原码B补码C反码D移码
11.大部分计算机内的减法是用C实现。
A将被减数加到减数中B从被减数中减去减数C补数的相加D从减数中减去被减数
12.在浮点机中，判断原码规格化形式的原则是B。
A尾数的符号位与第一数位不同B尾数的第一数位为1，数符任意
C尾数的符号位与第一数位相同D阶符与数符不同
13.在浮点机中，判断补码规格化形式的原则是C。
A尾数的第一数位为1，数符任意B尾数的符号位与第一数位相同
C尾数的符号位与第一数位不同D阶符与数符不同
14.设机器数字长8位（含1位符号位），若机器数BAH为原码，则算术左移一位得C，算术右移一位得。
AF4H;EDHBB4H;6DHCF4H;9DHDB5H;EDH
15.运算器由许多部件组成，其核心部分是B。
A数据总线B算术逻辑运算单元C累加寄存器D多路开关
16.设机器数字长为16位（含1位符号位），若用补码表示定点小数，则最大正数为B。
A1-215B1-2-15C215-1D215
17.计算机中表示地址时，采用B
A原码B补码C反码D无符号数
18.浮点数的表示范围和精度取决于C。
A阶码的位数和尾数的机器数形式B阶码的机器数形式和尾数的位数
C阶码的位数和尾数的位数D阶码的机器数形式和尾数的机器数形式
19.在运算器中不包含B。
A状态寄存器B数据总线CALUD地址寄存器
20.在定点补码运算器中，若采用双符号位，当B时表示结果溢出。
A双符号位相同B双符号位不同C两个正数相加D两个负数相加
21.在浮点数加减法的对阶过程中，D。
A将被加（减）数的阶码向加（减）数的阶码看齐B将加（减）数的阶码向被加（减）数的阶码看齐
C将较大的阶码向较小的阶码看齐
D将较小的阶码向较大的阶码看齐
22.在浮点数中，当数的绝对值太大，以至于超过所能表示的数据时，称为浮点数的B。
A正上溢B上溢C正溢D正下溢
1.指令系统采用不同寻找方式的目的是B。
A、降低指令译码难度B、缩短指令字长，扩大寻址空间，提高编程灵活性C、实现程序的控制D、提高访存速度
2．零地址运算指令在指令格式中不给出操作数地址，它的操作数来自C。
A、立即数和栈顶B、暂存器
C、栈顶和次栈顶D、内存
3．一地址指令中，为完成两个数的算术运算，除地址译码指明的一个操作数外，另一个数常采用C。
A、堆栈寻址方式B、立即寻址方式
C、隐含寻址方式D、直接寻址方式
4．二地址指令中，操作数的物理位置可安排在C。
A、两个内存单元B、两个寄存器
C、一个主存单元和一个寄存器
D、栈顶和次栈顶
5．操作数在寄存器中的寻址方式中，操作数在B。
A、直接B、寄存器直接
C、寄存器间接D、立即寻址
6．寄存器间接寻址方式中，操作数在C中。
A、通用寄存器B、堆栈
C、主存单元D、指令中
7．变址寻址方式中，操作数的有效地址是C。
A、基址寄存器内容加上形式地址（位移量）B、程序计数器内容加上形式地址C、变址寄存器内容加上形式地址
8.基址寻址方式中，操作数的有效地址是A。
A、基址寄存器内容加上形式地址（位移量）B、程序计数器内容加上形式地址C、变址寄存器内容加上形式地址
9.采用基址寻址可扩大寻址方位，且A。
A．基址寄存器内容由操作系统确定，在程序执行过程不可变
B．基址寄存器内容由操作系统确定，在程序执行过程可变C．基址寄存器内容由用户确定，在程序执行过程不可变D．基址寄存器内容由用户确定，在程序执行过程可变
10.采用变址寻址可扩大寻址范围，且D。
A.变址寄存器内容由操作系统确定，在程序执行过程不可变
B.变址寄存器内容由操作系统确定，在程序执行过程可变
C.变址寄存器内容由用户确定，在程序执行过程不可变
D.变址寄存器内容由用户确定，在程序执行过程可变
11.变址寻址和基址寻址的有效地址形成方式相似，但是C。
A、变址寄存器的内容在程序执行过程中是不可变的B、在程序执行过程中，变址寄存器、基址寄存器和内容都是可变的C、在程序执行过程中，基址寄存器的内容不可变，变址寄存器中的内容可变
12．堆栈寻址方式中，设A为累加器，SP为堆栈指示器，M（SP）为SP指示的栈顶单元，如果进栈操作的动作顺序为（A）→M（SP）,（SP）-1→SP，那么出栈操作的动作顺序应为B
A、M（SP）→A，（SP）+1→SPB、（SP）+1→SP，M（SP）→A
C、（SP）-1→SP，M（SP）→A
14．程序控制类指令的功能是__D____。
A.进行算术运算和逻辑运算
B.进行主存与CPU之间的数据传送
C.进行CPU和I/O设备之间的数据传送D.改变程序执行的顺序
15.设相对寻址的转移指令占两个字节，第一字节是操作码，第二字节是相对位移量（可正可负），则转移的地址范围是B。
A、255B、256C、254
16、直接、间接、立即三种寻址方式指令的执行速度，由快到慢的顺序是C。
A、直接、立即、间接B、直接、间接、立即C、立即、直接、间接
17、设机器字长为16位，存储器按字编址，对于单字长指令而言，读取该指令后，PC值自动加A。
A、1B、2C、4
18、设计器字长为16位，存储器按字节编址，CPU读取一个单字长指令后，PC值自动加B
A、1B、2C、4
19器字长为16位，存储器按字节编址，设PC当前值为1000H，当读取一条双字长指令后，PC值为C。
A、1000HB、1002HC、1004H
20.在一地址指令中,下列B是正确的.
A、仅有一个操作数，其地址由指令地址码提供B、可能有一个操作数，也可能有两个操作数C、一定有两个操作数，另外一个是隐含的
21（多选择）下列寻址方式中，Ｂ、Ｄ、Ｅ、Ｇ能反映RISC的特征。
A、丰富的寻址方式B、指令采用流水方式C、控制器采用微程序设计D、只有LOAD/STORE指令访问存储器E、难以用优化编译生成高效的目标代码
F、配置了多个通用寄存器
22、下列叙述中，ADE能反映CISC的特征（多选）。
A、丰富的寻址方式B、控制器采用组合逻辑C、指令字长固定D、各种指令都可以访存E、大多数指令需要多个时钟周期才能执行完成F、只有LOAD/STORE指令可以访存
G、采用优化编译技术
1.在CPU中跟踪指令后继地址的寄存器是__B____。
A主存地址寄存器B程序计数器C指令寄存器D状态条件寄存器
2.以下关于CPU的叙述，错误的是___B___。
ACPU产生每条指令的操作信号并将操作信号送往相应的部件进行控制
BPC除了存放指令地址，也可以临时存储算术/逻辑运算结果
CCPU中的控制器决定计算机运行过程的自动化
D指令译码器是CPU控制器中的部件
3.在取指令操作完成之后，PC中存放的是___C___。
A下一条实际执行的指令地址
B当前指令地址
C下一条顺序执行的指令地址
D对于微程序控制的计算机，存放的是该条指令的微程序入口地址
4．指令周期是指____B__。
ACPU从主存取出一条指令的时间BCPU执行一条指令的时间C．CPU从主存取出一条指令加上CPU执行这条指令的时间D时钟周期时间
5.下列说法正确的是____D__。
A指令周期等于机器周期B指令周期小于机器周期
C指令周期大于等于机器周期
D指令周期是机器周期的两倍
6.操作控制器的功能是____D__。
A.产生时序信号B.从主存取出一条指令C.完成指令操作的译码D.从主存取出指令，完成指令操作码译码，并产生有关的操作控制信号，以解释执行该指令
7.以下叙述中正确描述的句子是：
___A、D___。
A同一个CPU周期中，可以并行执行的微操作叫相容性微操作
B同一个CPU周期中，不可以并行执行的微操作叫相容性微操作
C同一个CPU周期中，可以并行执行的微操作叫相斥性微操作
D同一个CPU周期中，不可以并行执行的微操作叫相斥性微操作
8.微程序控制器中，机器指令与微指令的关系是___B___。
A.每一条机器指令由一条微指令来执行B.每一条机器指令由一段微指令编写的微程序来解释执行
C.每一条机器指令组成的程序可由一条微指令来执行D.一条微指令由若干条机器指令组成
9.微程序控制器速度比硬布线控制器速度慢，主要是因为__D____。
A.增加了从磁盘存储器读取微指令的时间B.增加了从主存储器读取微指令的时间C.增加了从指令寄存器读取微指令的时间D.增加了从控制存储器读取微指令的时间
10.存放微指令的控制存储器隶属_____D_。
A辅助存储器B高速缓存C主存储器DCPU
11.流水CPU是由一系列叫做“段”的处理线路所组成，和具有m个并行部件的CPU相比，一个m段流水CPU____A__。
A具备同等水平的吞吐能力
B不具备同等水平的吞吐能力
C吞吐能力大于前者的吞吐能力
D吞吐能力小于前者的吞吐能力
12、同步控制是___C___。
A只适用于CPU控制的方式B只适用于外围设备控制的方式
C由统一时序信号控制的方式D所有指令执行时间都相同的方式
13.为了便于实现多级中断，保存现场信息最有效的办法是采用____B__。
A通用寄存器B堆栈
C存储器D外存
14.发生中断请求的条件之一是__C____。
A.一条指令执行结束B.一次I/O操作结束C.机器内部发生故障D.一次DMA操作结束
15.中断标志触发器用于___B___。
A、向CPU发出中断请求
B、指示CPU是否进入中断周期
C、开放和关闭中断系统
16、中断允许触发器用于___C___。
A、向CPU发出中断请求
B、指示正有中断在进行
C、开发和关闭中断系统
17.程序计数器的位数决定___A___。
A、存储器的寻址空间B、机器字长C、指令字长
18.CPU的通用寄存器____B__。
A、只能存放数据，不能存地址
B、可以存放数据和地址
C、可以存放数据和地址，还可以代替指令寄存器
20、一个节拍信号的宽度为__D____。
A、指令周期B、存取周期C、机器周期D、时钟周期
21、取指令操作__C____。
A、受上一条指令的操作码控制B、受当前指令的操作码控制
C、是控制器固有的功能，无需在操作码控制下完成
22、在微程序控制器中，控制部件向执行部件发出的某个控制信号为___A___。
A、微命令B、微操作C、微指令
23、下列叙述中，正确的是____B__。
A、控制器产生的所有控制信号称为微命令B、微程序控制器比硬布线控制器更加灵活C、微处理器的程序为微程序
24.水平型微指令的特点是_A_____。
A、一次可以完成多个操作B、微指令的操作控制字段不进行编码
C、微指令的格式简短
25、垂直型微指令的特点是____C__。
A、微指令格式垂直表示B、控制信号经过编码产生C、采用微操作码
填空题
1.在计算机系统中，多个系统部件之间信息传送的公共通路称为总线。
就其所传送信息的性质而言，在公共通路上传送的信息包括数据、地址、控制信息。
2．总线控制主要包括判优控制和通信控制。
1.对存储器的要求是容量大，速度快，成本低。
为了解决这三方面的矛盾计算机采用多级存储体系结构。
2.主存储器是计算机系统中的记忆设备，它主要用来存放程序和数据。
3.相联存储器不按地址而是按内容访问的存储器，在cache中用来存放行地址表，在虚拟存储器中用来存放页表快表。
4.Cache是一种高速存储器，是为了解决CPU和主存之间速度上不匹配而采用的一项重要硬件技术。
1.I/O接口电路通常具有选址功能、传送命令、传送数据和反映I/O设置工作状态功能。
2.I/O的编址方式可分为不统一编址和统一编址两大类，前者需有独立的I/O指令，后者可通过访存指令和设备交换信息。
3.I/O和CPU之间不论是采用串行传送还是并行传送，它们之间的联络方式（定时方式）可分为立即响应、异步定时、同步定时三种。
4.一次中断处理过程大致可分为中断请求、中断判优、中断响应、中断服务和中断返回等五个阶段。
5.在DMA方式中，CPU和DMA控制器通常采用三种方法来分时使用主存，它们是停止CPU访问主存、周期挪用和DMA和CPU交替访问主存。
6.单重中断的中断服务程序的执行顺序为中断请求信号产生与传送、屏蔽与判优、CUP响应、中断处理和中断返回。
7.多重中断的中断服务程序的执行顺序为」：
①关中断；②保存现场信息；③判别中断条件；④开中断；⑤执行中断服务程序；⑥关中断；⑦恢复现场信息；⑧
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