计算机组成课后答案doc.docx

计算机组成课后答案doc.docx

《计算机组成课后答案doc.docx》由会员分享，可在线阅读，更多相关《计算机组成课后答案doc.docx（39页珍藏版）》请在冰豆网上搜索。

计算机组成课后答案doc

第一章计算机系统概论

1.什么是计算机系统、计算机硬件和计算机软件？

硬件和软件哪个更重要？

解：

P3

计算机系统：

由计算机硬件系统和软件系统组成的综合体。

计算机硬件：

指计算机中的电子线路和物理装置。

计算机软件：

计算机运行所需的程序及相关资料。

硬件和软件在计算机系统中相互依存，缺一不可，因此同样重要。

5.冯•诺依曼计算机的特点是什么？

解：

冯•诺依曼计算机的特点是：

P8

计算机由运算器、控制器、存储器、输入设备、输出设备五大部件组成；指令和数据以同同等地位存放于存储器内，并可以按地址访问；指令和数据均用二进制表示；指令由操作码、地址码两大部分组成，操作码用来表示操作的性质，地址码用来表示操作数在存储器中的位置；指令在存储器中顺序存放，通常自动顺序取出执行；机器以运算器为中心（原始冯•诺依曼机）。

7.解释下列概念：

主机、CPU、主存、存储单元、存储元件、存储基元、存储元、存储字、存储字长、存储容量、机器字长、指令字长。

解：

P9-10主机：

是计算机硬件的主体部分，由CPU和主存储器MM合成为主机。

CPU：

中央处理器，是计算机硬件的核心部件，由运算器和控制器组成；（早期的运算器和控制器不在同一芯片上，现在的CPU内除含有运算器和控制器外还集成了CACHE）。

主存：

计算机中存放正在运行的程序和数据的存储器，为计算机的主要工作存储器，可随机存取；由存储体、各种逻辑部件及控制电路组成。

存储单元：

可存放一个机器字并具有特定存储地址的存储单位。

存储元件：

存储一位二进制信息的物理元件，是存储器中最小的存储单位，又叫存储基元或存储元，不能单独存取。

存储字：

一个存储单元所存二进制代码的逻辑单位。

存储字长：

一个存储单元所存二进制代码的位数。

存储容量：

存储器中可存二进制代码的总量；（通常主、辅存容量分开描述）。

机器字长：

指CPU一次能处理的二进制数据的位数，通常与CPU的寄存器位数有关。

指令字长：

一条指令的二进制代码位数。

8.解释下列英文缩写的中文含义：

CPU、PC、IR、CU、ALU、ACC、MQ、X、MAR、MDR、I/O、MIPS、CPI、FLOPS

解：

全面的回答应分英文全称、中文名、功能三部分。

CPU：

CentralProcessingUnit，中央处理机（器），是计算机硬件的核心部件，主要由运算器和控制器组成。

PC：

ProgramCounter，程序计数器，其功能是存放当前欲执行指令的地址，并可自动计数形成下一条指令地址。

IR：

InstructionRegister，指令寄存器，其功能是存放当前正在执行的指令。

CU：

ControlUnit，控制单元（部件），为控制器的核心部件，其功能是产生微操作命令序列。

ALU：

ArithmeticLogicUnit，算术逻辑运算单元，为运算器的核心部件，其功能是进行算术、逻辑运算。

ACC：

Accumulator，累加器，是运算器中既能存放运算前的操作数，又能存放运算结果的寄存器。

MQ：

Multiplier-QuotientRegister，乘商寄存器，乘法运算时存放乘数、除法时存放商的寄存器。

X：

此字母没有专指的缩写含义，可以用作任一部件名，在此表示操作数寄存器，即运算器中工作寄存器之一，用来存放操作数；

MAR：

MemoryAddressRegister，存储器地址寄存器，在主存中用来存放欲访问的存储单元的地址。

MDR：

MemoryDataRegister，存储器数据缓冲寄存器，在主存中用来存放从某单元读出、或要写入某存储单元的数据。

I/O：

Input/Outputequipment，输入/输出设备，为输入设备和输出设备的总称，用于计算机内部和外界信息的转换与传送。

MIPS：

MillionInstructionPerSecond，每秒执行百万条指令数，为计算机运算速度指标的一种计量单位。

9.画出主机框图，分别以存数指令“STAM”和加法指令“ADDM”（M均为主存地址）为例，在图中按序标出完成该指令（包括取指令阶段）的信息流程（如→①）。

假设主存容量为256M*32位，在指令字长、存储字长、机器字长相等的条件下，指出图中各寄存器的位数。

解：

主机框图如P13图1.11所示。

（1）STAM指令：

PC→MAR，MAR→MM，MM→MDR，MDR→IR，

OP（IR）→CU，Ad（IR）→MAR，ACC→MDR，MAR→MM，WR

（2）ADDM指令：

PC→MAR，MAR→MM，MM→MDR，MDR→IR，

OP（IR）→CU，Ad（IR）→MAR，RD，MM→MDR，MDR→X，ADD，ALU→ACC，ACC→MDR，WR

假设主存容量256M*32位，在指令字长、存储字长、机器字长相等的条件下，ACC、X、IR、MDR寄存器均为32位，PC和MAR寄存器均为28位。

10.指令和数据都存于存储器中，计算机如何区分它们？

解：

计算机区分指令和数据有以下2种方法：

通过不同的时间段来区分指令和数据，即在取指令阶段（或取指微程序）取出的为指令，在执行指令阶段（或相应微程序）取出的即为数据。

通过地址来源区分，由PC提供存储单元地址的取出的是指令，由指令地址码部分提供存储单元地址的取出的是操作数。

第3章系统总线

1.什么是总线？

总线传输有何特点？

为了减轻总线负载，总线上的部件应具备什么特点？

答：

P41.总线是多个部件共享的传输部件。

总线传输的特点是：

某一时刻只能有一路信息在总线上传输，即分时使用。

为了减轻总线负载，总线上的部件应通过三态驱动缓冲电路与总线连通。

4.为什么要设置总线判优控制？

常见的集中式总线控制有几种？

各有何特点？

哪种方式响应时间最快？

哪种方式对电路故障最敏感？

答：

总线判优控制解决多个部件同时申请总线时的使用权分配问题；

常见的集中式总线控制有三种：

链式查询、计数器定时查询、独立请求；

特点：

链式查询方式连线简单，易于扩充，对电路故障最敏感；计数器定时查询方式优先级设置较灵活，对故障不敏感，连线及控制过程较复杂；独立请求方式速度最快，但硬件器件用量大，连线多，成本较高。

5.解释下列概念：

总线宽度、总线带宽、总线复用、总线的主设备（或主模块）、总线的从设备（或从模块）、总线的传输周期和总线的通信控制。

答：

P46。

总线宽度：

通常指数据总线的根数；

总线带宽：

总线的数据传输率，指单位时间内总线上传输数据的位数；

总线复用：

指同一条信号线可以分时传输不同的信号。

总线的主设备（主模块）：

指一次总线传输期间，拥有总线控制权的设备（模块）；

总线的从设备（从模块）：

指一次总线传输期间，配合主设备完成数据传输的设备（模块），它只能被动接受主设备发来的命令；

总线的传输周期：

指总线完成一次完整而可靠的传输所需时间；

总线的通信控制：

指总线传送过程中双方的时间配合方式。

6.试比较同步通信和异步通信。

答：

同步通信：

指由统一时钟控制的通信，控制方式简单，灵活性差，当系统中各部件工作速度差异较大时，总线工作效率明显下降。

适合于速度差别不大的场合。

异步通信：

指没有统一时钟控制的通信，部件间采用应答方式进行联系，控制方式较同步复杂，灵活性高，当系统中各部件工作速度差异较大时，有利于提高总线工作效率。

8.为什么说半同步通信同时保留了同步通信和异步通信的特点？

答：

半同步通信既能像同步通信那样由统一时钟控制，又能像异步通信那样允许传输时间不一致，因此工作效率介于两者之间。

10.为什么要设置总线标准？

你知道目前流行的总线标准有哪些？

什么叫plugandplay？

哪些总线有这一特点？

答：

总线标准的设置主要解决不同厂家各类模块化产品的兼容问题；

目前流行的总线标准有：

ISA、EISA、PCI等；

plugandplay：

即插即用，EISA、PCI等具有此功能。

11.画一个具有双向传输功能的总线逻辑图。

答：

在总线的两端分别配置三态门，就可以使总线具有双向传输功能。

a0

a1

an01n

12.设数据总线上接有A、B、C、D四个寄存器，要求选用合适的74系列芯片，完成下列逻辑设计：

（1）设计一个电路，在同一时间实现D→A、D→B和D→C寄存器间的传送；

（2）设计一个电路，实现下列操作：

T0时刻完成D→总线；

T1时刻完成总线→A；

T2时刻完成A→总线；

T3时刻完成总线→B。

解：

（1）由T打开三态门将D寄存器中的内容送至总线bus，由cp脉冲同时将总线上的数据打入到A、B、C寄存器中。

T和cp的时间关系如图

（1）所示。

cp总线

图

（1）

（2）三态门1受T0＋T1控制，以确保T0时刻D→总线，以及T1时刻总线→接收门1→A。

三态门2受T2＋T3控制，以确保T2时刻A→总线，以及T3时刻总线→接收门2→B。

T0、T1、T2、T3波形图如图

（2）所示。

第四章

3.存储器的层次结构主要体现在什么地方？

为什么要分这些层次？

计算机如何管理这些层次？

答：

存储器的层次结构主要体现在Cache-主存和主存-辅存这两个存储层次上。

Cache-主存层次在存储系统中主要对CPU访存起加速作用，即从整体运行的效果分析，CPU访存速度加快，接近于Cache的速度，而寻址空间和位价却接近于主存。

主存-辅存层次在存储系统中主要起扩容作用，即从程序员的角度看，他所使用的存储器其容量和位价接近于辅存，而速度接近于主存。

综合上述两个存储层次的作用，从整个存储系统来看，就达到了速度快、容量大、位价低的优化效果。

主存与CACHE之间的信息调度功能全部由硬件自动完成。

而主存与辅存层次的调度目前广泛采用虚拟存储技术实现，即将主存与辅存的一部分通过软硬结合的技术组成虚拟存储器，程序员可使用这个比主存实际空间（物理地址空间）大得多的虚拟地址空间（逻辑地址空间）编程，当程序运行时，再由软、硬件自动配合完成虚拟地址空间与主存实际物理空间的转换。

因此，这两个层次上的调度或转换操作对于程序员来说都是透明的。

4.说明存取周期和存取时间的区别。

解：

存取周期和存取时间的主要区别是：

存取时间仅为完成一次操作的时间，而存取周期不仅包含操作时间，还包含操作后线路的恢复时间。

即：

存取周期=存取时间+恢复时间

5.什么是存储器的带宽？

若存储器的数据总线宽度为32位，存取周期为200ns，则存储器的带宽是多少？

解：

存储器的带宽指单位时间内从存储器进出信息的最大数量。

存储器带宽=1/200ns×32位=160M位/秒=20MB/秒=5M字/秒

注意：

字长32位，不是16位。

（注：

1ns=10s）

6.某机字长为32位，其存储容量是64KB，按字编址它的寻址范围是多少？

若主存以字节编址，试画出主存字地址和字节地址的分配情况。

解：

存储容量是64KB时，按字节编址的寻址范围就是64K，如按字编址，其寻址范围为：

64K/（32/8）=16K

主存字地址和字节地址的分配情况：

（略）。

7.一个容量为16K×32位的存储器，其地址线和数据线的总和是多少？

当选用下列不同规格的存储芯片时，各需要多少片？

1K×4位，2K×8位，4K×4位，16K×1位，4K×8位，8K×8位

解：

地址线和数据线的总和=14+32=46根；

选择不同的芯片时，各需要的片数为：

1K×4：

（16K×32）/（1K×4）=16×8=128片

2K×8：

（16K×32）/（2K×8）=8×4=32片

4K×4：

（16K×32）/（4K×4）=4×8=32片

16K×1：

（16K×32）/（16K×1）=1×32=32片

4K×8：