数字电路复习题答案.docx
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数字电路复习题答案
数字电路复习题答案
数字电路复习题
（注意:
以下题目是作为练习和考试题型而设，不是考题，大家必须融会贯通，举一反三。
）1、逻辑电路可以分为组合逻辑电路电路和时序逻辑电路电路。
2、数字电路的基本单元电路是门电路和触发器。
3、数字电路的分析工具是逻辑代数（布尔代数）。
4、（50.375）10=（110010.011）2=（32.6）16
5、3F4H=（0001000000010010）8421BCD
6、数字电路中的最基本的逻辑运算有与、或、非。
7、逻辑真值表是表示数字电路输入和输出之间逻辑关系的表格。
8、正逻辑的与门等效于负逻辑的或门。
9、表示逻辑函数的4种方法是真值表、表达式、卡诺图、逻辑电路图。
其中形式惟一的是真值表。
10、对于变量的一组取值，全体最小项之和为1。
11、对于任意一个最小项，只有一组变量的取值使其值为1，而在变量取其他各组值时
这个最小项的取值都是0。
12、对于变量的任一组取值，任意两个最小项之积为0。
13、与最小项ABC相邻的最小项有ABC、ABC、ABC。
14、组合逻辑电路的特点是输出端的状态只由同一时刻输入端的状态所决定，而与先前的状态没有关系（或输出与输入之间没有反馈延迟通路;电路中不含记忆元件）。
15、按电路的功能分，触发器可以分为RS、JK、D、T、T’。
16、时序电路可分为同步时序逻辑电路和异步时序逻辑电路两种工作方式。
17、描述时序电路逻辑功能的方法有逻辑方程组（含驱动方程、输出方程、
状态方程）、状态图、状态表、时序图。
18、（251）=（11111011）=（FB）10216
19、全体最小项之和为1。
20、按照使用功能来分，半导体存储器可分为RAM和ROM。
21、RAM可分为动态RAM和静态RAM。
22、存储器以字为单位组织内部结构，1个字含有若干个存储单元。
1个字中所含的位数（即存储单元的个数）称为字长。
字数与字长的乘积表示存储器的容量。
字数决定存储器的地址线的颗数，字长决定存储器的数据线的颗数。
1、用公式化简下列逻辑函数
（1）、=A+BY,AB，B，AB
（2）、=1Y,ABC，A，B，C
（3）、=BCY,A，B，C，ABC
（4）、=ADY,ABCD，ABD，ACD
（5）、=A+CDY,AC，ABC，ACD，CD
（6）、=1Y,ABC，A，B，C
（7）、*=A+B+CY,AD，AD，AB，AC，BFE，CEFG
（8）、=1Y（A,B,C）,,m（0,1,2,3,4,5,6,7）
（9）、*=B，AC，ACY（A,B,C）,,m（0,1,2,3,4,6,7）
，，C，AB,A,AC（10）、=Y（A,B,C）,,64,3,m2,0,（）,,m（4,5,6,7）
，，，，，，，，A，C，DA，C，DA，C，DA，B（11）、=A，BCD
（12）、ABC，ABC，ABC，ABC=A
，，A，BC，AC，AB，ABC，BC（13）、=C+AB
CD，A，A，AB，CD（14）、=A+CD
BC，AC，AB，BCDAC（15）、=BC+
2、用卡诺图化简（略）:
（1）、Y（A，B，C）=Σm（0,2,4,7）
（2）、Y（A,B,C）=Σm（1,3,4,5,7）
（3）、Y（A,B,C,D）=Σm（2,6,7,8,9,10,11,13,14,15）
（4）、Y（A,B,C,D）=Σm（1,5,6,7,11,12,13,15）（5）、Y,ABC，ABC，AC
Y,ABC，ABC，ABC（6）、
（7）、Y（A,B,C）=Σm（0,1,2,3,4）+Σd（5,7）（8）、Y（A,B,C,D）=Σm（2,3,5,7,8,9）+Σd（10,11,12,13,14,15）
（9）、F,BD，BC，ABCD,d,ABD，ABCD（10）、，，F,0,2,3,6,7,8,14,15,
（11）、，，F,2,3,10,11,14,15,
3、设:
Y,AB，Y,A，B，。
Y,A,B111
、B的波形如图题1-5所示。
试画出Y、Y、Y对应A、B的波形。
已知A123
图题1-5
解:
4、已知真值表如表题1-6（a）、（b），试写出对应的逻辑表达式。
表题1-6（a）表题1-6（b）
ABCYABCDY
00000
000000010
00100
001100110
01000
010101010
01100
011001111
10000
100110010
10101
101010111
11000
110011011
11101
111111111解:
1-6（a）Y,ABC，ABC，ABC，ABC
1-6（b）
Y,ABCD，ABCD，ABCD，ABCD，ABCD，ABCD
ABCD，ABCD，ABCD，ABCD，ABC
BCAD，A，ACBD，B，ACBD，B，ABCD，C，，，，，，，，
AC，BCD
5、试用74LS151实现逻辑函数:
Y,A，BC
解:
Y,A，BC,AB，AB，BC
…………………………
（1）,ABC，ABC，ABC，ABC，ABC
而74151的输出表达式为:
7
Y,mD………………
（2）,iii0,
比较
（1）和
（2）知:
D,1,D,1,D,1,D,1,D,1只要令，其余的为0，则74151的输出端的表76543达式就是要求的逻辑函数:
Y=A+BC
、用74138实现逻辑函数:
6
Y=A+BC
解:
Y,A，BC,AB，AB，BC
ABC，ABC，ABC，ABC，ABC
ABC，ABC，ABC，ABC，ABC
Y,Y,Y,Y,Y76543
所以，电路如下图所示:
7、写出如图所示电路对应的真值表
解:
Y,AC,BC
Z,AC,BC
ABCYZ
00000
00100
010100110110001101001101111111
8、设某车间有4台电动机ABCD，要求:
（1）A必须开机。
（2）其他三台中至少有两台开机
如果不满足上述条件，则指示灯熄灭。
试写出指示灯亮的逻辑表达式，并用与非门实现。
设指示灯亮为1，电动机开为1。
解:
根据题意可得到如下的真值表
ABCDL
10000
10010
10100
10111
11000
11011
11101
11111由真值表可得到如下的卡诺图:
由卡诺图可得:
L,BD，CD，BC
由真值表可知，A=1。
所以最终的表达式为:
L=A（BD+CD+BC）=ABD+ACD+ABC经过恒等变形得:
L,ABD，ACD，ABC
ABD,ACD,ABC
由表达式可得到如图所示的电路图
A&000B0
C
&&00LD000000
&0000
9、举重比赛有3个裁判员A、B、C，另外有一个主裁判D。
A、B、C裁判认为合格时为一票，D裁判认为合格时为2票。
多数通过时输出F=1，试用与非门设计多数通过的表决电路。
解:
根据题意可得到如下的真值表:
由真值表可得如下卡诺图:
ABCDF
00000
00010
00100
00111
01000所以，表达式如下:
01011
01100F,CD，ABD，ABC，ABD
01111将表达式进行恒等变换得:
10000F,CD，ABD，ABC，ABD
10011,CD,ABD,ABC,ABD
10100逻辑电路图如下:
10111
&0A0&0110000000
11010&0B00&000111010&00F01111100&0C00
D
&0000
10、已知下降沿有效的JK触发器CP、J、K及异步置1端、异步置0端的波形如图题SSdd
4-4所示，试画出Q的波形（设Q的初态为0）。
图题4-4
解:
11、设图题4-11中的触发器的初态均为0，试画出对应A、B的X、Y的波形。
解
图题4-11
12、触发器电路如图所示，试画出Q的波形
Q
解:
由图可知，J=A+B，K=A。
先画出A+B的波形，再画Q的波形。
波形如下:
13、试画出用1024×4位的RAM扩展成4096×4位的RAM接线示意图。
解:
需要4片1024×4的RAM，因为是字数的扩展，所以，需要增加2颗地址线，经过译码后分别选中4片中的一片，具体电路如下:
A0-A9
A10
译码器
A11A0-A9A0-A9A0-A9A0-A9CSCSCSCS1024×41024×41024×41024×4D0-D3D0-D3D0-D3D0-D3D0-D3
14、试分析如图所示时序电路，要求列出状态表，画出状态图，并说出它的逻辑功能。
解:
（1）写方程
由图可知:
CP=CP=CP01
nJQ,01
K,10
1n，nnQQQ,,010
nJQ,10
K,11
1n，nnQQQ,,110
（2）由状态方程可得如下的状态表和状态图
nn，1nn，1QQQQ0011
00010110
1000
1100
（3）由状态图可知，该逻辑电路是一个具有自启动功能的同步三进制加法计数器。
15、请用负跳沿JK触发器设计一个同步五进制减法计数器。
解:
原始状态图如下:
编码后的状态图如下:
由状态图可得到如下的状态表:
由状态表可得到驱动方程和输出方程:
输出方程:
nnnF,QQ,Q210
驱动方程:
1nnnn，Q,（Q，Q）Q，n1nnnn0210Q,QQ，QQ12101nn？
J,Q，Qn021？
J,Q12K,10nK,Q10
1nnnn，QQQQ,，，，，2210
J？
12
nnKQQ,，210
所以，可得到如下电路图:
>=1000
1SETSETSETQQQJJJ&000F0
CLRCLRCLRQQQKKK1&000
CP
验证能否自启动（略）
16、用74161设计一个五进制计数器
解:
可利用异步清零方式或置数方式来实现，下面用置数方式来实现。
由74161的功能表可知，它是同步置数。
要构成5进制计数器，应该保留0000-0100五个状态，舍掉0101-1111十一个状态，利用与非门对第五个状态0100译码，产生置数信号0并送至LD端，置数的数据为0000。
这样在下一个时钟脉冲正跳沿到达时，计数器置入0000状态，使计数器按五进制计数。
具体电路如下:
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