计算机原理期中测试题.docx

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计算机原理期中测试题

计算机原理期中测试题

五邑大学期中试卷

学期：

2013至2014学年度　　　第1学期

课程：

　计算机组成原理　　　　课程代号：

使用班级：

　姓名：

　　学号：

题号

一

二

三

四

五

六

七

八

总分

得分

一、单项选择题（10小题，每小题2分，共20分）

1.计算机各组成部件的相互连接方式，从早期以运算器为中心，发展到现在的以_________为中心。

A．控制器B．运算器C．存储器D．CPU

2.下列不同进位计数制的数中，最大的数是_________。

A．（0.100）2B．（0.55）8C．（0.61）10D．（0.75）16

3.电子计算机技术在半个世纪中虽有很大的进步，但至今其运行仍遵循着一位科学家提出的基本

原理。

他就是_________。

A．牛顿B．爱因斯坦C．爱迪生D．冯·诺依曼

4.一个含符号16位的补码机器数的表示范围是（）。

A．-215-1~+215-1B．-215~+215-1

C．-216-1~+216-1D．-216~+216-1

5.采用单符号法判定补码加减运算溢出的法则是

A．进位是1溢出B．进位是0无溢出

C．符号位与次高位进位状态相同无溢出D．符号位与次高位进位状态相异无溢出

6.设在数据传送中采用偶校验，若接收到的代码为10111011，则表明传送中_________。

A．未出现错误B．最低位出错

C．出现奇数位错D．未出现错误或出现偶数位错

7.寻址512K×8存储器所需最少的地址线（）根。

A．9B．11

C．19D．21

8.静态RAM的特点是_________。

A．工作时存储内容不变B．断电后存储内容不变

C．不需刷新D．不需电源提供电流

9.主存到cache的映射不需要替换策略的是（）。

A．直接映射方式B．全相联映射方式

C．组相联映射方式D．以上三种映射方式

10.用8K×8存储芯片组成一个64K×32的存储系统，需要芯片（）片。

A．8B．16

C．32D．64

二、判断题（10小题，每小题1分，共10分）

1．_______运算器由许多部件组成，其核心部分是算术逻辑运算单元（ALU）。

2、_______有符号阵列乘法可用无符号阵列乘法和三个求补器实现。

3、_______在机器运算中减法通常采用减法器来实现。

4、_______采用先行进位的加法器比采用行波进位的加法器结构简单。

5、_______当输入任务数为n时，一个m级流水线的加速比是（m×n）/（m+n-1）。

6．_______主存的存取时间与Cache的命中率无关。

7．_______双端口存储器在左端口与右端口的地址码相同情况下会发生读写冲突

8．_______相联存储器与传统存储器的主要区别是前者又叫按内容寻址的存储器。

9．_______在程序的执行过程中，Cache与主存的地址映射是由硬件自动完成的。

。

10．______采用交叉存储数据是连续地放在一个存储模块中。

三、填空题（10个空，每空2分，共20分）

1．CPU执行一段程序时，Cache完成存取的次数为1800次，主存完成存取的次数为200次，

Cache的命中率h=（）%。

2．一个五级的流水处理器，当任务饱满时，它处理10条指令的加速比是（）。

3．8位二进制补码表示整数的最大值为（）10，最小值为（）10。

4．在一个有四个过程段的浮点加法器流水线中，假设四个过程段的时间分别是T1=60ns、

T2=50ns、T3=90ns、T4=80ns。

则加法器流水线的时钟周期至少为（）ns。

5．某数在计算机中用BCD码表示为100110000111，其真值为（）10。

6．一个16K×32位的存储器，其地址线和数据线的总和是（）根。

7．一个四路组相联的Cache共有64块，主存共有8192块，每块32个字。

则主存地址中的主存

字块标记为（）位，组地址为（）位，字块内地址为（）位。

四、机器码填表（20分）

已知一个数的真值，原码，反码或补码，写出其余的值及补码的奇校验位。

真值（二进制）

原码

反码

补码

补码的奇校验位（1位）

57/64

1.100101

1.0000110

1.1010011

-0.0100011

五、机器定点运算题（10分）

设x=-97，y=55,均采用8位二进制补码表示（含1位符号位），按机器补码加减法规则计算x+y和x-y,并根据双符号法判断计算结果是正常、上溢出或下溢出，对正常结果还原成十进制数真值。

六、机器浮点运算题（10分）

已知x=（-1001.11）2y=（10111.01）2

求：

（1）化x,y为标准规格化浮点数格式；

（2）按机器浮点数计算步骤计算x+y。

（指数按实际指数计算，不用按754标准+127）

7、（10分）某计算机主存8MB，分成4096块。

Cache64KB，分成和主存同样大小的块，地址映像采用直接映像方式，见下图。

求：

（1）Cache有多少块？

块号为多少位？

（2）Cache的块内地址为多少位？

（3）设Cache中的主存标记如图所示，当CPU送出地址为7F1057H时，能否在Cache命中？

若送出地址为000000H时，能否在Cache中命中？

上述两个地址若不在Cache中，应映射到Cache中的哪一块？

八、存储器设计题（10分）

某机器中，已知配有一个地址空间为0000H~1FFFH的ROM区域（8K×16）。

现在再用RAM芯片（8K×8）形成一个16K×16的RAM区域，起始地址为6000H。

假设RAM芯片有片选CS和读写R/W信号控制端。

CPU地址总线为A15~A0，数据总线为D15~D0，读写控制信号为R/W，要求：

（1）需用几片RAM芯片（8K×8）？

给出ROM和RAM的地址空间分布表。

（2）将ROM和RAM同CPU连接，画出逻辑图。