计算机组成原理题目.docx

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计算机组成原理题目

*本试卷为随机选题

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一、单选题

1．下列关于微指令的叙述中不正确的是（）。

A．微指令中可以不设置下地址字段

B．同一条微指令中的微命令属于相容性微命令

C．微指令中常常包含判别测试位

D．微指令的长度与指令的复杂度有关

2．假定指令地址码给出的是操作数本身，则该操作数采用的是（）寻址方式。

A．立即B．直接C．基址D．相对

3．以下有关总线标准的叙述中，错误的是______。

A．引入总线标准便于设备互换和新设备的添加

B．主板上的处理器总线和存储器总线通常是专用总线

C．I/O总线通常是标准总线，所以PCI总线是标准总线

D．串行总线的数据传输率一定比并行总线的数据传输率低

4．DMA访问主存时，让CPU处于等待状态，等DMA的一批数据访问结束后，CPU再恢复工作，这种情况称作______。

A．停止CPU访问主存B．周期挪用C．DMA与CPU交替访问D．DMA

5．在以下描述PCI总线的基本概念中，正确的表述是______。

A．PCI总线是一个与处理器相关的高速外围总线

B．PCI总线的基本传输机制是猝发式传送

C．PCI设备一定是主设备

D．系统中只允许有一条PCI总线

6．下面关于溢出的叙述中不正确的是（）

A．浮点数溢出的条件是阶码溢出

B．定点运算器产生溢出的原因是运算结果超出了定点数的表示围

C．当定点运算器采用双符号位时，若运算结果的双符号位不同则溢出

D．当定点运算器采用单符号位时，若符号位与最高数值位相异则溢出

7．零地址指令可选的寻址方式是（　　　）

A．立即寻址

B．间接寻址

C．堆栈寻址

D．寄存器寻址

8．设某程序执行前　r0=0x11223344。

依次执行下列指令：

r1=0x100；STRr0,[r1]（将r0中的数据存放到r1的容所指向的主存单元）；LDRBr2,[r1]（从r1容所指主存单元取一个字节的数据送r2中保存）。

若数据在主存中按小端模式存放，则r2中的容为（）

A．0X11

B．0X22

C．0X33

D．0X44

9．采用规格化浮点数的目的是（）

A增加数据的表示围B．保证运算结果正确性

C．防止运算时产生溢出D．增加数据的表示精度

10．某计算机字长8位，采用补码数据表示。

两个有符号整型变量x=63,y=31，在该机中执行算术运算x+y后得到的结果及相应的溢出标志位OF的值分别为（）

A．1FH，0B．20H，0C．1FH，1D．20H，1

11．在CPU中，程序计数器PC用来存放（）

A．现行指令

B．下条指令

C．操作数的地址

D．下条指令的地址

12．以下关于DMA控制器和CPU关系的叙述中，错误的是______。

A．DMA控制器和CPU都可以作为总线的主控设备

B．DMA控制器和CPU都要使用总线时，CPU优先级更高

C．CPU可通过执行I/O指令来访问DMA控制器中的寄存器

D．CPU可通过执行I/O指令来启动进行DMA传送的设备

13．关于浮点数的下列描述中，不正确的是（）

A．阶码的位数决定数据表示的围

B．尾数的位数决定精确度

C．围扩大的同时精确度也随之增加

D．机器零不唯一

14．关于Cache的更新策略，下列说确的是（）。

A．读操作时，写直达法和写回法在命中时应用

B．写操作时，写回法和按写分配法在命中时应用

C．读操作时，写直达法和按写分配法在失效对应用

D．写操作时，按写分配法、不按写分配法在失效时应用

15．DMA方式的接口电路中有程序中断部件，其作用是______。

A．实现数据传送

B．向CPU提出总线使用权

C．向CPU提出传输结束

D．发中断请求

二、填空题

2．有效信息为1100，生成多项式G（x）＝1011，则有效信息的CRC码为

3．串行总线一般用于的数据传输，并行总线则主要用于数据传输。

4．一个具有24位地址和8位字长的存储器，该存储器能存储字节信息,若存储器由4M×1位的RAM芯片组成，需要片。

5．十进制数65789对应的IEEE75432位浮点数为 H

三、综合题

1．为什么要采用校验码？

2．假定主存和Cache之间采用直接映射方式，块大小为16B。

Cache的数据区容量为64KB，主存地址为32位，按字节编址，数据字长32位。

要求：

说明主存地址分成哪几个部分，每部分各几位？

计算Cache有多少行？

容量多大？

3．某计算机有变址、间接和相对等四种寻址方式，设指令由操作码、寻址方式特征位和地址码三部分组成，且为单字长指令。

设当前指令的地址码部分为001AH，正在执行的指令所在地址为1F05H，变址寄存器中的容为23A0H，根据要求完成下列填空：

已知存储器的部分地址及相关容如下：

⑴ 当执行取数指令时，如为变址寻址方式，则取得操作数为（    ）H;

⑵ 如为间接寻址，取出的数为（     ）H;

⑶ 当采用相对寻址时，有效地址为（    ）H;

*本试卷为随机选题

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一、单选题

1．下列是定点数不恢复余数除法中的相关操作:

①除法过程中的左移②除法过程中的加/减操作③余数校正则运算过程中可能出现溢出错误操作的是（）

A．仅①

B．仅②

C．②、③

D．①、②

2．若指令地址码为Ad，则相对寻址方式下操作数的有效地址为（）。

A．Ad

B．M[Ad]

C．R[Ad]

D．（PC）+Ad

3．中断向量地址是______。

A．子程序入口地址

B．中断服务程序入口地址

C．中断服务程序入口地址的地址

D．中断返回地址

4．某计算机字长8位，机器数11111111对应的十进制真值不可能是（）

-1-A．

B．127

-0-C．

-128-D．

5．通用寄存器是指具有多种功能的寄存器。

从CPU部寄存器的功能来看，通用寄存器一定不能替代下列寄存器的功能（）

A．变址寄存器

B．基址寄存器

C．地址寄存器

D．指令寄存器

6．CPU可直接访问的存储器是（）。

A．虚拟存储器

B．磁盘存储器

C．磁带存储器

D．主存储器

7．异步控制常用于______作为其主要控制方式。

A．在单总线结构计算机中访问主存与外围设备时

B．微型机的CPU中

C．硬布线控制器中

D．微程序控制器中

8．在中断接口电路中，向量地址可通过______送至CPU。

A．地址线

B．数据线

C．控制线

D．状态线

9．某计算机字长8位，两个有符号整数[x]补=44H,[y]补=DCH，在该机中执行算术运算x+2y后得到的结果及相应溢出标志位OF的值分别为（）

A．32H，0

B．32H，1

C．FCH，0

D．FCH，1

10．下列有关指令周期的叙述中，错误的是（）。

A．指令周期的第一个阶段一定是取指令阶段

B．乘法指令和加法指令的指令周期总是一样长

C．一个指令周期由若干个机器周期或时钟周期组成

D．单周期CPU中的指令周期就是一个时钟周期

11．下列是关于相容性和互斥性微操作的描述:

①能在同一CPU周期中并行执行的微操作一定是相容性微操作;②不能在同一CPU周期中并行执行的微操作一定是互斥性微操作;③能在同一时钟周期并行执行的微操作一定是相容性微操作;④不能在同一时钟周期并行执行的微操作一定是互斥性微操作上述描述中正确的是（）。

A．①、②、③

B．①、②、④

C．②、③、④

D．①、③、④

12．设某程序执行前　r0=0x11223344。

依次执行下列指令：

r1=0x100；STRr0,[r1]（将r0中的数据存放到r1的容所指向的主存单元）；LDRBr2,[r1]（从r1容所指主存单元取一个字节的数据送r2中保存）。

若数据在主存中按小端模式存放，则r2中的容为（）

A．0X11

B．0X22

C．0X33

D．0X44

13．寄存器中的值有时是地址，有时是数据，它们在形式上没有差别，只有通过（）才能识别它是数据还是地址。

A．寄存器编号

B．判断程序

C．指令操作码或寻址方式位

D．时序信号

14．关于动态存储器刷新的下列描述中不正确的是（）。

A．按行刷新

B．刷新地址来自CPU输出的地址

C．分散刷新速度慢

D．集中刷新存在存储访问死时间

15．假定指令的执行依次为取指周期、译码/取操作数周期、执行周期和写回周期。

指令的顺序寻址只能在下列哪个周期实现（）

A．取指周期

B．译码/取操作数周期

C．执行周期

D．写回周期

二、填空题

1．对存储器的要 、 、，为解决这三者的矛盾，计算机、采用体系结构。

2．用8K×8位的EPROM芯片组成32K×16位的只读存储器，按字节编址，数据寄存器最少应有位,地址寄存器最少应有位。

3．主机存容量为16MB,Cache的容量16KB，每块8个字，每个字32位。

Cache按四路组相联映像（即Cache每组包含4个字块）组织，设Cache的初态为空，CPU依次从主存第0、1、2、….99号读出100个字（主存一次读出一个字），并重复此次序读8次，问命中率为。

4．计算机的主存地址空间大小为64MB，采用字节编址方式。

其cache数据区容量为4KB，采用4路组相联映射方式、LRU替换和回写（writeback）策略，块大小为64B。

该cache的总容量有位。

5．假设一个同步总线的时钟频率为100MHZ,总线带宽为32位,每个时钟周期传输一个字长的数据,该总线的最大数据传输率为MB/S，若要将总线带宽提高一倍，可将数据总线增加到位或讲总线时钟频率增至MHZ，或每个时钟周期传输个数据。

三、综合题

1．下图为实现原码一位乘法的硬件逻辑图。

 图原码乘法的逻辑实现　　

 图中寄存器R0存放部分积，寄存器R1存放乘数，控制电路产生乘法执行过程中的移位和计数功能。

设被乘数[x]原=x0x1x2x3x4x5,乘数[y]原=y0y1y2y3y4y5,根据原码一位乘法的运算法则，回答下列问题：

 1）乘法开始执行时，R0、R1、a、b的初始分别为多少？

 2）R0和R1除具有数据寄存功能外，还必须有什么功能？

 3）要得到正确的结果，图中还需要增加什么功能的电路？

2．何为动态存储器的刷新？

有哪些常见的刷新方式？

各有何特点？

3．分别给出具有下列要求的程序或程序段的示例：

对于数据的访问，几乎没有时间局部性和空间局部性。

对于数据的访问，有很好的时间局部性，但几乎没有空间局部性。

对于数据的访问，有很好的空间局部性，但几乎没有时间局部性。

对于数据的访问，空间局部性和时间局部性都好。

*本试卷为随机选题

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一、单选题

1．若机器数11111111对应的值为零,则对应的机器数为（）

A．原码

B．反码

C．补码

D．移码

2．下列叙述中______是正确的。

A．程序中断方式中有中断请求，DMA方式中没有中断请求

B．程序中断方式和DMA方式中实现数据传送都需中断请求

C．程序中断方式和DMA方式中都有中断请求，但目的不同

D．DMA要等到指令周期结束时才进行周期窃取

3．在某8位采用单符号补码数据表示的计算机中,已知[X]补=0.1001,[Y]补=1.0101，则计算完XY并完成商校验后，商寄存器的值为（）

A．11110011

B．11111101

C．10000011

D．10000001

4．某计算机字长8位，ALU采用SN74181实现，两个无符号数x=69,y=38在该机中