数字电路第四章ppt课件PPT文件格式下载.ppt
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解：
（1）由逻辑图逐级写出逻辑表达式。
为了写表达式方便，借助中间变量P。
中北大学电子信息工程系第三章组合逻辑电路例例3.3.13.3.1：
设设计计一一个个三三人人表表决决电电路路，结结果果按按“少少数数服服从从多多数数”的的原原则则决决定。
定。
（11）列真值表：
）列真值表：
（3）化简。
化简。
（22）由真值表写出逻辑表达式：
由真值表写出逻辑表达式：
3.3组合逻辑电路的设计方法小规模（SSI）中规模（MSI）大规模（LSI）超大规模（VLSI）设计过程的基本步骤：
中北大学电子信息工程系第三章组合逻辑电路如果，要求用与非门实现该逻辑电路，就应将表达式转换成与非与非表达式：
画出逻辑图如图所示。
得最简与或表达式：
（44）画出逻辑图。
）画出逻辑图。
中北大学电子信息工程系第三章组合逻辑电路解：
（1）列真值表：
例3.3.2：
设计一个电话机信号控制电路。
电路有I0（火警）、I1（盗警）和I2（日常业务）三种输入信号，通过排队电路分别从L0、L1、L2输出，在同一时间只能有一个信号通过。
如果同时有两个以上信号出现时，应首先接通火警信号，其次为盗警信号，最后是日常业务信号。
试按照上述轻重缓急设计该信号控制电路。
要求用集成门电路7400（每片含4个2输入端与非门）实现。
中北大学电子信息工程系第三章组合逻辑电路
（2）由真值表写出各输出的逻辑表达式：
（3）根据要求，将上式转换为与非表达式：
中北大学电子信息工程系第三章组合逻辑电路（4）画出逻辑图。
中北大学电子信息工程系第三章组合逻辑电路例3.3.3：
设计一个将余3码变换成8421BCD码的组合逻辑电路。
（1）根据题目要求，列出真值表：
）根据题目要求，列出真值表：
中北大学电子信息工程系第三章组合逻辑电路
（2）用卡诺图进行化简。
（注意利用无关项）中北大学电子信息工程系第三章组合逻辑电路（3）由逻辑表达式画出逻辑图。
中北大学电子信息工程系第三章组合逻辑电路3.4组合逻辑模块及其应用组合逻辑模块及其应用3.4.13.4.1编码器编码器一.编码器的基本概念及工作原理编码将特定的逻辑信号编为一组二进制代码。
能够实现编码功能的逻辑部件称为编码器。
一般而言，N个不同的信号，至少需要n位二进制数编码。
N和n之间满足下列关系:
2nN中北大学电子信息工程系第三章组合逻辑电路例：
例：
设计一个键控设计一个键控8421BCD8421BCD码编码器。
码编码器。
中北大学电子信息工程系第三章组合逻辑电路
（2）由真值表写出各输出的逻辑表达式为：
（11）列出真值表：
）列出真值表：
中北大学电子信息工程系第三章组合逻辑电路重新整理得：
重新整理得：
（33）由表达式画由表达式画出逻辑图：
出逻辑图：
中北大学电子信息工程系第三章组合逻辑电路（44）增加增加控制使能标志控制使能标志GS：
当按下当按下S0S9任意一个键时，任意一个键时，GS=1，表示有表示有信号输入；
信号输入；
当当S0S9均没均没按下时，按下时，GS=0，表示没有信号表示没有信号输入。
输入。
中北大学电子信息工程系第三章组合逻辑电路二二.二进制编码器二进制编码器33位位二二进进制制编编码码器器有有88个个输输入入端端，33个个输输出出端端，所所以以常常称称为为88线线33线编码器，其功能真值表见下表：
（线编码器，其功能真值表见下表：
（输入为高电平有效输入为高电平有效）中北大学电子信息工程系第三章组合逻辑电路由真值表写出各输出的逻辑表达式为：
用门电路实现逻辑电路：
中北大学电子信息工程系第三章组合逻辑电路三优先编码器允许同时输入两个以上信号，并按优先级输出。
集成优先编码器举例74148（8线-3线）注意：
该电路为反码输出。
EI为使能输入端（低电平有效），EO为使能输出端（高电平有效），GS为优先编码工作标志（低电平有效）。
中北大学电子信息工程系第三章组合逻辑电路三三优先编码器优先编码器允许同时输入两个以上信号，并按允许同时输入两个以上信号，并按优先级输出。
优先级输出。
中北大学电子信息工程系第三章组合逻辑电路四四编码器的应用编码器的应用11编码器的扩展编码器的扩展用两片用两片7414874148优先编码器串行扩展实现的优先编码器串行扩展实现的1616线线44线优先编码器线优先编码器中北大学电子信息工程系第三章组合逻辑电路22组成组成8421BCD8421BCD编码器编码器中北大学电子信息工程系第三章组合逻辑电路3.4.2译码器一译码器的基本概念及工作原理一译码器的基本概念及工作原理译码器将输入代码转换成特定的输出信号例：
22线线44线译码器线译码器中北大学电子信息工程系第三章组合逻辑电路写出各输出函数表达式：
画出逻辑电路图：
中北大学电子信息工程系第三章组合逻辑电路二、集成译码器二、集成译码器1.1.二进制译码器二进制译码器741383741383线线88线译码器线译码器中北大学电子信息工程系第三章组合逻辑电路2.84212.8421BCD译码器译码器74427442中北大学电子信息工程系第三章组合逻辑电路中北大学电子信息工程系第三章组合逻辑电路三、译码器的应用三、译码器的应用1译码器的扩展用两片74138扩展为4线16线译码器中北大学电子信息工程系第三章组合逻辑电路2实现组合逻辑电路例3.4.2.1试用译码器和门电路实现逻辑函数：
将逻辑函数转换成最小项表达式，再转换成与非与非形式。
=m3+m5+m6+m7=用一片74138加一个与非门就可实现该逻辑函数。
中北大学电子信息工程系第三章组合逻辑电路例3.4.2.2某组合逻辑电路的真值表如表4.2.4所示，试用译码器和门电路设计该逻辑电路。
写出各输出的最小项表达式，再转换成与非与非形式:
中北大学电子信息工程系第三章组合逻辑电路用一片74138加三个与非门就可实现该组合逻辑电路。
可见，用译码器实现多输出逻辑函数时，优点更明显。
中北大学电子信息工程系第三章组合逻辑电路3构成数据分配器构成数据分配器数据分配器将一路输入数据根据地址选择码分配给多路数据输出中的某一路输出。
中北大学电子信息工程系第三章组合逻辑电路用译码器设计一个用译码器设计一个“1线线-8线线”数据分配器数据分配器中北大学电子信息工程系第三章组合逻辑电路四、数字显示译码器四、数字显示译码器常用的数字显示器有多种类型，按显示方式分，有字型重叠式、点阵式、分段式等。
按发光物质分，有半导体显示器，又称发光二极管（LED）显示器、荧光显示器、液晶显示器、气体放电管显示器等。
11七段数字显示器原理七段数字显示器原理中北大学电子信息工程系第三章组合逻辑电路按内部连接方式不同，七段数字显示器分为共阴极和共阳极两种。
22七段显示译码器7448七段显示译码器7448是一种与共阴极数字显示器配合使用的集成译码器。
中北大学电子信息工程系第三章组合逻辑电路中北大学电子信息工程系第三章组合逻辑电路7448的逻辑功能：
的逻辑功能：
（1）正常译码显示。
LT=1，BI/RBO=1时，对输入为十进制数l15的二进制码（00011111）进行译码，产生对应的七段显示码。
（2）灭零。
当LT=1，而输入为0的二进制码0000时，只有当RBI=1时，才产生0的七段显示码,如果此时输入RBI=0，则译码器的ag输出全0，使显示器全灭；
所以RBI称为灭零输入端。
（3）试灯。
当LT=0时，无论输入怎样，ag输出全1，数码管七段全亮。
由此可以检测显示器七个发光段的好坏。
LT称为试灯输入端。
中北大学电子信息工程系第三章组合逻辑电路（4）特殊控制端BI/RBO。
BI/RBO可以作输入端，也可以作输出端。
作输入使用时，如果BI=0时，不管其他输入端为何值，ag均输出0，显示器全灭。
因此BI称为灭灯输入端。
作输出端使用时，受控于RBI。
当RBI=0，输入为0的二进制码0000时，RBO=0，用以指示该片正处于灭零状态。
所以，RBO又称为灭零输出端。
中北大学电子信息工程系第三章组合逻辑电路将BI/RBO和RBI配合使用，可以实现多位数显示时的“无效0消隐”功能。
具有无效0消隐功能的多位数码显示系统中北大学电子信息工程系第三章组合逻辑电路3.4.33.4.3数据选择器数据选择器一、一、数据选择器的基本概念及工作原理数据选择器的基本概念及工作原理数据选择器根据地址选择码从多路输入数据中选择一路，送到输出。
中北大学电子信息工程系第三章组合逻辑电路例：
四选一数据选择器根据功能表，可写出输出逻辑表达式：
中北大学电子信息工程系第三章组合逻辑电路由逻辑表达式画出逻辑图：
由逻辑表达式画出逻辑图：
中北大学电子信息工程系第三章组合逻辑电路二、集成数据选择器二、集成数据选择器集成数据选择器集成数据选择器74151（8选选1数据选择器）数据选择器）中北大学电子信息工程系第三章组合逻辑电路中北大学电子信息工程系第三章组合逻辑电路三、数据选择器的应用1数据选择器的通道扩展数据选择器的通道扩展用两片用两片74151组成组成“16选选1”数据选择器数据选择器中北大学电子信息工程系第三章组合逻辑电路2实现组合逻辑函数实现组合逻辑函数
（1）当逻辑函数的变量个数和数据选择器的地址输入变量个数相同时，可直接用数据选择器来实现逻辑函数。
例4.3.1试用8选1数据选择器74151实现逻辑函数：
将逻辑函数转换成最小项表达式：
=m3+m5+m6+m7画出连线图。
中北大学电子信息工程系第三章组合逻辑电路
（2）当逻辑函数的变量个数大于数据选择器的地址输入变量个数时。
例4.3.2试用4选1数据选择器实现逻辑函数：
将A、B接到地址输入端，C加到适当的数据输入端。
作出逻辑函数L的真值表，根据真值表画出连线图。
中北大学电子信息工程系第三章组合逻辑电路3.4.4加法器一、加法器的基本概念及工作原理一、加法器的基本概念及工作原理加法器实现两个二进制数的加法运算1半加器只能进行本位加数、被加数的加法运算而不考虑低位进位。
列出半加器的真值表：
画出逻辑电路图。
由真值表直接写出表达式:
中北大学电子信息工程系第三章组合逻辑电路如果想用与非门组成半加器，则将上式用代数法变换成与非形式：
由此画出用与非门组成的半加器
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