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2总体方案设计
锁存电路
四位参赛人员
1234
编码电路
译码电路
数码管显示
清零电路
图2.1抢答器主体方案
表2.1抢答状态
1号
2号
3号
4号
数码管显示号数
1
1
2
3
4
x
2.1方案比较
该电路的主要目的是应用一些常用集成数字器件设计成高准确率的四路数字抢答器。
要求将最先按下按钮的抢答人员的号数显示在数码管上，故考虑用锁存器将第一个出现的抢答信号锁存起来，不受此外的抢答信号的干扰，再通过优先编码器输出抢答号数的二进制编码，将此二进制编码送给译码器来控制数码管的显示，另外用一个按钮由主持人控制，每一轮抢答结束后，由主持人安按钮清零，开始新一轮的抢答。
方案一、用单片机作为主要控制模块，用软件编程来作为控制方式。
图2.3由单片机组成的四路抢答器
方案二、利用CD4532（优先编码器）实现编码电路。
图2.4基于74LS148构成的抢答器电路
方案三、利用4D触发器74ls175和D触发器
图2.574LS175控制的抢答电路结构
2.2方案论证
第一种方案中由于应用软件方式控制，那么控制方式可以根据实时需要对程序进行更改，通过改变程序，降低了成本，也减少了因电路设计的失误而带来的误差和损失。
但是由于课程学习限制，在此不采用此方法。
第二种方案，效果是最好的，且设计起来比较简单，只需要将芯片各管脚正确连接，连好清零端，便能准确实现功能，且很容易扩展其他的功能。
第三种方案，所用芯片比较少，但用了比较多的门和触发器。
大大增加了电路的复杂程度，与当今追求的简单准确有违。
2.3方案选择
上述两个方案最大的区别就是，方案一采用的是74LS148作为编码器，但该编码器在实际仿真的时候输出端的电平并不能按照功能表输出，与设计要求的清零有一定差别，若要选用它作为编码器，则清零比较困难。
而方案二是用CD4532组成的编码电路，它的功能与74LS148相近，但电路可以比74LS148更简单，且选用这个编码器，方便扩报警功能。
基于上述比较，最后选择方案二。
3.单元模块电路设计
3.1抢答部分
该模块的功能是模拟不同人员的抢答状态，其中有抢答和清零两种状态，该模块主要由按键开关的不同状态对应产生的二进制码分别为1号抢答-1000（K3K2K1K0），二号抢答-0100（K3K2K1K0）、三号抢答-0010（K3K2K1K0），四号抢答-0001（K3K2K1K0），清零-0000（K3K2K1K0）。
其电路如图3.1所示：
图3.1抢答部分电路
3.2锁存部分
该模块由74HC573的输入端接各位参赛人员的按键，输出端连接4532（优先编码器）。
在主持人宣布开始抢答后，各位参赛人员迅速按下按键，则按下按键的同时74HC573的输入端就得到一个有效的高电平，这时候74HC573就会在输出端输出相应的低电平，低电平继而送给CD4532，那么在有输入的情况下，CD4532的GS端就会输出一个高电平，经过非门以后变为一个低电平，而74HC573的LE（锁存端）就会得到一个有效的低电平而锁存住，整个过程速度很快，最先出现的抢答信号就能迅速地被锁起来，不被其他信号干扰，能达到抢答的功能。
由功能表可知，74HC573有八个输入端，但由于是四人抢答。
故需要选择抢答管。
由于74HC573是高电平有效，故不需要的管脚可以直接接地，抢答管脚接按键。
选择抢答管脚为D1-D4.因为四人抢答就需要显示1、2、3、4，而D0-D7输出高电平使得数码管相应显示0-7，所以选择了D1D2D3D4四个管脚。
其余的管脚接地。
输出端接CD4532，只需要将相应的管脚对应连接。
图3.2抢答按钮部分电路
3.3优先编码部分
该编码器有八个信号输入端，三个二进制输出端，输入输出均以高电平有效作为有效电平，而且优先级次序为I7，I6，I5,I4,I3,I2,I1,I0。
次编码器为优先编码器，在遵从优先次序的情况下输出端Q0Q1Q2分别输出对应的三位二进制编码。
该模块主要由8线-3线编码器组成，EI为使能输出端，
本电路中，编码器的输入端接锁存器的输入端。
EI=1时，编码器可以工作，编译出对应的三位二进制代码。
图3.3编码电路
3.4译码部分
3.4.1译码器原理
A、B、C、D：
译码输入端。
输入需要译码的数据。
LE:
使能控制端。
用于控制译码器的正常译码，只有当LE时，译码器才能正常译码，否则不论输入任何值，所有数据输出端均输出高电平。
Y0-Y7:
译码输出端。
正常译码时，只有一个数据输出端为有效电平，其余全为高
平。
该模块是由一块CD4511译码器构成，A、B、C、D译码输入端连接计数器的计数输出端。
此译码输出可以控制输出0-9，但是由于是CD4532是三端输出，所以只使用ABC三个管脚，只需将D脚接地。
这样，译码器也能输出0-7，能够满足四个人的抢答要求。
QA-QG为七个输出端，接在数码管的七个输入端。
3.4.2译码器功能表、管脚图和显示图
表3.1译码器功能表
图3.5数码管引脚图
图3.6数码管显示图
图3.7译码电路
3.5清零部分
CD4532的EI端为输入使能端，当输入高电平时，该器件能正常编码，当EI端得到一个无效的低电平时，GS会输出低电平，经过一个非门后，74HC573的LE端得到一个高电平，该器件会放开锁存，使得所有输出为低电平，使得数码管显示为0，达到清零的效果。
图3.8清零电路
3.6显示部分
3.6.1显示电路原理
该部分电路输入端连接CD4511译码器的输出端，译码信号由于是二进制的信号，所以可以直接由信号线连接。
由于数码管是共阴极数码管，所以是高电平有效。
数码管下端可以直接接地，这样，只要输入端有输入，数码管就可以正常显示。
3.6.2显示电路
该电路主要由七段数码管构成，结构简单，比较容易连接和显示比较方便，因为是共阴极数码管，所以将公共端接地，而其他输入端就只需与CD4511的输出端对应相接。
图3.9显示电路
3．7特殊器件介绍
3.7.174HC573锁存器介绍
74HC573是由八个输入端一个锁存端一个输出控制端和八个输出端构成。
LE端为锁存端，低电平有效，当LE端出现一个低电平，锁存器就可以将输入信号锁存起来，第一个抢答信号就被锁存了起来，不受其他信号的干扰。
表3.274HC573功能表
图3.1174HC573内部结构图
3.7.2CD4532的介绍
该编码器有八个信号输入端，三个二进制输出端，输入输出均以高电平有效作为有效电平，而且优先级次序为I7，I6，I5,I4,I3,I2,I1,I0。
为了拓展电路功能，还设置了高电平有效的输入使能端EI和输出使能端EO，以及优先编码工作状态标志GS。
当EI=1时，编码器工作，而当EI=0时，禁止编码器工作，此时不论8个输入端为何种状态，3个输出端均为低电平，且GS和EO均为低电平。
EO只有在EI为1的时候且所有输入端都为0的时候输出为1，它可以与另一片相同的器件的EI连接，以便组成更多输入端的优先编码器。
GS的功能是，当EI为1，且至少有一个输入端有一个高电平信号输入时，GS为1，表明编码器处于工作状态，否则GS为0，或者只有I0输入端有高电平时，Y2Y1Y0为000的情况。
其功能表为
表3.3CD4532功能表
4.系统调试
4.1抢答按键电路部分
在按下相应的键后，所对应的输出端可以得到一个有效的高电平，此时数码管也能显示相应的数字。
图4.1抢答按键仿真图
4.2优先抢答功能调试
当最先抢答的人员的抢答信号被锁存住后，其他人员的抢答为无效，不能改变数码管的显示数字，干扰主持人的分辨能力。
其仿真图为
图4.2优先功能仿真
4.3清零功能调试
图4.3清零功能仿真
4.4显示部分调试
图4.4数码管显示1、2、3、4的仿真图
5.系统功能、指标参数
5.1系统的主要功能
本设计是由按键电路，锁存电路，译码电路、编码电路、清零电路和显示电路等六个部分组成。
比赛开始时数码管显示为0，,当主持人宣布开始抢答时，各位参赛人员开始抢答，数码管显示最先按下按键的，在主持人清零之前，数码管一直显示第一位按下按键的选手的编号。
一轮结束后，主持人按下清零键，这时候开始新一轮的抢答。
5.2系统的指标参数分析
（1）采用了+5v的电源。
（2）锁存器采用了74HC573。
（3）优先编码器采用了CD4532。
（4）译码器采用了CD4511.
（5）电路的按键电路是常为低电平，当按下按键时得到一个低电平，所以需要一个下拉电阻，经过考虑，采用1k的电阻比较合适。
而且CD4532的非清零时处于高电平和CD4511的BI端和LT端常接高电平，所以需要两个上拉电阻，经过考虑，取10k比较合适。
6设计总结与体会
生活中，四路数字抢答电路是一个非常实用的电路，应用非常广泛，抢答器具有锁存，显示和清零功能。
即选手按动按钮，锁存相应的编号，并在LED数码管上显示。
选手抢答实行优先锁存优先抢答选手的编号一直保持到主持人将系统清除为止。
抢答器由主持人控制，主持人按动开始按钮，选手可以进行抢答，第一个抢答的选手编号显示在数码管上，主持人不清零则其他选手再抢答无效，直至主持人清零，才可再次抢答。
此设计电路主要利用优先编码器，译码器，我们可以通过电路的设计来验证平时所学的理论知识，以及各个元器件的实际应用，从中我们学习到在利用的过程中我们应该注意什么，同时也锻炼了我们的动手实践能力。
这次课程设计，我们遇到了重重困难，在当初认为最简单的抢答部分我们就遇到了很多的困难，用74LS148不能达到我们预期的编码功能，只
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