时序逻辑电路练习及答案2Word格式文档下载.docx
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1、时序电路包含组合电路和存储电路两部分，存储电路是必不可少的。
2、同步时序逻辑电路中的无效状态是由于状态表没有达到最简所造成的。
3、即使电源关闭，移位寄存器中的内容也可以保持下去。
4、采用74LS161芯片可构成地址计数器，但最多不能超过8位地址。
5、74LS190芯片和74HC190芯片功能完全相同
三、选择题（每题3分，共18分）
1、下列电路中，能够存储数字信息的是（）；
A译码器；
B全加器；
C寄存器；
D编码器；
2、时序逻辑电路的输出状态的改变（）。
A.仅与该时刻输入信号的状态有关；
B.仅与时序电路的原状态有关；
C.与A.、B.皆有关D.输出信号的次态
3、（）触发器可以用来构成移位寄存器。
A.基本R-SB.同步R-SC.同步
DD.边沿D
4、用n个触发器构成计数器，可得到最大计数长度是（）。
A、nB、2nC、2nD、2n1
5、用触发器设计一个24进制的计数器，至少需要（）个触发器。
A、3B、4C、5D、6
6、一个4位的二进制加计数器，由0000状态开始，经过25个时钟脉冲后，此计数器的状态为（）
A、1100B、1000C、1001D、1010
四、时序逻辑电路的分析（30分）
电路如图所示，按要求进行分析。
1、写出电路的驱动方程：
（6分）
2、列出电路的状态方程：
3、列出电路的输出方程：
（3分）
4、画出状态转换表：
（6分）
5、画出状态转换图：
述电路的逻辑功能并指出其优缺点：
（3分）
五、计数器的分析题（20分）
已知74LS161功能表如下，试分析下列电路能构成几进制计数器，并画出状
态转换图。
若用置位法实现该功能
，电路应如何连接，画出电路图
计数器74LS161功能表如下
CLK
EP
6
CLK乩
LT
74LS161
LD
SP
ET
工作状态
X
XX
置零
1
mi数
保持
保持（floo）
J
计数
模块6-2参考答案
一、填空题（每空2分，共22分）
1.触发器2.该时刻的输入；
电路原来的状态3.同步；
异步
4.7；
3；
15.等价状态6.同步；
2n-1
二、判断题（每题2分，共10分）
TFTTT
三、选择题（每题3分，共18分）
CCDCCC
四、时序逻辑电路的分析（30分）
解：
1、电路的驱动方程为：
（6分）
J0
Q2/;
K0
Q2；
J1Q0;
K1
Q0/；
J2
2、状态方程：
（6分）
触发器的特性方程为：
Q*JQ/K/Q
*
Q0
将驱动方程代入特性方程可得状态方程为：
////*/*/
Q2Q0Q2Q0Q2；
Q1Q0Q1Q0Q1Q0；
Q2Q1Q2Q1Q2Q1
3、列出电路的输出方程：
YQ1/Q2（3分）
4、画出状态转换表：
（6分）
QiQlQ^
2Q&
Y
000
001
on
□
011
m
in
110
100
ICO
CJ
010
101
5、画出状态转换图：
6、描述电路的逻辑功能并指出其优缺点：
此电路是一个带有进位输出的六进制计数器；
其优点是计数过程中，每次状态转换时只有一个触发器的状态发生翻转,
译码时不会发生竞争—冒险现象;
其缺点是电路不能自启动。
十进制加法计数器（10分）
置位法:
LD（Q3Q0）
（10分）
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