电子科技大学数字电路期末考试样题.docx
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电子科技大学数字电路期末考试样题
电子科技大学数字电路期末考试样题
LT
2．已知逻辑函数
，请写出该函数的标准和（最小项之和）表达式：
3．找出逻辑表达式
对应的电路的所有静态冒险。
四、组合电路设计：
1、试用一片三输入八输出译码器74X138和适当的与非门实现函数：
画出电路连接图。
译码器如右图所示。
2、一个多路复用器，具有4个2位输入总线P、Q、R、T，3个选择输入端S2~S0根据表1选定4个输入总线中的一个来驱动2位输出总线Y。
如图2所示，可以使用一片74x153（四选一多路复用器）和一个码转换器实现该功能，试写出图2中“码转换器”对应的真值表和逻辑表达式。
，
五、时钟同步状态机设计：
1、写出一个3位同步格雷（GRAY）码计数器的转移/输出表：
Q2Q1Q0
Q2*Q1*Q0*
Z
2、构造J-K触发器的应用表。
已知某状态机的转移/输出表如表2所示，写出针对J-K触发器的激励/输出表。
表2：
转移/输出表
Q1Q0
X
0
1
00
01，0
10，0
01
11，0
01，0
11
01，1
00，0
10
01，0
11，0
Q1*Q0*，Z
3、已知某状态机针对D触发器的激励/输出表如表3所示，请导出最小成本激励方程和输出方程。
表3：
激励/输出表
Q1Q0
X
0
1
00
00,0
01,0
01
00,0
10,0
10
00,0
10,1
D1D0,Z
，
六、时钟同步状态机分析：
1、已知电路如图3所示，写出电路的激励方程、转移方程并建立转移表
2、已知某时序电路的转移/输出表如表4所示，请画出与输入波形对应的输出Y的波形图（设起始状态为Q1Q0=00）。
3、构造一个与图4所示状态图等效的状态/输出表。
状态/输出表
S
XY
Z
00
01
10
11
S*
图4
七、设计一个MEALY型序列检测器，当且仅当输入X是1111或1101时，输出Z为1。
允许重叠。
写出最简状态/输出表或状态图。
比如：
X：
0
0
1
1
0
1
1
1
1
0
1
1
1
0
1
0
0
0
0
Z：
0
0
0
0
0
1
0
0
1
0
1
0
0
0
1
0
0
0
0
解：
状态/输出表：
含义
S
X
0
1
未收到1位有效码
A
A，0
B，0
收到1个1
B
A，0
C，0
收到11
C
D，0
E，0
收到110
D
A，0
B，1
收到111
E
A，0
E，1
S*，Z
八、74x163为同步清零，同步计数的4位二进制计数器，利用74x163和集成多路选择器74x151构成的序列发生器电路如图5所示。
1）试分析当M=0和M=1时，电路中Q2Q1Q0的输出序列以及计数器分别工作在几进制。
2）
写出当M=0和M=1输出Y处产生的序列。
解：
1）M=0时，Q2Q1Q0的输出序列为：
000→001→010→011→100→101→110→111→000→⋯，为八进制计数器；
M=1时，Q2Q1Q0的输出序列为：
001→010→011→100→101→110→111→001→⋯，为七进制计数器。
2）M=0时，输出Y处产生的序列：
11101010；
M=1时，输出Y处产生的序列：
1011010。
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