本科生期末考试题库Word文档格式.docx

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A单总线B双总线

C三总线D多总线

12单级中断系统中，CPU一旦响应中断，立即关闭（）标志，以防止本次中断服务结束前同级的其他中断源产生另一次中断进行干扰。

Axx允许Bxx请求

Cxx屏蔽DDMA请求

13安腾处理机的典型指令格式为（）位。

A32位B64位C41位D48位14下面操作中应该由特权指令完成的是（）。

A设置定时器的初值

B从用户模式切换到管理员模式

C开定时器xx

D关xx

15下列各项中，不属于安腾体系结构基本特征的是（）。

A超长指令字

B显式并行指令计算

C推断执行

D超线程

二、填空题（每小题2分，共20分）

1字符信息是符号数据，属于处理（）领域的问题，国际上采用的字符系统是七单位的（）码。

2按IEEE754标准，一个32位浮点数由符号位S（1位）、阶码E（8位）、尾数M（23位）三个域组成。

其中阶码E的值等于指数的真值（）加上一个固定的偏移值（）。

3双端口存储器和多模块交叉存储器属于并行存储器结构，其中前者采用（）并行技术，后者采用（）并行技术。

4虚拟存储器分为页式、（）式、（）式三种。

5安腾指令格式采用5个字段：

除了操作码（OP）字段和推断字段外，还有3个7位的（）字段，它们用于指定（）2个源操作数和1个目标操作数的地址。

6CPU从内存取出一条指令并执行该指令的时间称为（），它常用若干个（）来表示。

7安腾CPU中的主要寄存器除了128个通用寄存器、128个浮点寄存器、128个应用寄存器、1个指令指针寄存器（即程序计数器）外，还有64个（）和8个（）。

8衡量总线性能的重要指标是（），它定义为总线本身所能达到的最高传输速率，单位是（）。

9DMA控制器按其结构，分为（）DMA控制器和（）DMA控制器。

前者适用于高速设备，后者适用于慢速设备。

1064位处理机的两种典型体系结构是（）和（）。

前者保持了与IA-32的完全兼容，后者则是一种全新的体系结构。

三、简答题（每小题8分，共16分）

1CPU中有哪几类主要寄存器，用一句话回答其功能。

2指令和数据都用二进制代码存放在内存中，从时空观角度回答CPU如何区分读出的代码是指令还是数据。

四、计算题（10分）

设x=-15，y=+13，数据用补码表示，用带求补器的阵列乘法器求出乘积x×

y，并用十进制数乘法进行验证。

五、证明题（12分）

用定量分析方法证明多模块交叉存储器带宽大于顺序存储器带宽。

六、设计题（15分）

某计算机有下图所示的功能部件，其中M为主存，指令和数据均存放在其中，MDR为主存数据寄存器，MAR为主存地址寄存器，R

0～R

3为通用寄存器，IR为指令寄存器，PC为程序计数器（具有自动加1功能），C、D为暂存寄存器，ALU为算术逻辑单元，移位器可左移、右移、直通传送。

⑴将所有功能部件连接起来，组成完整的数据通路，并用单向或双向箭头表示信息传送方向。

⑵画出“ADDR1，（R2）”指令周期流程图。

该指令的含义是将R

1中的数与（R

2）指示的主存单元中的数相加，相加的结果直通传送至R

1xx。

⑶若另外增加一个指令存贮器，修改数据通路，画出⑵的指令周期流程图。

七、分析计算题（12分）

如果一条指令的执行过程分为取指令、指令译码、指令执行三个子过程，每个子过程时间都为100ns。

⑴请分别画出指令顺序执行和流水执行方式的时空图。

⑵计算两种情况下执行n=1000条指令所需的时间。

⑶流水方式比顺序方式执行指令的速度提高了几倍？

本科生期末试卷

（二）

1冯·

诺依曼机工作的基本方式的特点是（）。

A多指令流单数据流

B按地址访问并顺序执行指令

C堆栈操作

D存贮器按内容选择地址

2在机器数（）中，零的表示形式是唯一的。

A原码B补码C移码D反码

3在定点二进制运算器中，减法运算一般通过（）来实现。

A原码运算的二进制减法器

B补码运算的二进制减法器

C原码运算的十进制xx

D补码运算的二进制xx

4某计算机字长32位，其存储容量为256MB，若按单字编址，它的寻址范围是（）。

A0—64MBB0—32MBC0—32MD0—64M

5主存贮器和CPU之间增加cache的目的是（）。

A解决CPU和主存之间的速度匹配问题

B扩大主存贮器容量

C扩大CPUxx通用寄存器的数量

D既扩大主存贮器容量，又扩大CPU中通用寄存器的数量

6单地址指令中为了完成两个数的算术运算，除地址码指明的一个操作数外，另一个常需采用（）。

A堆栈寻址方式B立即寻址方式

C隐含寻址方式D间接寻址方式

7同步控制是（）。

A只适用于CPU控制的方式

B只适用于外围设备控制的方式

C由统一时序信号控制的方式

D所有指令执行时间都相同的方式

8描述PCI总线中基本概念不正确的句子是（）。

APCI总线是一个与处理器无关的高速外围设备

BPCI总线的基本传输机制是猝发式传送

CPCI设备一定是主设备

D系统中只允许有一条PCI总线

9CRT的分辨率为1024×

1024像素，像素的颜色数为256，则刷新存储器的容量为（）。

A512KBB1MBC256KBD2MB10为了便于实现多级中断，保存现场信息最有效的办法是采用（）。

A通用寄存器B堆栈C存储器D外存11特权指令是由（）执行的机器指令。

A中断程序B用户程序C操作系统核心程序DI/O程序

12虚拟存储技术主要解决存储器的（）问题。

A速度B扩大存储容量C成本D前三者兼顾

13引入多道程序的目的在于（）。

A充分利用CPU，减少等待CPU时间

B提高实时响应速度

C有利于代码共享，减少主辅存信息交换量

D充分利用存储器

1464位双核安腾处理机采用了（）技术。

A流水B时间并行C资源重复D流水+资源重复

15在安腾处理机中，控制推测技术主要用于解决（）问题。

Axx服务

B与取数指令有关的控制相关

C与转移指令有关的控制相关

D与存数指令有关的控制相关

1在计算机术语中，将ALU控制器和（）存储器合在一起称为（）。

2数的真值变成机器码可采用原码表示法，反码表示法，（）表示法，（）表示法。

3广泛使用的（）和（）都是半导体随机读写存储器。

前者的速度比后者快，但集成度不如后者高。

4反映主存速度指标的三个术语是存取时间、（）和（）。

5形成指令地址的方法称为指令寻址，通常是（）寻址，遇到转移指令时（）寻址。

6CPU从（）取出一条指令并执行这条指令的时间和称为（）。

7RISC指令系统的最大特点是：

只有（）指令和（）指令访问存储器，其余指令的操作均在寄存器之间进行。

8微型机的标准总线，从带宽132MB/S的32位（）总线发展到64位的（）总线。

9IA-32表示（）公司的（）位处理机体系结构。

10安腾体系机构采用显示并行指令计算技术，在指令中设计了（）字段，用以指明哪些指令可以（）执行。

1简述64位安腾处理机的体系结构主要特点。

2画出分布式仲裁器的逻辑示意图。

已知x=-0.01111，y=+0.11001,求：

①[x]

补，[-x]

补，[y]

补，[-y]

补；

②x+y,x-y,判断加减运算是否溢出。

五、分析题（12分）

参见图1，这是一个二维xx系统，请问：

①在中断情况下，CPU和设备的优先级如何考虑？

请按降序排列各设备的中断优先级。

②若CPU现执行设备C的中断服务程序，IM

2，IM

1，IM

0的状态是什么？

如果CPU执行设备H的中断服务程序，IM

0的状态又是什么？

③每一级的IM能否对某个优先级的个别设备单独进行屏蔽？

如果不能，采取什么方法可达到目的？

④若设备C一提出中断请求，CPU立即进行响应，如何调整才能满足此要求？

图2所示为双总线结构机器的数据通路，IR为指令寄存器，PC为程序计数器（具有自增功能），M为主存（受R/W#信号控制），AR为地址寄存器，DR为数据缓冲寄存器，ALU由加、减控制信号决定完成何种操作，控制信号G控制的是一个门电路。

另外，线上标注有小圈表示有控制信号，例中y

i表示y寄存器的输入控制信号，R

1o为寄存器R

1的输出控制信号，未标字符的线为直通线，不受控制。

①“ADDR2,R0”指令完成（R

0）+（R

2）→R

0的功能操作，画出其指令周期流程图，假设该指令的地址已放入PC中。

并在流程图每一个CPU周期右边列出相应的微操作控制信号序列。

②若将（取指周期）缩短为一个CPU周期，请先画出修改数据通路，然后画出指令周期流程图。

七、分析题（12分）

设有k=4段指令流水线，它们是取指令、译码、执行、存结果，各流水段持续时间均为Δt。

①连续输入n=8条指令，请画出指令流水线时空图。

②推导流水线实际吞吐率的公式P，它定义为单位时间中输出的指令数。

③推导流水线的加速比公式S，它定义为顺序执行几条指令所用的时间与流水执行几条指令所用的时间之比。

本科生期末试卷（三）

1下列数中最小的数是（）。

A（101001）

2B（52）

8C（101001）

BCDD（233）

16

2某DRAM芯片，其存储容量为512×

8位，该芯片的地址线和数据线的数目是（）。

A8，512B512，8C18，8D19，83在下面描述的汇编语言基本概念中，不正确的表述是（）。

A对程序员的训练要求来说，需要硬件知识

B汇编语言对机器的依赖性高

C用汇编语言编写程序的难度比高级语言小

D汇编语言编写的程序执行速度比高级语言慢

4交叉存储器实质上是一种多模块存储器，它用（）方式执行多个独立的读写操作。

A流水B资源重复C顺序D资源共享5寄存器间接寻址方式中，操作数在（）。

A通用寄存器B主存单元C程序计数

器D堆栈

6机器指令与微指令之间的关系是（）。

A用若干条微指令实现一条机器指令

B用若干条机器指令实现一条微指令

C用一条微指令实现一条机器指令

D用一条机器指令实现一条微指令

7描述多媒体CPU基本概念中，不正确的是（）。

A多媒体CPU是带有MMX技术的处理器

BMMX是一种多媒体扩展结构

CMMX指令集是一种多指令流多数据流的并行处理指令

D多媒体CPU是以超标量结构为基础的CISC机器

8在集中式总线仲裁中，（）方式对电路故障最敏感。

A菊花链B独立请求C计数器定时查询9流水线中造成控制相关的原因是执行（）指令而引起。

A条件转移B访内C算逻D无条件转移

10PCI总线是一个高带宽且与处理器无关的标准总线。

下面描述中不正确的是（）。

A采用同步定时协议B采用分布式仲裁策略

C具有自动配置能力D适合于低成本的小系统

11下面陈述中，不属于外围设备三个基本组成部分的是（）。

A存储介质B驱动装置C控制电

路D计数器

12中断处理过程中，（）项是由硬件完成。

A关中断B开中断C保存CPU现

场D恢复CPU现场

13IEEE1394是一种高速串行I/O标准接口。

以下选项中，（）项不属于IEEE1394的协议集。

A业务层B链路层C物理层D串行总线管理

14下面陈述中，（）项属于存储管理部件MMU的职能。

A分区式存储管理B交换技术C分页技术1564位的安腾处理机设置了四类执行单元。

下面陈述中，（）项不属于安腾的执行单元。

A浮点执行单元B存储器执行单元

C转移执行单元D定点执行单元

1定点32位字长的字，采用2的补码形式表示时，一个字所能表示的整数范围是（）。

2IEEE754标准规定的64位浮点数格式中，符号位为1位，阶码为11位，尾数为52位，则它能表示的最大规格化正数为（）。

3浮点加、减法运算的步骤是（）、（）、（）、（）、（）。

4某计算机字长32位，其存储容量为64MB，若按字编址，它的存储系统的地址线至少需要（）条。

5一个组相联映射的Cache，有128块，每组4块，主存共有16384块，每块64个字，则主存地址共（）位，其中主存字块标记应为（）位，组地址应为（）位，Cache地址共（）位。

6CPU从主存取出一条指令并执行该指令的时间叫（），它通常包含若干个（），而后者又包含若干个（）。

7某中断系统中，每抽取一个输入数据就要中断CPU一次，中断处理程序接收取样的数据，并将其保存到主存缓冲区内。

该中断处理需要X秒。

另一方面，缓冲区内每存储N个数据，主程序就将其取出进行处理，这种处理需要Y秒，因此该系统可以跟踪到每秒（）次中断请求。

8在计算机系统中，多个系统部件之间信息传送的公共通路称为（）。

就其所传送信息的性质而言，在公共通路上传送的信息包括（）、（）、（）。

9在虚存系统中，通常采用页表保护、段表保护和键保护方法实现（）保护。

10安腾体系结构采用推测技术，利用（）推测方法和（）推测方法提高指令执行的并行度。

1列表比较CISC处理机和RISC处理机的特点。

2简要列出64位的安腾处理机体系结构的主要特点。

四、计算题（12分）

有两个浮点数N

1=2j1×

S

1,N

2=2j2×

2，其中阶码用4位移码、尾数用8位原码表示（含1位符号位）。

设

j

1=（11）

2,S

1=（+0.0110011）

2,j

2=（-10）

2=（+0.1101101）

2，求N

1+N

2，写出运算步骤及结果。

五、设计题（12分）

机器字长32位，常规设计的物理存储空间≤32M，若将物理存储空间扩展到256M，请提出一种设计方案。

六、分析题（10分）

某机的指令格式如下所示

X为寻址特征位：

X=00：

直接寻址；

X=01：

用变址寄存器R

X1寻址；

X=10：

X2寻址；

X=11：

相对寻址

设（PC）=1234H,（RX1）=0037H,（RX2）=1122H（H代表十六进制数），请确定下列指令中的有效地址：

①4420H②2244H③1322H④3521H

七、分析题（15分）

有如下四种类型的单处理机：

①基准标量机（每个CPU周期启动1条机器指令，并行度ILP=1）；

②超级标量机（每个CPU周期启动3条机器指令，并行度ILP=3）；

③超级流水机（每个CPU周期启动1条机器指令，并行度ILP=3）；

④超标量超流水机（每个CPU周期启动9条指令，并行度ILP=9）。

试画出四种类型处理机的时空图。

本科生期末试卷（四）

1运算器的核心功能部件是（）。

A数据总线BALUC状态条件寄存

器D通用寄存器

2某单片机字长32位，其存储容量为4MB。

若按字编址，它的寻址范围是（）。

A1MB4MBC4MD1MB

3某SRAM芯片，其容量为1M×

8位，除电源和接地端外，控制端有E和R/W#，该芯片的管脚引出线数目是（）。

A20B28C30D32

4双端口存储器所以能进行高速读/写操作，是因为采用（）。

A高速芯片B新型器件

C流水技术D两套相互独立的读写电路

5单地址指令中为了完成两个数的算术运算，除地址码指明的一个操作数以外，另一个数常需采用（）。

6为确定下一条微指令的地址，通常采用断定方式，其基本思想是（）。

A用程序计数器PC来产生后继微指令地址

B用微程序计数器µ

PC来产生后继微指令地址

C通过微指令顺序控制字段由设计者指定或由设计者指定的判别字段控制产生后继微指令地址

D通过指令中指定一个专门字段来控制产生后继微指令地址7微程序控制器中，机器指令与微指令的关系是（）。

A每一条机器指令由一条微指令来执行

B每一条机器指令由一段用微指令编成的微程序来解释执行C一段机器指令组成的程序可由一条微指令来执行

D一条微指令由若干条机器指令组成

8CPU中跟踪指令后继地址的寄存器是（）。

A地址寄存器B程序计数器C指令寄存器D通用寄存器

9某寄存器中的数值为指令码，只有CPU的（）才能识别它。

A指令译码器B判断程序C微指

令D时序信号

10为实现多级中断，保存现场信息最有效的方法是采用（）。

A通用寄存器B堆栈C主存D外存11采用DMA方式传送数据时，每传送一个数据，就要占用一个（）的时间。

A指令周期B机器周期C存储周

期D总线周期

12将IEEE1394串行标准接口与SCSI并行标准接口进行比较，指出下面陈述中不正确的项是（）。

A前者数据传输率高

B前者数据传送的实时性好

C前者使用6芯电缆，体积小

D前者不具有热插拔能力

13下面陈述中，不属于虚存机制要解决的问题项是（）。

A调度问题

B地址映射问题

C替换与更新问题

D扩大物理主存的存储容量和字长

14进程从运行状态转入就绪状态的可能原因是（）。

A被选中占有处理机时间

B等待某一事件发生

C等待的事件已发生

D时间片已用完

15安腾处理机的一组指令中，可以并行执行的指令是（）。

AId8r1=[r3]Baddr6=r8,r9

CSUBr3=r1,r4Daddr5=r3,r7

1计算机系统的层次结构从下至上可分为五级，即微程序设计级（或逻辑电路级）、一般机器级、操作系统级、（）级、（）级。

2十进制数在计算机内有两种表示形式：

（）形式和（）形式。

前者主要用在非数值计算的应用领域，后者用于直接完成十进制数的算术运算。

3一个定点数由符号位和数值域两部分组成。

按小数点位置不同，定点数有（）和（）两种表示方法。

4对存储器的要求是容量大、速度快、成本低，为了解决这三方面的矛盾，计算机采用多级存储体系结构，即（）、（）、（）。

5高级的DRAM芯片增强了基本DRAM的功能，存取周期缩短至20ns以下。

举出三种高级DRAM芯片，它们是（）、（）、（）。

6一个较完善的指令系统，应当有（）、（）、（）、（）四大类指令。

7机器指令对四种类型的数据进行操作。

这四种数据类型包括（）型数据、（）型数据、（）型数据、（）型数据。

8CPU中保存当前正在执行的指令的寄存器是（），指示下一条指令地址的寄存器是（），保存算术逻辑运算结果的寄存器是（）和（）。

9虚存系统中，通常采用页表保护、段表保护和键保护以实现（）保护。

10安腾体系结构采用分支推断技术，将传统的（）分支结构转变为无分支的（）代码，避免了错误预测分支而付出的代价。

1PCI总线中三种桥的名称是什么？

简述其功能。

2安腾处理机采用的6种增强并行性功能的技术措施是什么？

四、证明题（12分）

设|x|﹤（2n-1），|y|﹤（2n-1），|x+y|﹤（2n-1）

求证：

[x]

补+[y]

补=[x+y]

补（mod2n+1）

五、计算题（10分）

设存储器容量为64M字，字长为64位，模块数m=8，分别用顺序和交叉方式进行组织。

存储周期T=100ns，数据总线宽度为64位，总线传送周期t=50ns。

求：

顺序存储器和交叉存储器的带宽各是多少？

六、分析题（12分）

一种二进制RS型32位的指令结构如下：

其中OP为操作码字段，X为寻址模式字段，D为偏移量字段，其寻址模式定义为有效地址E算法及说明列表如下：

据写入到以（R2）为地址的数存单元中。

请画出该存数指令周期流程图，并在CPU周期框外写出所需的微操作控制信号。

（一个CPU周期含T

1～T

4四个时钟信号，寄存器打入信号必须注明时钟序号）

请写出6种寻址方式的名称。

七、设计题（15分）

CPU的数据通路如图1所示。

运算器中R

3为通用寄存器，DR为数据缓冲寄存器，PSW为状态字寄存器。

D-cache为数据存储器，I-cache为指令存储器，PC为程序计数器（具有加1功能），IR为指令寄存器。

单线箭头信号均为微操作控制信号（电位或脉冲），如LR

0表示读出R

0寄存器，SR

0表示写入R

0寄存器。

机器指令“LDA（R3）,R0”实现的功能是：

以（R3）的内容为数存单元地址，读出数存该单元中数据至通用寄存器R0中。

请画出该取数指令周期流程图，并在CPU周期框外写出所需的微操作控制信号。

（一个CPU周期有T

本科生期末试卷（五）

1某机字长64位，1位符号位，63位表示尾数，若用定点整数表示，则最大正整数位（）。

A+（263-1）B+（264-1）C-（263-1）D-（264-1）

2请从下面浮点运算器中的描述中选出两个描述正确的句子（）。

A浮点运算器可用两个松散连接的定点运算部件一阶码和尾数部件来实现。