DXP实训报告Word格式文档下载.docx

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General-PurposeSingleBipolarTimer

DIP-8

NE555N

上表列出的是电路图所需要元器件的所有封装，其中C1和C3都选择了CAPPR2-5x6.8型号的封装，其他的电容封装都选择了RAD-0.1型号的封装，DS1到DS56都选择了CAPPR2-5x6.8型号的封装，这可以看出不同的元器件可以用相同的封装，对于各种元器件的封装，我们要选择恰当，才能更好的布局，元器件的封装的选择不仅影响布局而且还影响布线，从而影响整个PCB板的设计，所以在选择封装时要慎重考虑好影响整个PCB板的主要因素，为制作良好的PCB板做铺垫。

三、ERC与网络表

ERC电路规则检查没有错误，所以整个电路图是没有错；

网络表是检查电路图有没有封装和漏接线的工具，生成网络表如下图所示：

[

]

RPot

R12

R11

R10

DS56

DS55

DS54

DS53

DS52

DS51

DS50

DS49

DS48

DS47

DS46

DS45

DS44

DS43

DS42

DS41

DS40

DS39

DS38

DS37

DS36

DS35

DS34

DS33

DS32

DS31

DS30

DS29

DS28

DS27

DS26

DS25

DS24

DS23

DS22

DS21

DS20

DS19

DS18

DS17

DS16

DS15

DS14

DS13

DS12

DS11

DS10

DS9

DS8

DS7

DS6

DS5

DS4

DS3

DS2

DS1

（

+5V

R10-2

R11-2

U1-1

U1-2

U1-14

U2-4

U2-8

）

NetR12_2

R12-2

U1-8

NetR12_1

R12-1

U2-3

NetR11_1

U2-7

R11-1

RP1-1

NetR8_2

R9-1

R8-2

NetR8_1

R8-1

U1-13

NetR7_1

R7-1

U1-12

NetR6_1

R6-1

U1-11

NetR5_1

R5-1

U1-10

NetR4_2

R4-2

U1-6

NetR3_2

R3-2

U1-5

NetR2_2

R2-2

U1-4

NetR1_2

R1-2

U1-3

NetQ8_2

Q8-2

R9-2

NetQ8_1

Q8-1

R10-1

U1-9

NetQ7_2

R7-2

Q7-2

NetQ6_2

Q6-2

R6-2

NetQ5_2

R5-2

Q5-2

NetQ4_2

R4-1

Q4-2

NetQ3_2

R3-1

Q3-2

NetQ2_2

R2-1

Q2-2

NetQ1_2

R1-1

Q1-2

NetDS55_1

DS55-1

DS56-2

NetDS54_1

DS54-1

DS55-2

NetDS53_1

DS53-1

DS54-2

NetDS50_1

DS51-2

DS50-1

NetDS49_2

DS49-2

DS53-2

Q7-1

NetDS49_1

DS49-1

DS50-2

NetDS47_1

DS47-1

DS48-2

NetDS46_1

DS46-1

DS47-2

NetDS45_1

DS45-1

DS46-2

NetDS43_1

DS43-1

DS44-2

NetDS42_1

DS42-1

DS43-2

NetDS41_2

Q6-1

DS41-2

DS45-2

NetDS41_1

DS41-1

DS42-2

NetDS39_1

DS39-1

DS40-2

NetDS38_1

DS38-1

DS39-2

NetDS37_1

DS37-1

DS38-2

NetDS35_1

DS35-1

DS36-2

NetDS34_1

DS34-1

DS35-2

NetDS33_2

Q5-1

DS33-2

DS37-2

NetDS33_1

DS33-1

DS34-2

NetDS31_1

DS31-1

DS32-2

NetDS30_1

DS30-1

DS31-2

NetDS29_1

DS29-1

DS30-2

NetDS27_1

DS27-1

DS28-2

NetDS26_1

DS26-1

DS27-2

NetDS25_2

Q4-1

DS25-2

DS29-2

NetDS25_1

DS25-1

DS26-2

NetDS23_1

DS23-1

DS24-2

NetDS22_1

DS22-1

DS23-2

NetDS21_1

DS21-1

DS22-2

NetDS19_1

DS19-1

DS20-2

NetDS18_1

DS18-1

DS19-2

NetDS17_2

Q3-1

DS17-2

DS21-2

NetDS17_1

DS17-1

DS18-2

NetDS15_1

DS15-1

DS16-2

NetDS14_1

DS14-1

DS15-2

NetDS13_1

DS13-1

DS14-2

NetDS11_1

DS11-1

DS12-2

NetDS10_1

DS10-1

DS11-2

NetDS9_2

Q2-1

DS9-2

DS13-2

NetDS9_1

DS9-1

DS10-2

NetDS7_1

DS7-1

DS8-2

NetDS6_1

DS6-1

DS7-2

NetDS5_1

DS5-1

DS6-2

NetDS3_1

DS3-1

DS4-2

NetDS2_1

DS2-1

DS3-2

NetDS1_2

Q1-1

DS1-2

DS5-2

NetDS1_1

DS1-1

DS2-2

NetC1_1

C1-1

U2-6

U2-2

RP1-2

RP1-3

GND

Q6-3

C1-2

Q8-3

U2-1

U1-7

Q5-3

Q1-3

Q2-3

Q3-3

Q4-3

Q7-3

+12V

DS52-1

DS4-1

DS8-1

DS12-1

DS16-1

DS20-1

DS24-1

DS28-1

DS32-1

DS36-1

DS40-1

DS44-1

DS48-1

DS56-1

NetDS51_1

DS52-2

DS51-1

四、PCB板制作与工艺设计

1、画电路图

2、生成网络表

3、布局

4、布线

5、覆铜

6、画PCB板尺寸

7、设计规则检查

五、各种报表的生成

1、DRC规则表

ProtelDesignSystemDesignRuleCheck

PCBFile:

\PCB\J\²

\PCB1.PcbDoc

Date:

2013/5/27

Time:

19:

37:

ProcessingRule:

WidthConstraint（Min=60mil）（Max=100mil）（Preferred=60mil）（InNet（'

+12V'

））

RuleViolations:

GND'

+5V'

HoleSizeConstraint（Min=1mil）（Max=500mil）（All）

HeightConstraint（Min=0mil）（Max=1000mil）（Prefered=500mil）（All）

WidthConstraint（Min=30mil）（Max=50mil）（Preferred=40mil）（All）

ClearanceConstraint（Gap=15mil）（All）,（All）

Broken-NetConstraint（（All））

Short-CircuitConstraint（Allowed=No）（All）,（All）

ViolationsDetected:

TimeElapsed:

00:

六、PCB各层面输出与打印

顶层:

底层:

各层叠印效果：

丝印层：

3D效果图

七、总结

实训就是实践，一周的PCB实训使我们更加对Protel2004软件能更加熟悉。

实训期间，对平时课上所学的进行了一个系统的学习，将其联系在了一起。

对于彩灯控制电路的设计过程中，进行了元件的编辑，元件的设计与封装，以及最后的PCB图的制作，布线等等。

在这些操作中，我们更加了解到了细心的含义，一时的大意都可能导致很大的错误。

在整个对彩灯控制电路的设计过程中，我认为最难操作的应该是最后的PCB图，在对其元件进行放置中，既要注意元件在整个主电路图中的位置，又要在乎在布线时期的简洁和清晰程度，整块设计版成型时是否美观。

同样手工布线清晰明了，布线完成时要仔细检查。

虽然经过一段很复杂的过程，但当最后看见自己一周的成果，真的存在一种喜悦。

我建议学校多提供一些实训，提高大学生自己动手的能力，加强对社会中的适应能力。

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