pci总线与初始化Word格式文档下载.docx
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基地址寄放器#1
18H:
基地址寄放器#2
1CH:
基地址寄放器#3
20H:
基地址寄放器#4
24H:
基地址寄放器#5
28H：
PCMCIA（笔记本电脑）的卡总线结构指针器
2CH：
子系统与版本标识码
30H：
PCI总线局部扩充ROM基地址
34H：
新增能力指针
38H：
保留
3CH：
主（控）设备要求和中断输入配置寄放器
3．配置初始化程序说明
四、PCI总线信号的选用
1．信号表
2．说明
五、补充说明
1．PCI总线引脚信号图TS—三态，STS—维持三态，OC—集电极开路
地址时命令
数据时字节选择
在IDSEL
有效时
用I/O
CFCH写
PRSN1
PRSN2
B11
支持引脚
B9
不设高缓时不连引脚
64位操作
边界扫描
测试
从设备:
无
先地址，后数据
总线对请求的应答GNT
从设备
仅输入
高速缓存
主控设备对总线请求REQ
C
P
U
与
主
板
总
线
桥
路
设备（空间）选中DESEL#
配置寄存器空间选中IDSEL
PCI
总线
设备
主控
或
从控
插槽
总线命令/字节选择C/BE3:
0#
地址/数据AD31:
0*
奇偶校验位PAR：
分地址、数据阶段两个
帧FRAME#（传送有效周期）
目标准备好TRDY#
源准备好TRDY#
目标要求停止传送STOP#
（传送完成或意外）
一般是设备所在空间的最高几位译码
由桥路配置寄存器设备配置空间选择决定
总线CLK
复位RST#
锁定操作LOCK
（可执行的程序存贮器必须用）
中断请求INTA、B、C、D
由AD31:
0与C/BE3:
0的各位异或而生成
B9,11=11
槽上无卡
否则有卡
但供电功率，电流
不同
I/OTS
从设备仅输入
OUTSTS
从设备仅输出
64个字节
设备配置
寄存器
奇偶校验错误PERR#（数据）
仅输出
与数据阶段的PAR相关
OCSTS
系统错误SERR#（地址）
与地址阶段的PAR相关
内有
桥路配置
I/OCF8H写：
以设置设备配置寄存器的空间选择IDSEL和地址
试探返回SB0#与探测完成SDONE
AD63:
32，C/BE7:
4，奇偶校位PAR64，
主控请求REQ64，目标对请求应答ACK64
串行数据人出TDI，TDO，时钟TCLK
操作允许TMS，复位TRST
不用JTAG时不连引脚
仅TDO输出，其它入
C3:
0命令
0000中断隐含读中断字
0001特殊周期操作
1100存贮器重复读
大块传送用
1101双地址周期
64位寻址用
其它保留
有关问题：
1）PCI插槽和ISA插槽信号连接最大不同：
各ISA插槽脚同名信号是相连的，而同总线号上的PCI插槽同名信号中有的是各自独立的，如中断A-D,,IDSEL,REQ,GNT等.。
不同总线号上的PCI插槽同名信号全部不连。
2）新版中，高速缓存支持取消，增加电源管
理信号PME，.
0010I/O读
0011I/O写
1010配置I/O读
1011配置I/O写
0110存贮器读
0111存贮器写
1110cache读
1111cache写
存贮器读写常要含
cache读写
存贮器宽32位16位8位
字BE3D31:
24D15:
8（BHE）不用
节BE2D23:
16不用不用
允BE1D15:
8=A1=A1
许BE0D7:
0D7:
0=A0
2．PCI总线的特点及其插卡设计注意点（依照PCI标准版本）
※PCI总线速度
PCI总线CLK周期在33MHz为30ns、66MHz为15ns。
猝发Burst方式下，在FRAME有效，源IRDY、目TRDY有效下，每一个周期可传送一个长字，因此，理论最大传送速度速度为132M/262M（32bit）或264M/524M（64bit）字节。
其中目标预备好TRDY所需等待周期与目标（如存贮器）速度相关，若是存贮器（或设备）的读周期+读出数据返回CPU时刻，小于CLK周期，那么必需利用TRDY信号；
源预备好IRDY，除与主存速度有关，还与更高级操作、主存刷新、时钟中断等有关。
另外程序中的一次持续的读或写操作，也会因更高级操作请求、主存刷新、时钟中断等而分假设干次。
因此，实际速度要比理论小许多。
所有信号的采样都要在总线CLK的上升沿进行。
PCI总线和ISA总线在信号利用上最大的不同是：
ISA总线信号在逻辑设计中是直接连接利用，而PCI总线信号必需按时序要求寄放、译码、组合产生所需的新信号来利用,而不能直接利用。
下面将表达到那个问题。
※复用信号与寄放、组合
1）PCI总线地址、数据ADi共点复用，分地址和数据周期传送，i最大64位。
因此，不管是配置操作，仍是通常操作，目标必需在FRAME有效后的第一个周期即地址周期寄放地址（配置操作实际是设备功能号和配置寄放器地址）及和设备总基地址空间一致的高位地址译码即设备选中DEVSEL，并维持到FRAME无效后的最后一个传送终止。
注意，在总线每次对目标读第一数时，多一个转换周期。
对数据是不是要寄放,要紧取决于目标是不是需要。
2）总线传送方式与类型命令和数据宽度（字节数）C/BEi共点复用，因此，目标必需在FRAME有效后的第一个周期寄放命令码，并维持到FRAME无效后的最后一个传送终止。
寄放的命令码必需与CLK、FRAME、DEVSEL（配置用IDSEL）、IRDY、TRDY等组合形成对目标（如存贮器或设备配置寄放器等）的读令或写令、片选、许诺等，通常利用读或写令的后沿对Burst猝发用地址计数器加1。
当目标不利用高速缓冲存贮命令时，要将其看成一样存贮器命令处置。
猝发地址顺序为线性增加（AD0=AD1=0）。
设备选中DEVSEL#信号是目标回答系统主设备（如CPU等）目标设备所用被分派的空间已选中（现行地址基地址部份和和基地址寄放器比较相等信号），在返送PCI总线时,必需”或”上经延迟的配置空间选中IDSEL,以操纵配置数据的读/写和向PCI总线操纵器桥路作应答，DEVSEL#信号必需在FRAME有效后的第7个周期前有效，不然被以为总线（该插槽上）无实际目标设备（系统桥路检测按时如此约定）。
配置空间选中IDSEL是读写配置寄放器选中信号，同时的FRAME有效时的地址周期，AD7:
2为配置寄放器地址（如有设备号必需包括设备号地址部份）,AD1:
0必需为0,命令周期C3:
0是读/写（1010/1011）命令。
若是配置读00单元长字为全“1”，以为总线（该插槽上）无目标设备（系统BIOS如此约定）。
※PCI总线传送类型
1）PCI总线的大体传送是高速的Burst即猝发性操作，其不直接支持DMA传送方式。
总线的主桥路可自动将处置器对存贮器的持续双字及其以上的读或写传送归并到一个猝发传送中去，且对一个持续的数据段，只发其首地址，因此在猝发操作时目标不仅要寄放首地址，还必需在每一个数据传送完即进行地址加1。
除猝发操作外，也可进行单个的操作。
2）除通常的存贮器、I/O、配置访问的猝发或单个读、写传送外，还有快速背对背，锁定操作（适时要求）、高速缓存型等，对设计的目标如插卡来讲，又有主动、从动之分。
详见PCI标准版本。
注：
背对背传送是一种不利用CPU指令即数据传送不通过CPU寄放器（但通过PCI桥路）的快速传送。
许多设备有的可能同处在一PCI插槽上，也可能在不同的PCI插槽上，还有可能在不同总线号上的PCI插槽上，也还有可能是同一或不同总线号上的嵌入设备，这些设备中的任意两个设备间的数据直接互换，或PCI插槽上主设备或与主存贮器数据的直接互换，都属于这种传送，很类似DMA。
但两个设备中至少必需有一个具有主控功能，且在利用总线上，不可与其它的传送产生竞争或冲突，这就要进行仲裁。
3）PCI总线在传送中支持予取功能，若是目标设备具有予取的FIFO缓冲和操纵，并在配置寄放器配置该功能位。
4）终止传送：
CPU总线主控、目标都能够终止传送。
主控终止缘故之一是完成传
送，之二是CPU及其总线主桥路所限定的时刻溢出或故障PERR、SERR；
目标（如插卡）终止缘故是其处于不能即时应答或不能处置传送的状态，或具有传送长度计数器是最后一次，现在必需向总线发出停止信号STOP，并维持到FRAME终止。
5）传送时序，请参照PCI局部总线标准版
在利用PCI接口芯片PLX9052等或相应的核core时，要紧考虑的是目标预备好和目标的最后一次传送。
PCI接口芯片PLX9052等或相应的核core，将专门表达。
※错误检测功能
PCI总线错误反映功能较强，在地址周期，不论主、从都可检查发生的地址奇偶校验错误；
在数据传送期间，主控反映读数据奇偶校验错误，从动目标反映写入数据奇偶校验错误。
配置传送也一样如此。
参与总的奇偶校验的信号除ADi外，还包括C/BEi及总线奇偶校验信号PAR，其产生的奇偶校验结果，偶数个“1”正确，奇数个“1”错误。
在地址周期，奇数个“1”的错误，将在下一个CLK生成总线报系统错误信号SERR；
在写数据传送期间，从动目标校出的奇数个“1”的错误时，于下一个CLK生成总线数据错误信号PERR；
SERR、PERR都维持到FRAME终止后一个周期；
在读数据传送期间，从动目标仅校验Adi、C/BEi，（PAR不参与校验逻辑）
所产生的校验信号即总线信号PAR。
通常对设计从控性的插卡，能够不考虑PERR、SERR，但被读时，必需产生的校验信号位PAR，不然总线主桥路校验必产生错误，致使插卡无法工作。
除非在配置寄放器设置不许诺。
※电源治理功能
PCI插卡上电源治理是新增功能，通过PME，，PRSN1（B9）、PRSN2信号和相关的专门配置寄放器和新能力指针实现，操纵包括供电的电流（功率）、电压、热拔插、节电与低功耗方法等。
专门配置寄放器，由BIOS中嵌入的中断路由表确信，在F0000-FFFFFH以“$PIR”字符串开始，偏移地址32字节。
（PCI系统结构C-134页）。
插槽的识别号由新能力指针指向的配置空间ID=04H。
※PCI总线的级联
通过主/PCI、PCI-PCI等桥路，可实现多PCI总线级联（串、并）的各类拓扑结构。
总线号最多可达256个。
如多CPU的工作站确实是PCI总线级联结构。
目前典型的PC结构是
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