计算机组成原理白中英本科生试题库整理附答案_精品文档Word文件下载.doc
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5常用的虚拟存储系统由（B）两级存储器组成，其中辅存是大容量的磁表面存储器。
cache-主存
主存-辅存
cache-辅存
通用寄存器-cache
6RISC访内指令中，操作数的物理位置一般安排在（D）
栈顶和次栈顶
两个主存单元
一个主存单元和一个通用寄存器
两个通用寄存器
7当前的CPU由（B）组成。
控制器
控制器、运算器、cache
运算器、主存
控制器、ALU、主存
8流水CPU是由一系列叫做“段”的处理部件组成。
和具备m个并行部件的CPU相比，一个m段流水CPU的吞吐能力是（A
）。
具备同等水平
不具备同等水平
小于前者
大于前者
9在集中式总线仲裁中，（A）方式响应时间最快。
独立请求
计数器定时查询
菊花链
分布式仲裁
10CPU中跟踪指令后继地址的寄存器是（C
地址寄存器
指令计数器
程序计数器
指令寄存器
11从信息流的传输速度来看，（A）系统工作效率最低。
单总线
双总线
三总线
多总线
12单级中断系统中，CPU一旦响应中断，立即关闭（C）标志，以防止本次中断服务结束前同级的其他中断源产生另一次中断进行干扰。
中断允许
中断请求
中断屏蔽
DMA请求
13下面操作中应该由特权指令完成的是（B）。
设置定时器的初值
从用户模式切换到管理员模式
开定时器中断
关中断
14冯·
诺依曼机工作的基本方式的特点是（B
多指令流单数据流
按地址访问并顺序执行指令
堆栈操作
存贮器按内容选择地址
15在机器数（B
）中，零的表示形式是唯一的。
原码
补码
移码
反码
16在定点二进制运算器中，减法运算一般通过（
D）来实现。
原码运算的二进制减法器
补码运算的二进制减法器
原码运算的十进制加法器
补码运算的二进制加法器
17某计算机字长32位，其存储容量为256MB，若按单字编址，它的寻址范围是（
D）。
0—64MB
0—32MB
0—32M
0—64M
18主存贮器和CPU之间增加cache的目的是（A
解决CPU和主存之间的速度匹配问题
扩大主存贮器容量
扩大CPU中通用寄存器的数量
既扩大主存贮器容量，又扩大CPU中通用寄存器的数量
19单地址指令中为了完成两个数的算术运算，除地址码指明的一个操作数外，另一个常需采用（
C）。
堆栈寻址方式
立即寻址方式
隐含寻址方式
间接寻址方式
20同步控制是（
只适用于CPU控制的方式
只适用于外围设备控制的方式
由统一时序信号控制的方式
所有指令执行时间都相同的方式
21描述PCI总线中基本概念不正确的句子是（CD
PCI总线是一个与处理器无关的高速外围设备
PCI总线的基本传输机制是猝发式传送
PCI设备一定是主设备
系统中只允许有一条PCI总线
22CRT的分辨率为1024×
1024像素，像素的颜色数为256，则刷新存储器的容量为（
B）
512KB
1MB
256KB
2MB
23为了便于实现多级中断，保存现场信息最有效的办法是采用（
B）。
通用寄存器
堆栈
存储器
外存
24特权指令是由（C
）执行的机器指令。
中断程序
用户程序
操作系统核心程序
I/O程序
25虚拟存储技术主要解决存储器的（
B）问题。
速度
扩大存储容量
成本
前三者兼顾
26引入多道程序的目的在于（
A）。
充分利用CPU，减少等待CPU时间
提高实时响应速度
有利于代码共享，减少主辅存信息交换量
充分利用存储器
27下列数中最小的数是（C
）
（101001）2
（52）8
（101001）BCD
（233）16
28某DRAM芯片，其存储容量为512×
8位，该芯片的地址线和数据线的数目是（
8，512
512，8
18，8
19，8
29在下面描述的汇编语言基本概念中，不正确的表述是（
对程序员的训练要求来说，需要硬件知识
汇编语言对机器的依赖性高
用汇编语言编写程序的难度比高级语言小
汇编语言编写的程序执行速度比高级语言慢
30交叉存储器实质上是一种多模块存储器，它用（
A）方式执行多个独立的读写操作。
流水
资源重复
顺序
资源共享
31寄存器间接寻址方式中，操作数在（B
主存单元
堆栈
32机器指令与微指令之间的关系是（
用若干条微指令实现一条机器指令
用若干条机器指令实现一条微指令
用一条微指令实现一条机器指令
用一条机器指令实现一条微指令
33描述多媒体CPU基本概念中，不正确的是（
CD）。
多媒体CPU是带有MMX技术的处理器
MMX是一种多媒体扩展结构
MMX指令集是一种多指令流多数据流的并行处理指令
多媒体CPU是以超标量结构为基础的CISC机器
34在集中式总线仲裁中，（A
）方式对电路故障最敏感。
菊花链
计数器定时查询
35流水线中造成控制相关的原因是执行（
A）指令而引起。
条件转移
访内
算逻
无条件转移
36PCI总线是一个高带宽且与处理器无关的标准总线。
下面描述中不正确的是（
采用同步定时协议
采用分布式仲裁策略
具有自动配置能力
适合于低成本的小系统
37下面陈述中，不属于外围设备三个基本组成部分的是（
存储介质
驱动装置
控制电路
计数器
38中断处理过程中，（B
）项是由硬件完成。
关中断
开中断
保存CPU现场
恢复CPU现场
39IEEE1394是一种高速串行I/O标准接口。
以下选项中，（
D）项不属于IEEE1394的协议集。
业务层
链路层
物理层
串行总线管理
40运算器的核心功能部件是（B
数据总线
ALU
状态条件寄存器
通用寄存器
41某单片机字长32位，其存储容量为4MB。
若按字编址，它的寻址范围是（A
1M
4MB
4M
1MB
42某SRAM芯片，其容量为1M×
8位，除电源和接地端外，控制端有E和R/W#，该芯片的管脚引出线数目是（
20
28
30
32
43双端口存储器所以能进行高速读/写操作，是因为采用（
高速芯片
新型器件
流水技术
两套相互独立的读写电路
44单地址指令中为了完成两个数的算术运算，除地址码指明的一个操作数以外，另一个数常需采用（
45为确定下一条微指令的地址，通常采用断定方式，其基本思想是（
用程序计数器PC来产生后继微指令地址
用微程序计数器µ
PC来产生后继微指令地址
通过微指令顺序控制字段由设计者指定或由设计者指定的判别字段控制产生后继微指令地址
通过指令中指定一个专门字段来控制产生后继微指令地址
二、填空题
1
字符信息是符号数据，属于处理（
非数值）领域的问题，国际上采用的字符系统是七单位的（ASCII）码。
P23
2
按IEEE754标准，一个32位浮点数由符号位S（1位）、阶码E（8位）、尾数M（23位）三个域组成。
其中阶码E的值等于指数的真值（
e）加上一个固定的偏移值（
127）。
P17
3
双端口存储器和多模块交叉存储器属于并行存储器结构，其中前者采用（
空间）并行技术，后者采用（
时间）并行技术。
P86
4衡量总线性能的重要指标是（
总线带宽），它定义为总线本身所能达到的最高传输速率，单位是兆字节每秒（
MB/s）。
P186
5
在计算机术语中，将ALU控制器和（cache）存储器合在一起称为（CPU）。
P139
6
数的真值变成机器码可采用原码表示法，反码表示法，（
补码）表示法，（
移码）表示法。
P19-P21
7
广泛使用的（
SRAM）和（
DRAM）都是半导体随机读写存储器。
前者的速度比后者快，但集成度不如后者高。
P66
8
反映主存速度指标的三个术语是存取时间、（存储周期）和（存储器带宽）。
9
形成指令地址的方法称为指令寻址，通常是（顺序）寻址，遇到转移指令时（跳跃）寻址。
P123
10
CPU从（主存中）取出一条指令并执行这条指令的时间和称为（指令周期）。
11定点32位字长的字，采用2的补码形式表示时，一个字所能表示的整数范围是（
-2的31次方到2的31次方减1）。
P20
12IEEE754标准规定的64位浮点数格式中，符号位为1位，阶码为11位，尾数为52位，则它能表示的最大规格化正数为（
+［1+（1-）］）。
P18？
？
13浮点加、减法运算的步骤是（0操作处理
）、（比较阶码大小并完成对阶）、（
尾数进行加或减运算）、（结果规格化并进行舍入处理
）、（溢出处理
P52
14某计算机字长32位，其存储容量为64MB，若按字编址，它的存储系统的地址线至少需要（14）条。
KB=2048KB（寻址范围）=20482
15一个组相联映射的Cache，有128块，每组4块，主存共有16384块，每块64个字，则主存地址共（20
）位，其中主存字块标记应为（
8）位，组地址应为（
6）位，Cache地址共（
7）位。
=16384字2=
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