数字频率计的方案设计书与实现Word文档下载推荐.docx

1、1. 引言数字频率计是一种基础测量仪器，在许多情况下，要对信号的频率进行测量，利用示波器可以粗略测量被测信号的频率，精确测量则要用到数字频率计。 本设计项目可以进一步加深我们对数字电路应用技术方面的了解与认识，进一步熟悉数字电路系统设计与调试的方法和步骤。2设计任务书1、设计题目：数字频率计2、设计出一个数字频率计，其技术指标如下：（ 1 ）频率测量范围： 10 9999Hz 。（ 2 ）输入电压幅度 300mV 。（ 3 ）输入信号波形：任意周期信号。（ 4 ）显示方式：4位十进制数显示。（ 5 ）电源： 220V 、 50Hz 。3、给定仪器设备及元器件示波器、音频信号发生器、逻辑笔、万用

2、表、数字集成电路测试仪、直流稳压电源。4电路原理要求简单，便于制作调试，元件成本低廉易购。3. 数字频率计基本原理3.1 设计思路（1）利用光电开关管做电机转速的信号拾取元件，在电机的转轴上安装一圆盘，在圆盘上挖一小洞，小洞上下分别对应着光发射和光接受开关，圆盘转动一圈既光电管导通一次，利用此信号做为脉冲计数所需。（2）计数脉冲通过计数电路进行有效的计数，按照设计要求每一秒种都必须对计数器清零一次，因为电路实行秒更新，所以计数器到译码电路之间有锁存电路，在计数器进行计数的过程中对上一次的数据进行锁存显示，这样做不仅解决了数码显示的逻辑混乱，而且避免了数码显示的闪烁问题。（3）对于脉冲记数，有测

3、周和测频的方式。测周电路的测量精度主要受电路系统的脉冲产生电路的影响，对于低频率信号，其精度较高。测频电路其对于正负一的信号差比较敏感，对于低频率信号的测量误差较大，但是本电路仍然采用测频方式，原因是本电路对于马达电机转速精度要求较低，本电路还有升级为频率计使用，而测频方式对高频的精度还是很高的。时钟实现方法很多，本电路采用晶振电路，已求得高精度的时钟需求。3.2 原理框图 图3-1 系统框图4. 设计步骤及实现方法4.1 信号拾取与整形图4-1 信号拾取基本原理图电路核心由一个光电开关管组成，平时电机转轮静止，发光二极管所发出的光被 轮子挡住，所以接收管处于截止状态，1端为高电平。当电机转动

4、一圈 ，会使接收管导通一次，1端输出一个低电平，1端波形在实际电机工作状态中，会受到各方面的干扰，波形会存在许多杂波成分，需要 对波形进行处理，处理成符合记计数器所需要的矩型波。波形处理电路有一个施密特触发器组成，如上图。当输入电压逐步升高时，致使 VI施密特上VT+，内部触发器发生翻转。当VI逐步下降时，致使 VIVT-。所以只要VIVT+电路就稳定在高电平，这样就 有效的防止了杂波的干扰，并使输出得到矩形脉冲，符合了下级计数的需求。本施密特触发器选用40106，管脚如下，可 以看出内部含有六路同样的施密特触发器，我们只使用其中一组，图4-3 本施密特触发器选用40106管脚4.2 计数电路

5、本电路采用四个同步计数器接成串行工作方式，查数字电路产品资料后，准备采用CD4518，管脚如下图，该IC是一种同步加数器，在一个封装中含有两个可互换二/十进制计数器，其功能引脚分别是和。该计数器是单路系列脉冲输入（1或2脚；9或10脚），4路BCD码输出（36脚；1114脚）。其工作波形如下： 图 4-4 图4-5从4518应用手册给出的真值表看出 ，CD4518有两个时钟输入端CP和EN（ENABLE A或B），若用时钟上升沿触发，信 号从CP 端输入，此时EN端接高电平“1”，若用时钟下降沿触发，信号从EN端输入，此时 CP端应 接低电平“0”，不仅如此，清零端（RESET）也应该保持低电

6、平“0”，只有满足了这些条件，电路才会处于计数状态。 图4-6我们还从真值表里可以得出，利用EN端下降沿触发的特点组成N位十进制计数器。从波形分析，当输入端的计数脉冲到第10个时，电路自动复位0000状态，因为4518没有进位功能的引脚，所以应该充分利用第6或14脚输出脉冲的下降沿，利用该脉冲和EN端相连，就可以实现电路进位的功能，根据分析结果，电路设计如下： 图4-74.3锁存电路锁存集成有电平和边沿触发之分，设计时要充分考虑进去，内部构造大都采用D触发器形式，使用电平或者脉冲方式来触发。而从前面的分析看，本次设计的锁存电路必须采用边沿触发方式的集成电路来实现，因为假如采用电平方式的话，那么

7、在秒脉冲的正半周（既高电平）会使锁存器一直处于导通状态，不能正常显示测量值。因此采用边沿触发就可以在极短的时间内将所需要的数据进行传送，而在其它时间内处于封闭状态。查阅数据集成资料并，发现8D锁存器74LS324正适合要求，这款集成多在计算机电路中运用，而且容易购买，此集成为20脚封装，内部有8个D锁存器，采用两个这样的集成便可以实现4位10进制的的数据传输，它以上升沿作为CP端（即CLK）的有效触发，将8个D输入同时打到输出Q端，在输出端加有三态驱动，其内部其管脚排列如下右图，内部构造（单个D触发器）如下右图 图4-7 图4-8从此集成参数和真值表（如下），在其 （1） 脚使能端加上低电平才

8、能有效得使输出端得到所需的数据，其他状态不传送数据 ，也可从上图分析此（1）脚是控制三态门的，相当于电路的通断开关，只 有接低电平，电路才能正常工作。 图 4-9 4.4 译码显示电路市场上比较多见数码显示器件是LED数码管，它有亮度高、售价低等特点，非常适 合本电路制作。数码管的外形尺寸和内部构造如图所示， 图4-11 图4-12主要参数如下：1.6V4.2V；功耗400mW，工作电流10mA；分共阳共阴两种极性，本电路选用共阴。其引脚按顶视图的（1）脚开始，顺时针读数，（3）脚和（8）脚为公共脚 ，其中（5）脚为小数点，本电路不做连接。引脚分别如下： 图4 -13根据管脚分布和译码参数及管

9、脚分布，电路设计如下： 图4-15 电路图 4.5 时钟电路及波形设计根据以上各电路功能模块的需求，时钟电路总共需要产生两路输出信号，一路是频率为1秒的标准矩形脉冲，利用其上沿对锁存器进行锁存，另一路是计数器的清零脉冲，要求脉冲宽度250ns才可以有效得将计数器清零，频率仍然是1秒。 各部分设计如下：1） 时钟产生电路 时钟产生方式很多，可以由各种门电路，环谐振电路，也可以由触发器、555集成 构成，谐振可以是电容，晶体。为了电路调试方便，综合条件，采用CMOS集成加晶 振，晶振采用平常较为多见的时钟晶振，谐振频率为32.786k。查阅数据集成资料 ，发现CD4046符合各方面的要求，它内部含

10、有14级的二进制串行计数器，可以进 行214分频，32.768k谐振频率经过内部14级计数器 214=16372分频后可以得到2HZ的精确频率。现在所需要的1秒的时钟，因此2HZ的 脉冲需在经过一个二分频电路就可以输出准确1秒脉冲。左图便是CD4060的应用接线图，（11）和（10）脚内部电路和外围组成典型的石英晶体门振荡电路，产生32.678KHZ的频率信号进入14级计数器后，在3脚输出2HZ的频率方波。C1和C2做频率微调，输出频率主要取决于石英晶体。 图 4-16对于2HZ的方波仍然无法让电路正常工作，需要进行2分频才能产生1秒的时钟，因 此本电路设计一个JK触发器进行2分频，分频后的方

11、波可以直接用来控制锁存电路的 工作。本电路采用CD4027作为2分频的器件，其管脚分布为：从左图可知，内部含有两套相同的JK触发器，（1） 和（2）为输出端，（3）脚为前级时钟输入，（4）和（7）脚分别是更新和复位脚，本电路要将其接低电平，（5）和（6）脚为JK端，需接高电平。从（1）脚输出的信号既是所需要的1HZ方波。 图4-17 2） 单稳态设计从4027第（3）脚输出的方波仍然无法进行正常清零的工作，此脚需要接一单稳态 处理后才能进行清零。从前面的设计需求出发，单稳态电路输出的波形宽度至少要达到250ns 才能正常清零。查询有关集成库发现CD4528是一种双可重触发单稳态器件，它的管脚及

12、真值表 分别如下： 图 4-18CD4528里同样有两组单稳态电路，（1）和（2）是微分定时输入，（3）脚是 使能端，（4）和（5）组成与门电路，（5）脚与（4）脚反相，因为此电路只需要一只脚 输入端，我们使用（4）脚同相端输入，将（5）脚接高电平即可。（6）和（7）是输出端 。根据真值表，需要将第（3）脚即clear脚接高电平，电路接线如下：左图R3和C3组成微分定时，单稳态输出波形宽度为 =0.2*R3*C3*（VDD-VSS），本电路由10K和0.01UF组成，输出TW宽度为25us（标准值 ）,远远满足计数器所需要的250ns的时间宽度。2HZ信号从（4）脚输入，250ns方波从第6脚

13、输出至计数器清零端。 图4-19根据以上分析画出 时钟电路总接线图，如下所示： 图4-205 总体电路图及工作原理1）根据设计所需，列主要器件 清单：器件名称：用处及规格数量IC CD 40106整形1 CD4518计数2 74LS374锁存 CD4543译码4 CD4060时钟产生 CD40272分频 CD4528单稳态光电开关管晶振32.768kLED数码显示 表5-1除此外电容电组若干，供电电源等未列入清单。严格按所电路设计实施制作，力求一次成功。但在制作调试过程中仍遇到很大的 困难。调试过程记录如下：（a）数码显示错误测量电压发现数码段显示错误，比如目标显示5，而实际显示3，分别测量数

14、码管的 f端和 b端， 发现管脚在制作印刷电路板f脚和b脚换位，以至产生此错误，互换后正常。（b）数码显示高低位数错误这是在设计初期没有想到的问题，protel布线后出来应该是反面辅铜板的线路，在制作时就非常注意这个问题。 （c）无法更新显示也就是在脉冲的上沿到来时，锁存器没有被触发，无法传递数据。检查 CD4027 （1） 脚电压，发现没有秒脉冲，也就是说就没有高电平的上沿，当然锁存器也就无法得到触发脉冲。（d）时钟电路的调试借助于频率计对CD4060进行测量，为不影响振荡工作，应该选择适当的引 脚进行测量，最后选择在7端或者5端进行测量（7端标准频率为2048HZ， 5端为 1024HZ

15、）。微调可变电容C2，使7脚（或5脚）输出接近2048HZ（或1024HZ）。 元器件的检测与电路调试缺点分析 本电路具有测量精度高，调试制作简单等特点，但还存在许多不足之处有待改进 ：1. 本电路总共使用 12块集成，所以存在很大的亢余度，部分集成内部只用了1/6，造成浪费。如显示电路可以采用动态显示的方法，采用一体化的集成既译码锁存 计数为一体的集成。2对转速的测量单位为秒，因此就提供转速测量的功能来讲并不是最佳结果，应该 是以分为单位。7 心得体会从总体上来看，电路设计制作还是比较成功的，跟以往的制作相比，本次电路完全是在自己个人的思路下创作出来的，因此获得了很多的经验， 这次设计让我真正体会到了书本知识永远是基础，而基础正是你向高层次迈进的扎实阶梯，没有这个基础，就无法实现技术上的腾飞。在实践当中，灵活运用书 本上所讲的知识，万变不离其中，只有扎实掌握了核心的方法，才有可能做到活用巧用。参考文献1） 电子技术基础（数字部分），康华光，高等教育出版社，1998年2） 实用电子电路手册，高等教育出版社，1992年3） 新型集成器件实用电路，杨帮文，电子工业出版社，2002年4） 电子技术课程设计指导书，艾永乐、付子义，焦作工学院电气系，1998年