1、User：用户模式。绝大部分的任务执行都在这种操作模式下，此为正常的程序执行模式。FIQ：快速中断模式。支持数据传送或通道处理。IRQ：普通中断模式。用于一半中断处理。Supervisor：管理模式。一种操作系统受保护的方式。Abort：中止模式。在访问数据中止后或指令预取中止后进入中止方式。System：系统模式。是操作系统一种特权级的用户方式。Undef：未定义模式。当执行未定义指令时会进入这种操作模式。10. 当PCLK=66.5MHz时，选择不同的时钟分频（1/2、1/4、1/8、1/16）输入，分别计算定时器最小分辨率、最大分辨率及最大定时区间。最小分辨率：定时器输入时钟频率=值.5
2、/0+1/2=33.2500（MHz）一个计数脉冲时间=1/33.2500MHz=0.0300（us）最大分辨率：定时器输入时钟频率=PCLK/255+1/2=66.5/256/2=129.8828一个计数脉冲的时间=1/129.8828=7.6992（us）最大定时区间：由于TCNTBn=65535，计数到0共65536个计数脉冲，所以65536*7.6992=0.5045（sec）。11. 分析如图所示I2S总线时序图，说明其操作过程。12. S3C2410A与UAD1341通过I2S总线接口连接，试述音频数据传送过程。处理器通过IIS总线接口，控制音频数据在s3c2410内存与UDA13
3、41TS之间传送。连接在UDA1314TS上的麦克风信号在UDA1314内部经过A/D转换器，转换成二进制数，串行通过DATAO引脚送到S3C2410的IIS模块，在IIS模块中数据转换成并行数据然后使用通常存取方式或DMA存取方式，将并行数据保存的内存中，而内存中要输出的音频数据使用通常存取方式或DMA存取方式，将数据并行传送到IIS模块在IIS中转换成串行数据，串行通过DATAI引脚送到UDA1314TS，在片内经过D/A转换器，变成模拟信号，经过驱动器，驱动扬声器。13. 简述LCD控制器组成及数据流描述。LCD控制器包括：REGBBANK，LCDCDMA，TMEGEN，定时控制逻辑单元
4、，VIDPRCS以及VIDEOMUX组成。当传送请求由总线仲裁器接收时，4个连续的字数据由系统存储器帧缓冲区传送到LCDCDMA内的FIFO。全部FIFO大小为28个字，分别由12个字的FIFOL和16个字的FIFOH组成。使用FIFOL和FIFOH，用来支持双扫描显示模式，在单扫描显示模式，仅有FIFO中一个，即FIFOH能够被使用。14. 以下是S3C2410A的串口逻辑方框图，试分析其组成和工作原理。二、 程序分析。给以下程序主要过程加注释，幷写出程序功能1. 汇编程序： IsrIRQ sub sp,sp,#4； /堆栈指针4送入sp stmfd sp！，r8r9 ldr r9， INT
5、OFFSET ldr r9，r9； /将该r9内容作为地址，读该单元数据送r9。 ldr r8，HandleEINT0；/读中断向量表首地址 add r8，r8，r9，lsl #2；/r9的值逻辑左移2位，加r8，和送r8。 ldr r8, r8； /将该r8内容作为地址，读该单元数据送r8。 str r8，sp,#8； /先索引，r8数据写入sp+8做地址的寄存器中，不回写。 ldmfd sp!，r8-r9,pc； /将sp指向的储存单元多字数据，装入r8-r9地址单元，pc中。程序实现的功能：IRQ中断服务程序 课本P2572. C语言程序段rGPFCON|=20|24; / 将GPF0配
6、置成EINT0和将GPF2配置成EINT2rGPGCON|=26|222; / 将GPG3，GPG11配置成EINT11,EINT19功能rINTMOD=0; / 中断模式配置为IRQ中断rEXTINT0|=40|48; / 将EINT0和EINT2信号方式设置为上升沿触发rEXTINT1|=412; / 将EINT11信号方式配置为上升沿触发rEXTINT2|=4 / 将EINT19信号方式配置为上升沿触发 / rINTMSK&=（10|12|15）; / EINT0,EINT2,EINT8_23对应屏蔽位置0，允许服务中断初始化 课本P2553. C语言程序段void Test_Touch
7、panel（void） rADCDLY=50000; /Normal conversion mode delay about rADCCON=（114）+（ADCPRS0;tt-） for（i=0;i10000;i+） int Main（int argc, char *argv） int i; U8 key; U32 mpll_val=0; int data; mpll_val = （9212）|（112）&0xff, （mpll_val4）&0x3f, mpll_val&3）; ChangeClockDivider（key, 12）; MMU_DisableICache（）; MMU_Dis
8、ableDCache（）; rGPBCON = 0x155555; data = 0x06; while（1） rGPBDAT = （data dely（120）; data =data; return 0;2. 根据Nand Flash控制器工作原理，试在图中画出S3C2410A的Nand Flash控制器与K9F2808U0C芯片的连接关系，并简单描述其操作过程。3. S3C2410A的LCD控制器初始化程序主要包括配置LCD引脚用到的GPIO；设置LCDCON寄存器参数等。试配置C端口、D端口的相关引脚为LCD功能引脚。写出端口配置初始化程序。4. 用S3C2410A或S3C2440的串
9、口1实现串口通信。试设计不带流量控制的简单收发程序，包括初始化程序，发送程序和接收程序。所用寄存器描述如下：ULCONn位描述60：正常模式；1：红外模式5:30xx：无奇偶校验；100：奇校验101：偶校验110：强制奇偶校验校验1；111：强制奇偶校验校验02每帧1个停止位；每帧2个停止位1:05位；6位；7位；8位UCONn的位功能位波特率时钟选择10使用PCLK ，1：使用UEXTCLK发送中断请求类型选择9脉冲；电平接收中断请求类型选择8Rx超时中断使能控制7禁止；使能接收错误状态中断使能控制回送模式选择5回送模式发送模式选择3:2中断请求或查询模式；接收模式选择UMCONn的位功能
10、AFC使能4请求发送0RTS无效；RTS有效等等已定义宏如下：#define WrUTXH0（ch） （*（volatile unsigned char *）0x50000020）=（unsigned char）（ch）#define RdURXH0（） （*（volatile unsigned char *）0x50000024）程序设计（要求加注释）：5. 使用S3C2410A的A/D转换器进行模拟信号到数字信号的转换。写出初始化函数和读取转换结果的函数。ADCDAT0位名XPDATA（正常ADC）9:X位置的转换数据值（包括正常A/D转换的数据值）。取值范围：03FF定义与AD转换相关的
11、寄存器#define rADCCON（*（volatile unsigned*）0x58000000）/ADC控制寄存器#define rADCTSC（*（volatile unsigned*）0x58000004）/ADC触摸屏控制寄存器#define rADCDLY（*（volatile unsigned*）0x58000008）/ADC启动或间隔延时寄存器#define rADCDAT0（*（volatile unsigned*）0x5800000c）/ADC转换数据寄存器0#define rADCDAT1（*（volati1e unsigned*）0x58000010）/ADC转换数据
12、寄存器 6. S3C2440的 bank6使用32位数据总线与SDRAM芯片HY57V561620连接，每片SDRAM 为32MB存储空间，16位数据线。试画出二者之间的连接电路图。在下图中SDRAM芯片引脚引出线上标出连接到S3C2440芯片上的对应引脚名称。简单描述工作原理：一、 填空1. “嵌入性”、“专用性”与“计算机系统”是嵌入式系统的三个基本要素。2. IP核分为软核、硬核、固核。3. 嵌入式系统通常由包含有嵌入式处理器、嵌入式操作系统、应用软件和外围设备接口的嵌入式计算机系统和执行装置（被控对象）组成。4. 嵌入式计算机系统是整个嵌入式系统的核心，可以分为硬件层、中间层、系统软件
13、层和应用软件层。5. 硬件层中包含嵌入式微处理器、存储器、通用设备接口和I/O接口。嵌入式微处理器是嵌入式系统硬件层的核心。6. 系统初始化过程按照自底向上、从硬件到软件的次序依次可以分为片级初始化、板级初始化和系统级初始化3个主要环节。7. 系统软件层通常包含有实时多任务操作系统（Real-time Operation System，RTOS）、文件系统、图形用户接口（Graphic User Interface，GUI）、网络系统及通用组件模块组成。RTOS是嵌入式应用软件的基础和开发平台。8. ARM处理器共有37个寄存器，31个通用寄存器，6个状态寄存器。寄存器R13通常用作堆栈指针，
14、称作SP。寄存器R14用作子程序链接寄存器，也称为链接寄存器LK （Link Register）。9. FIQ模式有7个分组的寄存器R8R14，映射为R8_fiqR14_fiq。在ARM状态下，许多FIQ处理没必要保存任何寄存器。User、IRQ、Supervisor、Abort和Undefined模式每一种都包含两个分组的寄存器R13和R14的映射，允许每种模式都有自己的堆栈和链接寄存器。10. 寄存器R15用作程序计数器（PC）。在ARM状态，位1:0为0，位31:2保存PC。11. 程序状态寄存器CPSR的N、Z、C、V分别指-，I=1指-、F=1指-，M4：0用做-。12. ARM指令
15、集大致分为6类：分支/跳转指令、存储器访问指令、数据处理指令、程序状态寄存器指令、异常中断指令、协处理器指令。指令解析举例：13. LDR R0,R1 ；将存储器地址为R1的字数据读入寄存器R0。14. STR R0，R1，8 ；将R0中的字数据写入以R1为地址的存储器中，并将新地址R18写入R1。15. ADDS R1,R1,#1 ；加法指令，R11R1 影响CPSR寄存器，带有S16. LDMFD R13!，R0，R4-R12，PC ；将堆栈内容恢复到寄存器（R0，R4到R12，LR）。17. S3C2410A的CPU内核采用的是16/32位ARM920T 内核，同时还采用了AMBA（先进
16、的微控制器总线体系结构）新型总线结构。18. ARM920T采用了MMU，AMBA总线和Harvard高速缓存体系结构，该结构具有独立的16KB指令Cache和16KB数据Cache，每个Cache都是由8字长的行组成的。19. 2个USB主设接口/1个USB从设接口20. 117位通用I/O口和24通道外部中断源；21. 电源控制模式有正常、慢速、空闲和电源关断4种模式；22. ARM处理器支持用户、快中断、中断、 管理 、 中止、系统和未定义等7种处理器模式，除了用户模式外，其余的均为特权模式；23. ARM微处理器支持四种类型的堆栈，即：满递增堆栈、满递减堆栈、空递增堆栈、空递减堆栈。2
17、4. 25. 8通道10位ADC和触摸屏接口；26. 支持小大端方式27. ARM体系结构使用单一、线性地址空间。将字节地址做为无符号数看待，范围为（ 02321 ）。28. 地址空间：8个存储器bank，每bank 128 MB（byte）（总共1GB）。29. 对于字对齐的地址A，地址空间规则要求如下：地址位于A的字由地址为A、A1、A2和A3的字节组成；地址位于A的半字由地址为A和A1的字节组成；地址位于A2的半字由地址为A2和A3的字节组成；地址位于A的字由地址为A和A2的半字组成。30. ARM系统使用存储器映射I/O。I/O口使用特定的存储器地址，当从这些地址加载（用于输入）或向这
18、些地址存储（用于输出）时，完成I/O功能。31. bank0bank6都采用固定的bank起始地址。32. 每个bank支持可编程的8/16/32位数据总线宽度。33. 总线宽度和等待寄存器BWSCON：用来设置总线宽的和等待状态。34. Bank控制寄存器BANKCONn：控制各bank的片选，访问周期。35. 刷新控制寄存器REFRESH：SDRAM的刷新控制寄存器。36. BANKSIZE寄存器：用来设置BANK的容量。37. 支持从NAND Flash存储器和NOR Flash两种启动方式。在NAND Flash模式下，采用4 KB内部缓冲器用于启动引导38. Cache存储器采用写直
19、达（Write-through）或写回（Write-back）操作来更新主存储器。39. 每个引脚端的功能通过端口控制寄存器（PnCON）来定义（配置）。40. 与配置I/O口相关的寄存器包括：端口控制寄存器（GPACONGPHCON）、端口数据寄存器（GPADATGPHDAT）、端口上拉寄存器（GPBUPGPHUP）、杂项控制寄存器以及外部中断控制寄存器（EXTINTN）等。41. 在ARM系统中，支持复位、未定义指令、软中断、预取中止、数据中止、IRQ和FIQ 7种异常，每种异常对应于不同的处理器模式，有对应的异常向量（固定的存储器地址）。42. S3C2410A通过对程序状态寄存器（PS
20、R）中的F位和I位进行设置控制CPU的中断响应。如果设置PSR的F位为1，则CPU不会响应来自中断控制器的FIQ中断；如果设置PSR的I位为1，则CPU不会响应来自中断控制器的IRQ中断。如果设置PSR的F位或I位设置为0，同时将中断屏蔽寄存器（INTMSK）中的相对应位设置为0，CPU响应来自中断控制器的IRQ或FIQ中断请求。43. S3C2410A中的中断控制器能够接收来自56个中断源的请求；44. S3C2440A中的中断控制器能够接收来自60个中断源的请求；45. 每个DMA控制器可以处理以下4种情况：（1）源和目的都在系统总线上；（2）源在系统总线上，目的在外围总线上；（3）源在外
21、围总线上，目的在系统总线上；（4）源和目的都在外围总线上。46. S3C2410A每个DMA通道有9个控制寄存器，4个通道共有36个寄存器。每个DMA通道的9个控制寄存器中有6个用于控制DMA传输，另外3个用于监控DMA控制器的状态。47. 如果在一个存储系统中，指令预取时使用的一个cache，数据读写时使用的另一个cache，各自是独立的，这时称系统使用了独立的cache，用于指令预取的cache称为指令cache，用于数据读写的cache称为数据cache。48. 存储器按存储信息的功能，分为随机存取存储器（Random Access Memory，RAM）和只读存储器（Read Only Memory，ROM）。49. Flash memory（闪速存储器）是嵌入式系统中重要的组成部分，用来存储程序和数据，掉电后数据不会丢失。50. Bank控制寄存器BANKCONn：混合编程技术中，子程序之间的调用必须遵循一定的调用规则，这些规则统称为ATPCS
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