1、湘潭大学计算机原理实验三多周期MIPSCPU控制部件预习报告要点实验三 多周期MIPS CPU的控制部件实验用有限状态机实现多周期CPU的控制部件一实验目的1、了解MIPSCPU控制器的功能和工作原理;2、掌握用有限状态机技术实现多周期控制器的方法;3、熟练掌握用Verilog HDL语言设计多周期控制器的方法;4、熟练掌握对多周期控制器的仿真实验验证和硬件测试两种调试方法;5、掌握向MIPS-CPU顶层数据通路中增加控制单元的方法,并通过仿真验证和硬件测试两种方法对电路进行故障定位的调试技术。二实验内容(1)MIPSCPU控制器的有限状态机设计,根据MIPSCPU各种类型指令执行要求和有限状
2、态机的设计原理,将多周期控制器的指令执行划分为多个状态,确定每一种指令的有限状态机,最后归纳为完整的多周期控制器有限状态机。通过Verilog HDL语言实现多周期控制器有限状态机。(2)根据MIPSCPU控制器的接口要求,在有限状态机的基础上,用Verilog HDL实现完整的MIPSCPU控制器的设计,并根据仿真波形,验证设计的正确性,并对出现的故障进行定位,修改程序,重新编译;(3)设计控制器的硬件下载测试方案。将编译通过的电路下载到实验台中。根据硬件调试结果验证设计的正确性,并对出现的故障进行定位,修改程序重新编译;最终完成控制器的硬件电路设计;(4)在MIPSCPU指令系统的数据通路
3、基础上,增加控制单元电路,并进行编译,仿真波形和调试。根据仿真波形,验证设计的正确性,并对出现的故障进行定位,修改程序,重新编译;(5)对增加了控制单元的顶层数据通路设计硬件下载测试方案。将编译通过的电路下载到实验台中。根据硬件调试结果验证设计的正确性,并对出现的故障进行定位,修改程序,重新编译;最终完成增加了控制单元的顶层数据通路设计。三实验原理与步骤1.把指令执行分成多个阶段,每个阶段在一个时钟周期内完成(1).时钟周期以最复杂阶段所花时间为准(2).尽量分成大致相等的若干阶段(3).每个阶段内最多只能完成:1次访存 或 1次寄存器堆读/写 或 1次ALU2.每步都设置相应的存储元件,执行
4、结果都在下个时钟开始保存到相应单元3.认真阅读书上的控制部件代码后,将其按照电路图进行拆分,拆分为三个部件,并在顶层模块中连接线路。四实验源代码D触发器源代码:下一状态部件源代码:输出函数部件源代码:五EDA阶段的实验结果( “编译”、 “仿真” 等)仿真结果如上图。六测试时的电路总体结构及其说明多周期CPU控制部件的状态转移图多周期CPU控制部件的电路结构图实验电路图七测试计划(包括计划进行的系统测试、每一测试的测试过程、测试所需的测试数据、预期结果数据等)及其相关说明下一状态函数的真值表输入输出op5:0func5:0状态指令ZwpcPcsource1:0wiriordwmemaluc3:
5、0selpcshiftalusrcb1:0sextwregm2regregrtjalsifxX0sidi_jX0i_jalX0i_jrX0i-othersX0sexei_addX0xx0x0X0000000x0xx0i_subX0i_andX0i_orX0i_xorX0i_sllX0i_srlX0i_sraX0i_addiX0i_andiX0i_oriX0i_xoriX0i_lwX0i_swX0i_beq0010i_bne0010i_luiX0smemi_lwX0i_swX0swbr_typeX0i_addiX0i_oriX0i_luiX0i_lwX0八关于实验电路设计的其他说明q值暂未进行输
6、出。九前期实验总结认真阅读书上的控制部件代码后,将其按照电路图进行拆分成三个部件,在此过程中,对控制部件进行了深入的了解,并且对Verilog语言也加强了不少。古今名言敏而好学,不耻下问孔子业精于勤,荒于嬉;行成于思,毁于随韩愈兴于诗,立于礼,成于乐孔子己所不欲,勿施于人孔子读书破万卷,下笔如有神杜甫读书有三到,谓心到,眼到,口到朱熹立身以立学为先,立学以读书为本欧阳修读万卷书,行万里路刘彝黑发不知勤学早,白首方悔读书迟颜真卿书卷多情似故人,晨昏忧乐每相亲于谦书犹药也,善读之可以医愚刘向莫等闲,白了少年头,空悲切岳飞发奋识遍天下字,立志读尽人间书苏轼鸟欲高飞先振翅,人求上进先读书李苦禅立志宜思真品格,读书须尽苦功夫阮元非淡泊无以明志,非宁静无以致远诸葛亮熟读唐诗三百首,不会作诗也会吟孙洙唐诗三百首序书到用时方恨少,事非经过不知难陆游问渠那得清如许,为有源头活水来朱熹旧书不厌百回读,熟读精思子自知苏轼书痴者文必工,艺痴者技必良蒲松龄 声明访问者可将本资料提供的内容用于个人学习、研究或欣赏,以及其他非商业性或非盈利性用途,但同时应遵守著作权法及其他相关法律的规定,不得侵犯本文档及相关权利人的合法权利。谢谢合作!
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