数字化语音存储与回放系统.docx

1、数字化语音存储与回放系统摘要文章介绍了一种数字化语音存储与回放系统的设计方法，该系统以单片机89C52为中心，采用两片 AT628128存储芯片(128KB)构成256KB的外部存储器来存放采集的语音数据,前端语音信号采集部分 采用ADC0809实现模数转换,后端语育信号回放部分采用ADC9764实现数模转换,通过键盘等接口电 路实现人机交互，单片机工作在中断查询模式,能够快速响应按键要求,以控制系统的语音信号采集开始、 存储和回放等。同时，外围电路辅以带通滤波器和放大器等电路对信号进行滤波放大,实现了语音信号的 高保真度存储与回放。关键词：单片机;语音存储;语音回放1前言 42系统总体方案设

2、计 53语音信号的数字化3.1语音信号的前端处理 73.2采样理论 73.2.1采样 73.2.2量化 83.2.3编码 83.3 A/D转换器的设计 93.3.1常见A/D转换器种 93.3.2系统设计对A/D转换器的要求 103.3.3模数转换芯片ADC0809简介 104语音信号的存储4.1存储方案的选择 124.2FIFO特点简介 134.3扩展 SRAM 仿真 FIFO 135语音信号的回放5.1数模转换器设计 145. 1. 1 AD9764 芯片简介 145. 1. 2 AD9764芯片的工作原理 156软件设计 17参考文献 19致谢 20第一章前言目前，许多应用系统中都需要语

3、音存储和回放处理。按照经典的信号与系统理论，语育信号为模拟信号; 而计算机系统建立在二进制基础上，使用的是数字信号。那么，利用计算机处理语音信号就必须先将其数 字化，并将其储存、实现回放。此次毕业设计的重点在于硏究语音信翩字化的理论与方法，以为例,具 体阐述从采集语音信号到储存,再到回放的整个流程;实现语音信号的数字化储存与回放。若用专用的语 昔芯片来处理有时会缺乏灵活性,难以满足不同场合的需要。本文介绍的语音存储与回放系统中，没有使用 专用的语音处理芯片，不需扩展接口电路，只利用一般的单片机测控系统中都有的硬件电路（如A /D、D /A、 存储器等），就能完成语昔信号的数字化处理，即能完成语

4、音的存储与回放，实现单片机测控系统的语音提示 报警及语音提示操作等。第二章系统总体方案设计语音是一种非常有用的信息载体,人们一直在寻找可靠的记录处理语音信号的方法。音乐盒是通过上 发条的滚轮上不同位置的突起来带动簧片发出事先设计好的乐音，这是通过机械的方法实现了语音信号的 记录(有计划地在滚轮上设置突起)、回放(簧片发出乐音)。留声机、磁带等是靠磁头处的电位变化记 录或回放语音信号的。而随着计算机技术的发展与普及,利用计算机处理语音信号已经被广泛应用。人耳能听到的声音频率范围为20Hz 20kH乙而一般语音频率最高为3.4kHz。数字化语音存储与回放 系统的基本思想是将模拟语音信号通过模数转换

5、器(A/D)转换成数字信号，再通过单片机控制存储在存储 器中;回放时，由单片机控制将数据从存储器中读出，然后通过数模转换器(D/A)转换成模拟信号，经放大在扬 声器(或耳机)上输出语昔。本系统以单片机89C52为控制器。由于89C52最大只能寻址64KB的范围，故而 系统另配了两片AT628128存储芯片(128KB)构成256KB的外部存储器来存放采集的语音数据。根据奈 奎斯特采样走理,采样频率必须大于模拟信号最高频率的两倍,由于语音信号频率为300Hz3.4kHz,所 以选取采样频率为8kH乙理论上即可不失真地回放输入的语音信号。具体的系统总体框图参见图2-1。图2T系统总体方案设计整个系

6、统分为数字和模拟两大部分。模拟电路主要由电压放大、功率放大及滤波器组成。数字电路以 单片机89C52为核扩展256KB的RAM存储器，外加A /D、D /A及键盘等外围电路构成。单片机芯片简介由于本系统采集语音信号频率较低,且逻辑比较简单,从性价比的角度选用单片机比较适合,如选用 FPGA、CPLD等可编程逻辑器件,虽然也能完成控制功能”但是系统设计成本将会直线上升,综合考星系 统需求，采用市面上应用广泛、设计成熟的AT89C52作为控制芯片，它是一种低电压、高性能CMOS 8 位单片机，片内含8KB的可反复擦写的程序存储器和12B的随机存取数据存储器（RAM ）,器件采用高密 度、非易失性存

7、储技术生产，兼容标准MCS-51指令系统，片内配置通用8位中央处理器（CPU ）和Flash 存储单元,功能强大的AT89C52单片机可灵活应用于各种控制领域。其主要工作特性是:片内程序存储器内含8KB的Flash程序存储器，可擦写寿命为1000次；片内数据存储器内含256字节的RAM ；具有32根可编程I/O口线；具有3个可编程走时器;中断系统是具有8个中断源、6个中断矢臺、2个级优先权的中断结构；串行口是具有一个全双工的可编程串行通信口；具有一个数据指针DPTR ；低功耗工作模式有空闲模式掉电模式；具有可编程的3级程序锁定位；工作电源电压为5 ( 1+0.2 ) V ,且典型值为5V ;最

8、高工作频率为24MHz。第三章语音信号的数字化3.1语音信号的前端处理由于经拾音器输入的语音信号比较微弱,而模数转换器ADC0809的工作电压在0+ 5V范围内，故而 在采集语育信号前，先要对其进行增益放大。本系统采用LM353作为运算放大器1,将语音信号放大至-2. 5V + 2. 5V,再通过+ 2. 5V电平位移,使信号电压在0 + 5V范围内，满足A/D转换的要求。考虑整流、 滤波后的纹波对扬声器输出的影响，本系统采用运算放大器2 （LM386）作功率放大器。由于运算放大器对电 源电压具有很强的抑制能力，不仅可大大减小扬声器输出端的纹波电压,同时驱动扬声器放出声音。另外，为 了能实现手

9、动音星调节,放大器2的输入端加上一个50kQ的电位器,以便调整音呈。为了滤除不必要的干扰及杂波,系统前向通道和后向通道中各设计了一个通带为300Hz 3. 4kHz的带 通滤波器。由于人的语音频段在10kHz以下,对于滤波的均衡度要求不高，所以本系统通过LM353制作一阶 滤波器进行滤波。此一阶带通滤波器由一个低通滤波器和一个高通滤波器串联而成具中低通滤波器能滤除 3. 4kHz以上的频率信号，减少了因8kHz的采样率弓|起的混叠失真;高通滤波器能滤除300Hz以下的频率信 号，减少了彳硕信号尤其是工频的影响,大大提高了系统的信噪比。3. 2采样理论信息从物理特征上分为：模拟信号与数字信号。话

10、筒输出的话昔信号属于模拟信号；而计算机数据属 于数字信号。若输入是模拟信号（例如语音信号），则在数字系统（例如计算机系统）的编码部分需要对 输入信号进行数字化，或称为模/数”变换，将模拟信号变为数字信号,以便在数字系统中继续加以处 理。数字化过程包括三个步骤：采样,臺化和编码。3. 2.1采样模拟信号首先被采样。通常抽样是按照等时间间隔进行的,虽然在理论上并不是必须如此的。模拟信号被抽样后，成为抽样信号，它在时间上是离散的，但是在其数值仍然是连续的，所以是离散模拟信号。 根据奈奎斯特采样走理,采样频率必须超过信号最高频率的2倍才能无失真的恢复出原模拟信号,假设对 个昔频信号(20Hz 20kH

11、z )进行采样，那么用40KHZ的时钟就可以了，比如PC的声卡采样频率就 是44lkH乙3. 2. 2量化数据采集系统的主要功能之一是把模拟信号转换成数字信号，这个过程就是呈化。呈化，就是用一基本星对W基本呈具有同一量纲的模拟量进行比较的过程，其输入是连续的模拟信号，输出是一系列离散的 数字信号。在星化过程中所使用的基本呈称为呈化电平(Quantized Level)，它是满呈程电压(Vfsr)与2的比值, 具中N为数字信号的二进制位数，也是ADC的分辨率。呈化电平一般用Q来表示，即Q=Vfsr/2n从上式可以看出，Q由Vfsr和2N所决走，是能够量化的最小单位，也是经过ADC后输出的数字信

12、号的分辨率。抽样信号量化信号丁n2TTT图3-2量化信号3. 2. 3编码呈化得到的数字信号的幅度对应于采样点的模拟信号的幅度，但每一个数字信号必须进行编码以变成 计算机可识别的二逬制数。采用的编码方式不同，得到的二进制数显然不同。常用的编码方式有单极性二 进制编码和BCD编码等。实际上，现有的ADC芯片输出的数字信号一般是己经过编码以后的二进制数, 用户不必再考虑编码的问题。编码信号011 100 011 100 / 100 101 101图3-3编码信号3. 3 A/D转换器的设计A/D转换器是将语昔信号转化为数字信号的关键部件,具主要参数有采样频率、采样位数和抗干扰性 能等。随着超大规模

13、集成电路技术的飞速发展和计算机技术在工业领域的广泛应用，A/D转换器的新设计 思想和制造技术层出不穷。为满足各种不同的检测和控制任务的需要,大星结构不同、性能各异的A/D转 换电路应运而生。不同的数据采集场合往往选用的ADC器件也不同。3. 3.1常见A/D转换器种类A/D转换器的种类很多，按工作原理不同分为直接A/D转换器和间接A/D转换器两类，直接ADC可以将模拟信号直接转换为数字信号，这类ADC具有较快的转换速度,具典型电路有快闪型和逐次上匕较 型A/D转换器；而间接ADC则是先将模拟信号转换为某一中间变臺（时间、频率、脉冲克康等）,然后 再将中间变星转换为数字星输出，此类ADC的速度较

14、慢,典型电路是双积分型A/D转换器和电压频率转 换型V/F转换器。按照A/D转换器的速度和精度,又可将A/D转换器大致可分为三类：1、 高速低（或中等）精度A/D转换器，具体的结构有快闪型、半快闪型型和流水线型。此类A/D转换 器速度快，但是精度不高,而且消耗的功耗大，占用的芯片面积也很大，主要用于视频处理、通信、高速 数字测臺仪器和雷达等领域。2、 中速中等精度A/D转换器。这一类型的A/D转换器是以速度来换取精度,如逐次逼近型A/D转 换器。这一类A/D转换器的数据输出通常是串行的,它们的转换速度在几十kHz到几百kHz之间,精度 也比高速A/D转换器高（1016位），主要用于传感器、自动

15、控制、音频处理等领域。3、 中速或低速高精度A/D转换器。此类A/D转换器速度不快，但精度很高（16 24位）,如型 ADC。该类型A/D转换器主要用于音频、通信、地球物理测臺、测试仪、自动控制等领域。3. 3. 2系统设计对A/D转换器的要求由于本系统采集信号为音频，对采样频率采样精度的要求不高，从经济易行的角度考虑可以选用中 速中精度A/D转换器,1、 采样速率40kHz-100kH乙 本系统要音频信号进行采样”采样速率过小就会造成欠采样，采样速率过 高会增加系统成本。2、 采样位数8-10位。综合考虑系统存储芯片存储容呈和人耳听力分辨力，采用采样位数8-10位的A/D 转换器。3、 稳走

16、性好,抗干扰能力强。这方面的指标主要是要求信噪比高、无失真动态范围大和电源抑制比高。_般男女语音的最高频率都不超过10kH乙本系统所要求的语音信号为电话语音级:200HZ-3. 4kHz 由香农采样走理可知，要不失真地还原出输入的模拟语音，理论上就要求采样频率至少为8kHz。经典的模数 转换器ADC0809,分辨率为8位转换时间为lOOps,最大采样频率为10kHz 8kHz,能满足香农采样走理的要求。并且0809芯片的数据输出端内咅隕有三态输出锁存器，可与单片机的数据总线直接连接，接口简 单，使用方便。故而本系统选用ADC0809作为模数转换器，采样频率为8kHz。对A/D转换结果的读出采用

17、查询方式，即每次通过写信号（/WR引脚）启动A /D转换后立即查询状态标志一旦发现转换结束信号读入自己内部的RAM区。（/EOC引脚）呈高电平，表明A /D转换结束则单片机将3. 3. 3模数转换芯片ADC0809简介ADC0809是采样分辨率为8位的、以逐次逼近原理进行模一数转换的器件。其内部有一个8 通道多路开关，它可以根据地址码锁存译码后的信号，只选通8路模拟输入信号中的一个逬行A/D 转换。1.主要特性1）8路输入通道，8位A/D转换器，即分辨率为8位。2）具有转换起停控制端。3）转换时间为lOOps4）单个十5V电源供电5）模拟输入电压范围0 十5V ,不需零点和满刻度校准。6）工作

18、温度范围为-40十85摄氏度7）低功耗，约15mW02.内部结构ADC0809是CMOS单片型逐次逼近式A / D转换器，内部结构如图13 . 22所示，它由8路 模拟开关、地址锁存与译码器、比较器、8位开关树型D/A转换器、逐次逼近3外部特性（引脚功能）ADC0809芯片有28条引脚,采用双列直插式封装，如图13 . 23所示。下面说明各引脚功 能。IN0-IN7 : 8路模拟呈输入端。2-1-2-8 : 8位数字呈输出端。ADDA、ADDB、ADDC : 3位地址输入线,用于选通8路模拟输入中的一路ALE :地址锁存允许信号,输入，高电平有效。START : A/D转换启动脉冲输入端,输入

19、一个正脉冲（至少100ns竞）使其启动（脉冲上 升沿使0809复位，下降沿启动A/D转换）。EOC : A/D转换结束信号，输出，当A/D转换结束时，此端输出一个高电平（转换期间 直为低电平）。OE :数据输出允许信号,输入，高电平有效。当A/D转换结束时,此端输入一个高电平， 才能打开输出三态门，输出数字星。CLK :时钟脉冲输入端。要求时钟频率不高于640KH乙REF （ + ）、REF （-）:基准电压。Vcc :电源，单一十5V。GND :地。ADC0809的工作过程是:首先输入3位地址,并使ALE,将地址存入地址锁存器中。此地址经译码 选通8路模拟输入之一到比鮫器。START上升沿将

20、逐次逼近寄存器复位。下降沿启动A / D转换，之后EOC 输出信号变低，指示转换正在进行。MSJA / D转换完成,EOC变为高电平，指示A / D转换结束，结果数 据已存入锁存器，这个信号可用作中断申请。当OE输入高电平时，输出三态门打开，转换结果的数字呈 输出到数据总线上。第四章语音信号的存储4.1存储方案的选择为实现语音信号实时存储与回放,必须设计可靠的数据缓冲方案。通常构成高速缓存的方案有三种, 即双口 RAM (Dual-Port RAM) x FIFO (First In First Out Memory)和高速 SRAM 切换方式。其中，前 两种存储器具有读和写同时逬行的能力，而

21、高速SRAM切换方式由于具低廉的成本也得到了广泛的应用。3种存储器的性能比较见下表：表4T存储器性能比较存储器总线资源访问方式双口 RAM两套地址线、数据线和控制线，引脚多可在任意时间访问任意存储空间应用场合全局存储器和大容星数据缓冲、存储、共享价格昂贵FIFOSRAM没有地址线,只有只能按先逬先出的顺序读写数据不同时钟域间的数据缓冲；不同克度数据接口间昂贵地址线、控制线各一套读写分开r不能同时进行读写操作大容呈数据缓冲、存储便宜双口 RAM具有两套独立的通过表4-1的比较可以看出：地址和控制线，可从两个端口同时读写而互不干扰，并可将采样数据从一个端口写入，而由控制器从另一个端口读出，可达到很

22、高的传输速度。但其价格比较昂贵,而且在 本系统中采集数据和处理数据是按照时间顺序进行的，因此没必要用双口 RAM0FIFO存储器就像数据管道一样r数据从管道的一头流入，从另一头流出，先进入的数据先流出,控 制方式简单。数据在其中顺序移动，因而能够达到很高的传输速度和效率，是数据缓冲的首选方式，但大 容星的高速FIFO存储器价格非常昂贵。从减少系统成本的角度,可以在单片机内部集成FIFO。但是受单 片机内部BRAM的限制,FIFO的存储深度不可能很大，而本系统又需要较大的数据缓冲能力，即要求FIFO 具有相当的存储深度,因此需要对存储器扩充。对存储器进行扩充,主要涉及到以下两个关键因素:空间、

23、速度。第三种高速SRAM切换方式虽然只有一套地址线,不具备读写操作同时进行的能力”但它可通过时 分复用地址线数据线的办法来实现读和写操作的交替进行，模仿FIFO的功能。而且大容星的高速SRAM 相对于数据缓冲来说有足够的空间,其读写速度一般在15ns左右，且价格比前两者低得多，满足系统要 求。因此本设计采用折中方案,即采用单片机内部集成FIFO加扩展SRAM仿真FIFO功能的方式作为数 据缓冲方案，这样既节约了成本又达到了设计要求。4.2 FIFO特点简介FIFO存储器是近几年面市的一种特殊存储器件,其特点是在同一芯片里的同一存储单元配备有两个数据口 ,个是输入口，只负责数据的写入，另一个是输

24、出口，只负责数据的输出。另夕卜在对这种存储器 进行读和写的操作时不需要地址线参与寻址,它的蠅是按照一种环形结构依次逬行存放的,因而省去了 大呈的地址线，使接口电路的设计和控制变得简单。FIFO存储器另一个与传统存储器不同的地方是传统 存储器的一个存储单元中只要写入一个癖后，这个换将一直保存，直到一个新的数据将其覆盖，无论 这个存储单元的数据被读取过多少次都是如此。而FIFO存储器中的存储单元则不是这样,写入的帥 旦被读取后，则这个数据再也无法被读取就像永远消失了一样。所以，FIFO存储器在操作时由空和满的标志位来表示FIFO存储器内部的状态。确定FIFO是否为空或满的方法是t匕较读指针和写指针

25、，如它们不相等，则肯走既不是空状态也不是 满状态。如读写指针相等并且最后的操作是读,则FIFO处于空状态。如读写指针相等且最后的操作是写， 则FIFO处于满状态，不能续写入数扌4.3扩展SRAM仿真FIFO采用外部SRAM实现FIFO的具体做法为：将三态缓冲门分别接到读写控制器上,在逬行写操作时，SRAM由三态门切换到同步FIFO ,以使采样数据写入其中。在逬行读操作时,SRAM再由三态门切 换到异步FIFO 侧进行读写。这种方式的优点是SRAM可随机存取r同时较大容呈的高速SRAM有现成的产品可供选择。在设计中使FPGA中的内部的娄传输时钟与外部的SRAM时钟同步并且要求FPGA内部的使能端

26、与SRAM的CE为一个同步使能，这样使数据达到同步的目的。SRAM采用HM628128 r容量256kB ,读写周期15ns , +5V供电，TTL兼容。第五章 语音信号的回放语音回放需将存储的数字语音数据通过D /A转换器转换成语肓模拟信号。本系统采用典型的D /阳专换 芯片AD9764,字长为14位，可直接与单片机连接。但AD9764的输出呈是电流而实际应用中需要模拟语昔 电氐为此，在AD9764的输出端接反相电压转换电路。这样，数字信号经D /A转换、双极性电流至电压变 换后已成为模拟语音信号,经带通滤波器再送往音频功率放大器,做适当的功率提升来推动扬声器发声。5.1数模转换器设计对于D

27、/A转换器性能的考虑，应包括建立时间、尖峰脉冲能呈、转换位数和积分线性等方面。与A/D 转换器的采样位数和输出信嗥比的关系类似，增大D/A转换器的位数也可以增大信噪比，减小电压幅值 星化误差,为满足信号模拟的信噪比要求,采用14位D/A转换器。5.1.1 AD9764芯片简介AD9764是高性能的TxDAC系列中的一款低功耗CMOS数/模转换器，14位分辨力、125MHz转换速率.片内1.20V基准、边沿触发锁存、极佳的动态无杂波失真范围和交调失真、输入数据格式为标准正二进制码、典型功耗190mWo AD9764的功能模块框图如图5J所示:REFIOACOMREFIO+1.2V参考FS ADJ

28、DVDDDCOMCLOCKSLEEPAVDDCOMP2电流源/阵列COMP1AD9764锁存器(在时钟上升沿数据被锁存)IOUTAIOUTBIOUTAIOUTB图5T AD9764的内部功能框图AD9764采用28脚SOIC封装、单5V电源供电、差分电流输出范围：2-20mAs可选择内部或外部参考电压，具引脚功能说明如表5-1所示：表5-1 AD9764的引脚功能说明引脚名称功能引脚名称功能1DB13最高位(MSB)2-13DB12-1数据位1-1214DB0最低位(LSB)15SLEEP掉电控制输入16REFLO参考地(内部参考)17REFIO基准输入/输出18FS ADJ满星程电碱出调节1

29、9COMP1带竞/噪声下降节点20ACOM模拟公共地21Ioutb电流输出端B22Iouta电流输出端A23COMP2驱动电路偏置节点24AVDD模拟电源电压25NC无内部连接26DCOM数字公共地27DVDD数字电源电压28CLOCK时钟输入5.1.2 AD9764芯片的工作原理5.1.2.1数字输入AD9764的数字输入包括14个数据输入引脚和1个时钟输入引脚，这14位并行娄输入遵循标准正二进制编码,其中DB13是最高融数据位(MSB),而DBO是副氐有效数据位(LSB)如图3-4 r输入 数据在在时钟上升沿时被锁存器锁存，转换后的数据输出也在时钟上升沿被刷新新r时钟频率最高可达125MS

30、PSO51.2.2模拟输出AD9764输出两路互补电流:Iouta和Ioutb ,当所有数据位都是逻辑1时,Iouta将产生一个满呈程输 出电流Ioutfs ,而Ioutb则产生一个电流为雲的互补输出。Iouta和Ioutb都是输入码DAC CODE与满量程 输出电流IOUTFS的函数，关系如下：Iouta=(DAC CODE/16384)xIqutfs(3-DIoutb=(16383-DAC CODE)/16384xIOutfs(3-2)其中，DAC CODE为并行输入的14位娄,满呈程输出电流Ioutfs的大小取决于Vrefio与满星程电流输出调节端(FS ADJ)的负载电阻Rset ,关

31、系如下：Ioutfs=32 xIref=32 X Vrefio/Rset (3-3)Iouta和Ioutb能通过负载电阻Rload转换成互补单端电压输出Vouta和Voutb，存在于Vouta和Voutb之间的差分电压Vdiff也能够通过变压器或差分放大器转换成单端电压，关系如下：Vdiff=(Iouta-Ioutb) x Rload=(2DAC CODE-16383)/16384 xI0Utfs Rload=(2DAC CODE-16383)/16384 x (32xVrefio/Rset) x Rload (3-4)式(3-4)也显示了 AD9764采用差分操作的优点,首先,差分输入抵消了 Iouta和Ioutb端由于噪声、 失真、直