整理数字逻辑第五章Word文件下载.docx

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J=0，K=0时，Q状态为保持；

J=0，K=1时，Q状态为置0；

J=1，K=0时，Q状态为置1;

J=1,K=1时,Q状态为翻转

--—--———----—----—---—---—---—-——--—-——--——--—--------——--—--———-—--—-------

2：

对于JK触发器，输入J＝0，K＝1，CLK脉冲作用后,触发器的次态应为（）。

0

1

Q'

D:

不确定 

J=1，K=1时，Q状态为翻转，即Q=Q’

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3：

有一个或非门构成的SR锁存器，欲使该锁存器保持原态即Q*=Q,则输入信号应为（）。

S＝R＝0

B：

S＝R＝1

S＝1，R＝0　

S＝0，R＝1 

您选择的答案：

或非门构成的SR锁存器的特性为：

R=1,S=0Q＊=0,Q*'

=1,即锁存器被置0（0状态）；

R=0,S=1Q＊=1，Q＊'

=0，即锁存器被置1（1状态）;

R=S=0，Q*=Q，即锁存器保持原态；

R=S=1Q*=Q＊'

=0，此为不允许输入。

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4：

JK触发器要实现Q＊=1时，J、K端的取值为（）。

J=0，K=1

J=0，K=0

C:

J=1,K=1

J=1,K=0 

D

J=0，K=1时，Q状态为置0;

J=1，K=0时,Q状态为置1；

J=1，K=1时,Q状态为翻转

--—---——-————-------——---——-—----—-—--—-—-—-—-—-—--—-—---———-——---—--—-——-——

5：

将D触发器的D端与它的Q'

端连接,假设初始状态Q=0，则经过1个脉冲作用后，它的状态Q为（）。

A:

不确定

翻转 

正确答案:

B

D触发器的特性为：

D=0时，Q＊=0,Q*'

=1，即触发器被置0（0状态）；

D=1时,Q*=1，Q*’=0，即触发器被置1（1状态）；

即：

Q＊=D

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6：

下列触发器中，没有约束条件的是（）。

基本RS触发器

主从RS触发器

同步RS触发器

边沿D触发器 

知识点:

RS触发器的特性方程为:

Q＊=S+R’Q,SR=0（约束条件）;

D触发器的特性方程为：

Q*=D

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7:

要使JK触发器的输出Q从1变成0，它的输入信号JK应为（）。

00

01

10

无法确定 

J=0,K=0时,Q状态为保持；

J=1，K=0时，Q状态为置1；

J=1,K=1时，Q状态为翻转

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8：

欲使D触发器按Q＊=Q’工作，应使输入D=（）。

Q

D=0时,Q*=0，即触发器被置0（0状态）；

D=1时，Q*=1,即触发器被置1（1状态）；

---------———--——--—--——-----——---—-————-—-—-————-———-----——--————--———-——--—

9:

T触发器中，当T=1时，触发器实现（）功能。

置1

置0

计数

保持 

C

T触发器的特性为：

T=0时,Q＊=Q，即触发器保持原来的状态;

T=1时,Q＊=Q＊,即触发器翻转，即:

计数状态

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10:

时序电路的异步复位信号作用于复位端时,可使时序电路（）复位.

在CLK上升沿

在CLK下降沿

在CLK为高电平期间

立即 

SD’叫异步置位端，RD’叫异步复位端.只要在SD’或RD’加入低电平,即可立即将触发器置1或置0，而不受时钟信号和输入信号的控制。

触发器正常工作时,SD’和RD’应处于高电平。

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11:

已知某触发器的特性如表所示（触发器的输入用A、B……表示）。

请选择与之具有相同功能的逻辑表达式是（C）。

Q*=A

Q*=A’Q+BQ'

Q*=AQ’+B'

Q＊=A+B'

Q 

JK触发器的特性为:

J=0,K=0时，Q状态为保持；

J=0，K=1时,Q状态为置0；

J=1，K=1时，Q状态为翻转,JK触发器的特性方程为:

Q*=JQ’+K’Q

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12:

采用主从结构的触发器，则触发方式为（）。

电平触发方式

脉冲触发方式

边沿触发方式

电路的触发方式由电路的结构形式决定，因此,电路结构形式与触发方式之间有固定的对应关系.同步SR结构—电平触发方式；

主从SR结构—脉冲触发方式;

两个电平触发D触发器结构—边沿触发方式

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13:

触发器异步输入端为低电平有效时，如果异步输入端RD’=1,SD'

=0，则触发器直接置成（）状态。

0、1都可

SD'

叫异步置位端，RD’叫异步复位端。

只要在SD’或RD’加入低电平，即可立即将触发器置1或置0,而不受时钟信号和输入信号的控制。

触发器正常工作时,SD’和RD'

应处于高电平.

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14：

要使触发器实现异步复位功能Q*=0，则异步控制端为（）

RD'

=0，SD’=1

RD’=1，SD’=0

RD’=1，SD'

=1

SD’叫异步置位端，RD'

叫异步复位端。

只要在SD’或RD’加入低电平，即可立即将触发器置1或置1,而不受时钟信号和输入信号的控制。

触发器正常工作时,SD’和RD’应处于高电平.

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15:

对于JK触发器已知Q=0,若要使Q*=1，则：

（）

J=0,K=0

J=0,K=1

J=1，K=0

J=0,K=0时，Q状态为保持;

J=0，K=1时,Q状态为置0;

J=1,K=0时，Q状态为置1;

J=1,K=1时,Q状态为翻转,JK触发器的特性方程为：

Q＊=JQ'

+K'

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16:

对于JK触发器，若J＝K,则可完成（）触发器的逻辑功能

T触发器

T’触发器 

JK触发器特性方程：

Q＊=JQ′+K′Q,当J=K=T时则变为T触发器特性方程:

Q＊=T′Q+TQ′

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17:

若J=K′，则完成（）触发器的逻辑功能。

Q＊=JQ′+K′Q，当J=K′=D时则变为D触发器特性方程Q*=D

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18:

（）的特性方程为Q＊=A

D触发器

SR触发器 

D触发器的特性方程为Q＊=D

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19:

（）的特性方程为Q＊=AQ'

+B'

JK触发器的特性方程为：

Q＊=JQ′+K′Q

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20:

（）的特性方程为Q＊=AQ’+A'

T触发器的特性方程为：

Q*=TQ′+T′Q

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21:

由图所示的CLK和D信号波形，上升沿触发的D触发器Q端波形为（）（设Q初态为0）。

图A

图B

图C

图D 

D=0时,Q＊=0，即触发器被置0（0状态）；

D=1时,Q*=1,即触发器被置1（1状态）;

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22：

分析图中所示输入、输出Q的波形。

则该触发器为（）

上升沿触发的T触发器

上升沿触发的D触发器

下降沿触发的T触发器

下降沿触发的D触发器 

参考D触发器和T触发器的特性表

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23:

上升沿触发的JK触发器

上升沿触发的SR触发器

下降沿触发的JK触发器

下降沿触发的SR触发器 

参考JK触发器和SR触发器的特性表

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24:

电路如下图所示，设起始状态Q2Q1=00，第3个上升沿，Q2Q1变为（）

11 

参考T触发器的特性表

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25：

逻辑电路如图所示，输入为X，Y，同它功能相同的是（）。

电平触发的SR触发器

JK触发器

SR锁存器

T触发器 

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26：

逻辑电路如图所示,当A=“0”，B=“1”时，脉冲来到后,触发器（）

翻转

保持原状态

置“0”

置“1” 

D触发器的特性方程为Q*=D

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27:

在下图所示电路中，能完成Q＊=0逻辑功能的电路有（）。

D触发器的特性方程为Q*=D；

Q＊=JQ′+K′Q;

T触发器的特性方程为:

Q*=TQ′+T′Q;

SR触发器的特性方程为：

Q＊=S+R′Q,SR=0（约束条件）

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28：

触发器的状态转换图如下，则它是：

D触发器 

见T触发器状态转换图

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29：

触发器的状态转换图如下，则它是:

见D触发器状态转换图

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