计算机组成原理试题Word文档下载推荐.doc

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第二章：

1.写出下列各整数的的原码，反码，补码表示（用8位二进制数）。

其中MSB是最高位（符号位），LSB是最低位。

（1）-35

（2）-128（3）-127（4）-1

解：

[-35]原=10100011[127]原=01111111[-127]原=11111111[-1]原=10000001

[-35]反=11011100[127]反=01111111[-127]反=10000000[-1]反=11111110

[-35]补=11011101[127]补=01111111[-127]补=10000001[-1]补=11111111

4.将下列十进制数表示成IEEE754标准的32位浮点规格化数

（1）27/64

（2）-27/64

IEEE754标准32位浮点的规格化数为

X=（-1）S´

1.M´

2E-127

（1）27/64

27/64=27´

2-6=（11011）2´

2-6=（1.1011）2´

2-2

所以S=0，E=e+127=125=（01111101）2，M=1011

32位的规格化浮点数为：

00111110110110000000000000000000，即十六进制的（3ED80000）16

（2）-27/64

-27/64=-（1.1011）2´

所以S=1，E=e+127=125=（01111101）2，M=1011

10111110110110000000000000000000，即十六进制的（BED80000）16

5.已知x和y，用变形补码计算x+y，同时指出结果是否溢出。

公式：

[x+y]补=[x]补+[y]补

（1）x=11011，y=00011

[x+y]补=0011011+0000011=0011110；

没有溢出，x+y=11110

（2）x=11011，y=-10101

[x+y]补=0011011+1101011=0000110；

0011011

+1101011

0000110

没有溢出，x+y=00110

（3）x=-10110，y=-00001

[x+y]补=1101010+1111111=1101001；

没有溢出，x+y=-10111

6.已知x和y，用变形补码计算x-y,同时指出运算结果是否溢出。

[x-y]补=[x]补+[-y]补

（1）x=11011，y=-11111

[-y]补=0011111

[x-y]补=0011011+0011111=0111010；

+0011111

0111010

正溢出，x-y=+111010

（2）x=10111，y=11011

[-y]补=1100101

[x-y]补=0010111+1100101=1111100；

0010111

+1100101

1111100

没有溢出，x-y=-00100

（3）x=11011，y=-10011

[-y]补=0010011

[x-y]补=0011011+0010011=0101110；

正溢出，x-y=+101110

13.下列各数使用了IEEE32位浮点格式，相等的十进制是什么？

（1）11000001111000000000000000000000

S=1

E=（83）16=131 e=E-127=131-127=4

1.M=（1.11）2

所以，该浮点数为-（1.11）2´

24=-（11100）2=-28

（2）00111111010100000000000000000000

S=0

E=（7E）16=126 e=E-127=126-127=-1

1.M=（1.101）2

所以，该浮点数为（1.101）2´

2-1=（0.1101）2=0.8125

第三章：

1、设有一个具有20位地址和32位字长的存储器，问：

（1） 

该存储器能存储多少字节的信息？

（2） 

如果存储器由512K×

8位SRAM芯片组成，需要多少片？

（3） 

需要多少位地址作芯片选择？

该存储器能存储：

（2）需要

（3）用512K*8位的芯片构成字长为32位的存储器，则需要每4片为一组进行字长的位数扩展，然后再由2组进行存储器容量的扩展。

所以只需一位最高位地址进行芯片选择。

CPU

地址

寄存器

数据

32K

*8

CS3

CS2

CS1

CS0

2:

4

译码器

~

A16

A15

9、CPU执行一段程序时，cache完成存取的次数为2420次，主存完成存取的次数为80次，已知cache存储周期为40ns，主存存储周期为240ns，求cache／主存系统的效率和平均访问时间。

cache的命中率

cache/主存系统效率e为

平均访问时间Ta为

16.下述有关存储器的描述中，正确的是（B、D）

A.多级存储体系由Cache、主存和虚拟存储器构成

B.存储保护的目的是：

在多用户环境中，既要防止一个用户程序出错而破坏系统软件或其它用户程序，又要防止用户访问不是分配给他的主存区，以达到数据安全与保密的要求。

C.在虚拟存储器中，外存和主存以相同的方式工作，因此允许程序员用比主存空间大得多的外存空间编程。

D.Cache和虚拟存储器这两种存储器管理策略都利用了程序的局部性原理。

17.引入多道程序的目的在于（A）。

A．充分利用CPU，减少CPU等待时间

B．提高实时响应速度

C．有利于代码共享，减少主、辅存信息交换量

D．充分利用存储器

18．虚拟段页式存储管理方案的特性为（D）

A.空间浪费大、存储共享不易、存储保护容易、不能动态连接。

B.空间浪费小、存储共享容易、存储保护不易、不能动态连接。

C.空间浪费大、存储共享不易、存储保护容易、能动态连接。

D.空间浪费小、存储共享容易、存储保护容易、能动态连接。

19.某虚拟存储器采用页式存储管理，使用LRU页面替换算法，若每次访问在一个时间单位内完成，页面访问序列如下：

1、8、1、7、8、2、7、2、1、8、3、8、2、1、3、1、7、1、3、7。

已知主存只允许放4个页面，初始状态时4个页面是全空的，则页面失效次数是___6____。

第四章：

4．指令格式结构如下所示，试分析指令格式及寻址方式特点。

12．根据操作数所在位置，指出其寻址方式（填空）：

（1）操作数在寄存器中，为（寄存器）寻址方式。

（2）操作数地址在寄存器，为（寄存器间接）寻址方式。

（3）操作数在指令中，为（立即）寻址方式。

（4）操作数地址（主存）在指令中，为（直接）寻址方式。

（5）操作数的地址，为某一寄存器内容与位移量之和，可以是（基址、变址、相对）寻址方式。

第五章：

1．请在括号内填入适当答案。

在CPU中：

（1）保存当前正在执行的指令的寄存器是（IR）；

（2）保存当前正在执行的指令地址的寄存器是（AR）

（3）算术逻辑运算结果通常放在（DR）和（通用寄存器）。

2.P150页-----图5.14

第六章：

8．同步通信之所以比异步通信具有较高的传输频率,是因为同步通信__C__。

A.不需要应答信号；

B.总线长度较短；

C.用一个公共时钟信号进行同步；

D.各部件存取时间比较接近。

10.采月串行接口进行7位ASCII码传送，带有1位奇校验位，l位起始位和1位停止位,当传输率为9600波特时，字符传送速率为_A___。

A.960B.873.C.1372D.480

14.PCI是一个与处理器无关的___D__，它采用__C__时序协议和__A__式仲裁策略，并具有_B___能力。

A.集中B.自动配置C.同步D.高速外围总线

9.在集中式总线仲裁中，__B__方式响应时间最快，_A___方式对__C__最敏感。

A.菊花链方式B.独立请求方式C.电路故障D.计数器定时查询方式

11．系统总线中地址线的功能是___D___。

A．选择主存单元地址B．选择进行信息传输的设备

C．选择外存地址D．指定主存和I/O设备接口电路的地址

12．系统总线中控制器的功能是___D___。

A．提供主存、I/O接口设备的控制信号和响应信号B．提供数据信息

C．提供时序信号D．提供主存、I/O接口设备的响应信号

15.PCI总线的基本传输机制是__B__传送。

利用__A__可以实现总线间的__C__传送，使所有的存取都按CPU的需要出现在总线上。

PCI允许___D_总线__E__工作。

A.桥B.猝发式C.并行D.多条E.猝发式

第八章：

1．如果认为CPU等待设备的状态信号是处于非工作状态（即踏步等待），那么在下面几种主机与设备之间的数据传送中：

（A）主机与设备是串行工作的；

（C）主机与设备是并行工作的；

（B）主程序与设备是并行运行的。

A．程序查询方式B.程序中断方式C.DMA方式

2．中断向量地址是__C___。

A．子程序入口地址B.中断服务程序入口地址

C．中断服务