数字电路仿真实验报告.docx
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数字电路仿真实验报告
数字电路仿真
实验报告
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实验一组合逻辑电路设计与分析
1.实验目的
(1)学会组合逻辑电路的特点;
(2)利用逻辑转换仪对组合逻辑电路进行分析与设计。
2.实验原理
组合逻辑电路是一种重要的数字逻辑电路:
特点是任何时刻的输出仅仅取决于同一时刻输入信号的取值组合。
根据电路确定功能,是分析组合逻辑电路的过程,一般按图1-1所示步骤进行分析。
图1-1组合逻辑电路的分析步骤
根据要求求解电路,是设计组合逻辑电路的过程,一般按图1-2所示步骤进行设计。
图1-2组合逻辑电路的设计步骤
逻辑电路转换成真值表
真值表转换成逻辑表达式
真值表化简逻辑表达式
逻辑表达式转换成真值表
逻辑表达式转换成逻辑电路
逻辑表达式转换成与非门电路
逻辑转换仪是在Multism软件中常用的数字逻辑电路设计和分析的仪器,使用方便.简洁。
图1-3逻辑转换仪的图标和面板
3.实验电路及步骤
(1)利用逻辑转换仪对已知逻辑电路进行分析。
a.按图1-4所示连接电路。
图1-4待分析的逻辑电路A
b.在逻辑转换仪面板上单击由逻辑电路转换为真值表的按钮和由真值表导出简化表达式后,得到如图1-5所示结果。
观察真值表,我们发现:
当四个输入变量A,B,C,D中1的个数为奇数时,输出为0,而当四个输入变量A,B,C,D中1的个数为偶数时,输出为1。
因此这是一个四位输入信号的奇偶校验电路。
图1-5经分析得到的真值表和表达式
(2)根据要求利用逻辑转换仪进行逻辑电路的设计。
a.问题提出:
有一火灾报警系统,设有烟感、温感和紫外线三种类型不同的火灾探测器。
为了防止误报警,只有当其中有两种或两种以上的探测器发出火灾探测信号时,报警系统才产生报警控制信号,试设计报警控制信号的电路。
b.在逻辑转换仪面板上根据下列分析出真值表如图1-6所示:
由于探测器发出的火灾探测信号也只有两种可能,一种是高电平
(1),表示有火灾报警;一种是低电平(0),表示正常无火灾报警。
因此,令A、B、C分别表示烟感、温感、紫外线三种探测器的探测输出信号,为报警控制电路的输入、令F为报警控制电路的输出。
图1-6经分析得到的真值表
(3)在逻辑转换仪面板上单击由真值表到处简化表达式的按钮后得到如图1-7所示的最简化表达式。
图1-7经分析得到的表达式AC+AB+BC
(4)在图1-8的基础上单击由逻辑表达式得到逻辑电路的按钮后得到如图1-8所示的逻辑电路。
图1-8生成的报警控制控制信号电路
4.思考题
(1)设计一个4人表决电路。
即如果3人或3人以上同意,则通过;反正,则被否决。
用与非门实现。
a.通过分析得到真值表如图1-9所示。
b.按由真值表转换成最简逻辑表达式的按钮得到相应的最简逻辑表达式。
c.按由逻辑表达式转换成与非门电路,得到如图1-10所示电路,即所求电路。
图1-9经分析得到的真值表
图1-10用与非门实现的4人表决电路
(2)利用逻辑转换仪对图1-11所示逻辑电路进行分析。
依次按逻辑转换仪上由逻辑电路转换成真值表的按钮和由真值表转换成最简表达式的按钮得到所要的分析结果,如图1-12所示。
图1-11待分析的逻辑电路
图1-12经分析得到的真值表和表达式
逻辑功能分析:
当A、B不同时为1时(任意一个不为1或都不为1),输出为C非;
当A、B同时为1时,输出为C。
AB端作为控制信号控制输出与C的关系。
5.实验心得
通过本次实验的学习,我们复习了数电课本关于组合逻辑电路分析与设计的相关知识,掌握了逻辑转换仪的功能及其使用方法。
初步掌握了软件multisim的用法。
实验二编码器、译码器电路仿真实验
1.实验目的
(1)掌握编码器、译码器的工作原理。
(2)常见编码器、译码器的应用。
2.实验原理
所谓编码是指在选定的一系列二进制数数码中,赋予每个二进制数码以某一固定含义。
例如,用二进制数码表示十六进制数叫做二—十六进制编码。
能完成编码功能的电路统称为编码器。
74LS148D是常用额8线—3线优先编码器。
在8个输入线上可以同时出现几个有效输入信号,但只对其中优先权最高的一个有效输入信号进行编码。
其中7端优先权最高,0端优先权最低,其他端的优先权按端脚号的递减顺序排列。
~E1为选通输入端,低电平有效,只有~E1=0时,编码器正常工作,而在~E1=1时,所以的输出端均被封锁。
E0为选通输出端,GS为优先标志端。
该编码器输入、输出均为低电平有效。
译码器是编码的逆过程,将输入的每个二进制代码赋予的含义“翻译”过来,给出相应的输出信号。
能够完成译码功能的电路焦作译码器。
74LS138D属于3线—8线译码器。
该译码器输入高电平有效,输出低电平有效。
图2-1编码器74LS148D图2-2译码器74LS138D
8位信号输入端
7端优先权最高三个使能端三路输入端
0端优先权最低
3.实验电路及步骤
3.1电路
(1)8—3线优先编码器具体电路如图2-1所示,说明如下:
利用9个单刀双掷开关(J0—J8)切换8位信号输入端和选通输入端(~E1)输入的高低电平状态。
利用5个探测器(X1—X5)观察3位信号输出端、选通输出端、优先标志段输出信号的高低电平状态(探测器亮表示输出高电平“1”,灭表示输出低电平“0”)。
(2)3—8线译码器具体电路如图2-2所示,说明如下:
利用3个单刀双掷开关(J1—J3)切换二路输入端输入的高低电平状态。
利用8个探测器(X0—X7)观察8路输出端输以信号的高低电平状态(探测器亮表示输出高电平“1”,灭表示输出低电平“0”)。
使能端G1接高电平,G2A接低电平,G2B接低电平。
3.2步骤
(1)8—3线优先编码器实验步骤:
a.按图2-3所示连接电路。
b.切换9个单刀双掷开关(J0—J8)进行仿真实验,将结果填入表2.1中。
输入端中的“1”表示接高电平,“0”表示接低电平,“×”表示接高、低电平都可以。
输出端中的“1”表示探测器亮,“0”表示探测器灭。
该编码器输入、输出均为低电平有效。
图2-38—3线优先编码器仿真电路
输入端
输出端
~E1
Y7
Y6
Y5
Y4
Y3
Y2
Y1
Y0
A2
A1
A0
GS
E0
1
×
×
×
×
×
×
×
×
1
1
1
1
1
0
1
1
1
1
1
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×
1
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0
0
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1
1
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×
×
1
0
1
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1
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1
1
1
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×
×
×
1
0
0
0
1
0
1
1
1
0
×
×
×
×
0
1
1
0
1
0
1
1
0
×
×
×
×
×
0
1
0
0
1
0
1
0
×
×
×
×
×
×
0
0
1
0
1
0
0
×
×
×
×
×
×
×
0
0
0
0
1
表2.18—3线译码器真值表(输入高电平有效,输出低电平有效)
(2)3-8线译码器实验步骤:
a.按图2-4所示连接电路。
b.切换3个单刀双掷开关(J1—J3)进行仿真实验,得到表2.2所示结果。
输入端中的“1”表示接高电平,“0”表示接低电平。
输出端中的“1”表示探测器亮,“0”表示探测器灭。
该译码器输入高电平有效,输出低电平有效。
图2-43—8线译码器仿真电路
输入端
输出端
G1
G2A
G2B
A2
A1
A0
Y0
Y1
Y2
Y3
Y4
Y5
Y6
Y7
1
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
1
1
0
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1
1
1
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1
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1
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1
1
1
1
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1
0
0
0
1
1
1
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1
1
1
1
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0
0
1
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1
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1
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1
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0
1
1
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1
1
1
1
1
1
0
1
1
0
0
1
1
1
1
1
1
1
1
1
1
0
表2.23—8线译码器真值表(输入高电平有效,输出低电平有效)
4.思考题
(1)利用两块8—3线优先编码器74LS148D设计16—4线优先编码电路,然后仿真验证16—4线优先编码的逻辑功能。
图2-516-4线优先编码电路
经验证,逻辑功能完全正确。
(2)利用两块3—8线译码器74LS138D设计4—16线优先编码电路,然后仿真验证4—16线译码的逻辑功能。
经验证,逻辑功能完全正确。
5.实验心得
本次实验主要掌握编码器、译码器的工作原理,并掌握了如何利用基础编码器设计位数更高的编码器。
知道了各个管脚的功能与连接方式,进一步学习了multisim软件的使用。
实验三竞争冒险电路仿真实验
1.实验目的
(1)掌握组合逻辑电路产生竞争冒险的原因。
(2)学会竞争冒险是否可能存在的判断方法。
(3)了解常用消除竞争冒险的方法。
2.实验原理
在组合逻辑电路中,由于门电路存在传输延时时间和信号状态变化的速度不一致等原因,使信号的变化出现快慢的差异,这种现象叫做竞争。
竞争的结果是使输出端可能出现错误的信号,这种现象叫做冒险。
所以有竞争不一定有冒险,有冒险一定存在竞争。
利用卡诺图可以判断组合逻辑电路是否存在竞争冒险现象,具体做法如下:
根据逻辑函数的表达四,做出其卡诺图,若卡诺图中填1的格所形成的卡诺图有两个相邻的圈相切,则该电路存在竞争冒险的可能性。
既然电路存在竞争就有可能产生冒险造成输出的错误动作,因此,必须杜绝竞争冒险现象的产生,常用的消除竞争冒险的方法有以下4种:
加取样脉冲,消除竞争冒险,修改逻辑设计,增加冗余项;在输出端接滤波电容;加封锁脉冲等。
3.实验电路及步骤
3.1电路
(1)0型冒险电路如图3-1所示,说明如下:
该电路的逻辑功能为
也就是说从逻辑功能上看不管信号如何变化,输出应该恒为1。
但由于74LS05D非门电路的延时,引起输出端在一小段时间内出现了不应该出现的低电平(负窄脉冲),这种现象称为0型冒险。
图3-10型冒险电路图3-21型冒险电路
(2)1型冒险电路如图3-2所示,说明如下:
该电路的逻辑功能为
,也就是说从逻辑功能上看不管信号是如何变化,输出应该恒为0。
但由于74LS04D非门电路的延时,引起输出端在一小段时间里出现了不应该出现的该电平(正窄脉冲),这种现象称为1型冒险。
(3)多输入信号同时变化时产生的冒险电路,具体电路如图3-3所示,说明如下:
该电路的逻辑功能为
,已知B=C=1,所以
,但是由于多输入信号的变化不同时引起该电路出现冒险的现象。
图3-3多输入信号同时变化时的冒险电路图3-4多输入信号用时变化时的冒险消除电路
3.2步骤
(1)0型冒险电路仿真实验步骤。
a.按图3-1所示连接电路。
b.进行实验仿真,记录仿真结果,说明现象。
图3-50型冒险电路仿真结果
仿真结果如图3-5所示,每当输入信号由高电平变为低电平时,输出端便会产生一个负窄脉冲。
c.考虑如何消除该电路出现的0型冒险现象。
可以在电路输出端串联一个适当的电感(由于本次实验选用的时钟信号频率较大,故选择1MH电感),当出现窄脉冲时,电感可感应出一电压抵消这一脉冲,达到平波的目的,实实验电路如图3-6所示。
图3-60型冒险消除电路
图3-70型冒险消除电路仿真结果
(2)1型冒险电路仿真实验步骤。
a.按图3-2所示连接电路。
b.进行实验仿真,记录仿真结果,说明现象。
图3-81型冒险电路仿真结果
仿真结果如图3-8所示,每当输入信号由低电平变为高电平时,输出端便会产生一个正窄脉冲。
c.考虑如何消除该电路出现的1型冒险现象。
同样运用串联电感的平波效应,可以消除该电路出现的1型冒险现象。
图3-91型冒险消除电路
图3-101型冒险消除电路仿真结果
(3)多输入信号同时变化时长生的冒险电路仿真实验步骤。
a.按图3-3所示连接电路。
b.利用卡诺图判断该电路存在竞争冒险的可能性(因为卡诺图中填1的格所形成的卡诺图有两个相邻的圈相切)。
运行实验仿真,记录结果并说明现象。
图3-11多输入信号冒险电路的仿真结果
仿真结果如图3-11所示。
当B=C=1时,该电路实际等同于0型冒险电路,每当输入信号由高电平变为低电平时,输出端便会产生一个负窄脉冲。
c.为了消除竞争冒险现象,采用修改逻辑设计,增加冗余项BC,使原逻辑表达式
变成
,采用修改后电路如图3-4所示,记录仿真结果。
仿真结果如图3-12所示。
图3-12多输入信号冒险消除电路仿真结果
4.思考题
如图3-13所示电路是否存在竞争冒险现象,若存在如何消除?
图3-13竞争冒险电路
图3-14竞争冒险电路仿真结果
当B=C=0时,原逻辑表达式
,存在冒险竞争,为消除竞争冒险现象,画卡诺图之后得出可以增加冗余项
与原输出进行或运算即可得出这个消除了冒险的图。
采用修改后电路如图3-15所示,记录仿真结果。
图3-15竞争冒险消除电路
图3-16竞争冒险消除电路仿真结果
5.实验心得
本次实验复习了课本上关于逻辑电路产生冒险竞争的原因、判断方法及消除方法。
并在Multism中运用元器件仿真了几个简单的逻辑电路,并成功消除了冒险竞争。
实验四触发器电路仿真实验
1.实验目的
(1)掌握边沿触发器的逻辑功能。
(2)逻辑不同边沿触发器逻辑功能之间的相互切换。
2.实验原理
触发器是构成时序电路的基本逻辑单元,具有记忆、存储二进制信息的功能。
从逻辑功能上将触发器分为RS、D、JK、T、T’等几种类型,对于逻辑功能的描述有真值表、波形图、特征方程等几种方法。
功能不同的触发器之间可以相互转换。
边沿触发器是指只在CP上升沿或下降沿到来时接受此刻的输入信号,进行状态转换,而其他时刻输入信号状态的变化对其没有影响的电路。
集成触发器通常具有异步置位、复位功能。
74LS74D是在一片芯片上包含两个完全独立边沿D触发器的集成电路。
对它的分析可分为以下三种情况:
(1)无论CP、D为何值,只要1~CLR=0,~1PR=1,触发器置0;只要~1CLR=1,~1PR=0,触发器置1。
(“~”表示非)
(2)当~1CLR=~1PR=0时为不允许状态、
(3)当~1CLR=~1PR=1且CP处于上升沿时,
74LS112D是在一芯片上饱和两个完全独立边沿JK触发器的集成电路。
对他的分析可分为以下三种情况。
(1)无论CP、J、K为何值,只要~1CLR=0,~1PR=1,触发器置0;只要~1CLR=1,~1PR=0,触发器置1。
(“~”表示非)
(2)当~1CLR=~1PR=0时为不允许状态。
(3)当~1CLR=~1PR=1且CP处于下降沿时,
。
图4-174LS74D逻辑符号和引脚注解
图4-274LS112D逻辑符号和引脚注解
3.实验电路及步骤
3.1电路
(1)D触发器仿真电路如图4-3所示,说明如下:
利用单刀双掷开关J1、J2、J3、J4切换输入管脚的信号电平状态,利用探测器X1观察输出管脚的信号电平状态。
用示波器查看输出管脚的信号波形。
图4-3D触发仿真电路
(2)JK触发器仿真电路如图4-4所示,说明如下:
图4-4JK触发器仿真电路
利用单刀双掷开关J1、J2、J3、J4、J5切换输入信号的信号电平状态,利用探测器X1观察输出管脚的信号电平状态。
用示波器查看输出管脚的信号波形。
3.2步骤
(1)D触发器仿真电路实验步骤。
a.按图4-1所示连接电路。
b.进行仿真电路实验,利用开关来改变~1PR、1D、~1CP、CP的状态,观察输出端1Q的变化,将结果填入表4.1并验证结果。
输入端的“1”表示接高电平,“0”表示接低电平,“x”表示接高、低电平都可以。
输出端的“1”表示探测器亮,“0”表示探测器灭。
表4.1边沿D触发器74LS74D真值表
输入端
现态
次态
CP
~CLP
~PR
D
0
0
0
1
0
1
0
1
1
1
1
0
0
1
1
1
1
1
(2)JK触发器仿真电路实验步骤。
a.按图4-2所示连接电路。
b.进行仿真电路实验,利用开关来改变~1PR、1J、1K、~1CP、CP的状态,观察输出端1Q的变化,将结果填入表4.2中并验证结果。
输入端中的“1”,表示接高电平,“0”表示低电平,“x”表示接高、低电平都可以。
输出端的“1”表示探测器亮,“0”表示探测器灭。
输入端
现态
次态
CP
~CLR
~PR
J
K
0
0
0
1
0
1
0
1
1
1
1
0
0
保持
1
1
1
1
0
1
1
1
1
0
1
0
1
1
1
1
1
翻转
表4.2JK触发器74LS112D真值表
4.思考题
由于D触发器使用方便,JK触发器功能最完善,怎样将JK触发器和D触发器分别转换成T触发器。
T触发器的逻辑表达式为
,JK触发器只需将J,K输入端连接同一信号便可,用D触发器转换成T触发器,则令
,只需在D输入端前增加一个异或门即可实现。
图4-5用D触发器转换的T触发器
图4-6用JK触发器转换的T触发器
5.实验心得
本次实验对D触发器、J触发器、T触发器的逻辑功能进行了复习,了解了74LS74D和74LS112D的逻辑符号和引脚注解,学会了如何用D触发器和JK触发器转换成T触发器。
实验五计数器电路仿真实验
1.实验目的
(1)了解计数器的日常应用和分类。
(2)熟悉集成计数器逻辑功能和其各控制端作用。
(3)掌握计数器使用方法。
2.实验原理
统计输入脉冲个数的过程叫计数。
能够完成计数工作的电路称作计数器。
计数器的基本功能是统计叫钟脉冲的个数,即实现计数操作,也可用于分频、定时、产生节拍脉冲等。
计数器的种类很多,根据计数脉冲引入方式的不同,将计数器分为同步计数器和异步计数器;根据计数过程中计数变化趋势,将计数器分为加法计数器、减法计数器、可逆计数器;根据计数器中计数长度的不同,可以将计数器分为二进制计数器和非二进制计数器(例如十进制、N进制)。
二进制计数器是构成其他各种计数器的基础。
按照计数器中计数值的编码方法,用n表示二进制代表,N表示状态位,满足
的计数器称作二进制计数器。
74LS161D是常见的二进制加法同步计数器,其引脚说明图如图5-1所示,其功能如表5.1所示。
74LS191D是常见的二进制加/减同步计数器,其引脚说明图如图5-2所示,其功能如表5.2所示。
表5.174LS161D功能表(~表示“非”)
输入
输出
~CLR
~LOAD
ENT
ENP
CLK
A
B
C
D
QA
QB
QC
QD
0
X
X
X
X
X
X
X
X
0
0
0
0
1
0
X
X
1
Da
Db
Dc
Dd
Da
Db
Dc
Dd
1
1
0
X
X
X
X
X
X
计数
1
1
0
X
X
X
X
X
X
保持
1
1
X
0
X
X
X
X
X
保持
表5.274LS191D功能表(~表示“非”)
输入
输出
~LOAD
~CTEN
~U/D
CLK
A
B
C
D
QA
QB
QC
QD
1
0
1
1
X
X
X
X
减法
1
0
0
1
X
X
X
X
加法
0
X
X
X
Da
Db
Dc
Dd
Da
Db
Dc
Dd
1
1
X
X
X
X
X
X
保持
若一计数器的计数长度(模)为10,则该计数器称为十进制计数器。
74LS62是常见的十进制加法同步计数器,其引脚说明图如图5-3所示,其引脚和功能与74LS161D二进制加法同步计数器类似。
74LS192D是常见双时钟同步十进制加/减计数器其引脚说明图如图5-4所示,。
3.实验电路及步骤
3.1电路
(1)74LS161D构成的二进制加法同步计数器。
具体电路如图5-5所示,说明如下:
a.该电路采用总线方式进行连接。
b.利用J2、J2、J3、J4四个单刀双掷开关可以切换74LS161D第7、10、9、1脚输入的高低电平状态。
74LS161D第3、4、5、6(4位二进制输入端)同时接高电平。
74LS161D第15脚(进位输出端)接探测器X1。
V1为时钟信号。
利用逻辑分析仪观察四位二进制输出端(第11、12、13、14脚)、进位输出端(第15脚)和时钟信号端(第2脚)的波形。
利用数码管U2显示计数器的计数情况。
图5-574LS161D构成的二进制加法同步计数器
(2)74LS191D构成的二进制加/减同步计数器,具体电路如图5-6所示,说明如下:
图5-674LS191D构成的二进制加/减同步计数器
利用J1、J2、J3三个单刀双掷开关可以切换74LS191D第5、11、4脚输入的高低电平状态。
74LS191D第1、9、10、15脚(4位二进制数输入端)同时接高电平。
74LS161D第12、13脚(最大与最小变换时的标志信号和进位输出端)分别接探测器X2、X1。
V1为时钟信号。
最小变换时的标志信号(第12脚)和时钟信号端(第14脚)的波形。
利用数码管U2显示计数器的计数情况。
3.2步骤
(1)74LS161D构成的二进制加法同步计数器仿真实验步骤。
a.按图5-5所示连接电路。
b.利用J1、J2、J3、J4四个单刀双掷开关切换74LS161D第1、7、9、10脚输入的高低电平状态,同时观察数码管U2的输出信号,验证表5.1给定的74LS161D功能是否与实验结果相吻合。
c.观测探测器X1发现当该计数器计满(计到数码管U2显示“F”时),探测器X1亮,表明进位输出端有进位输出且高电平有效。
d.逻辑分析仪观察的结果如图5-7所示,验证其结果是否与表5.1给定的74LS161D功能相吻合。
改变时钟信号V1的幅度和频率